2025/07/01 更新

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カワムラ カズシ
川村 一志
所属
理工学術院 基幹理工学部
職名
講師(専任)
学位
博士(工学) ( 2016年03月 早稲田大学 )
プロフィール

2025年4月~ 早稲田大学 基幹理工学部 電子物理システム学科 専任講師

情報処理推進機構未踏ターゲット事業2020年度採択者

JSTさきがけ「社会変革に向けたICT基盤強化」2023年度採択課題 研究者

経歴

  • 2025年04月
    -
    継続中

    早稲田大学   基幹理工学部   専任講師

  • 2024年10月
    -
    2025年03月

    東京科学大学   総合研究院   特任助教

  • 2020年04月
    -
    2025年03月

    早稲田大学   グリーン・コンピューティング・システム研究機構   招聘研究員

  • 2020年04月
    -
    2024年09月

    東京工業大学   科学技術創成研究院   特任助教

  • 2018年04月
    -
    2020年03月

    早稲田大学   理工学術院(基幹理工学部 情報通信学科)   講師(任期付)

  • 2017年04月
    -
    2018年03月

    早稲田大学   理工学術院総合研究所   次席研究員(研究院助教)

  • 2016年04月
    -
    2017年03月

    早稲田大学   大学院基幹理工学研究科 情報理工・情報通信専攻   博士研究員

  • 2015年04月
    -
    2017年03月

    日本学術振興会   特別研究員(DC2-PD)

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学歴

  • 2013年04月
    -
    2016年03月

    早稲田大学   大学院基幹理工学研究科   情報理工学専攻 博士後期課程  

  • 2012年04月
    -
    2013年03月

    早稲田大学   大学院基幹理工学研究科   情報理工学専攻 修士課程  

  • 2007年04月
    -
    2012年03月

    早稲田大学   基幹理工学部   情報理工学科  

委員歴

  • 2023年04月
    -
    継続中

    情報処理学会  論文誌System LSI Design Methodology 編集委員

  • 2023年04月
    -
    継続中

    情報処理学会  システムとLSIの設計技術(SLDM)研究会 運営委員

  • 2023年01月
    -
    継続中

    Treasurer of IEEE CAS Society Japan Joint Chapter

  • 2021年09月
    -
    継続中

    Publicity Co-Chair of ASP-DAC

  • 2020年09月
    -
    継続中

    Technical Program Committee Member of SASIMI

  • 2021年10月
    -
    2023年12月

    電子情報通信学会  回路とシステム小特集 編集委員

  • 2021年04月
    -
    2023年03月

    情報処理学会  システムとLSIの設計技術(SLDM)研究会 幹事

  • 2021年01月
    -
    2022年12月

    Treasurer of IEEE CEDA All Japan Joint Chapter

  • 2020年09月
    -
    2022年11月

    電子情報通信学会  回路とシステムワークショップ 実行委員

  • 2016年09月
    -
    2022年04月

    Program Committee Member of COOL Chips

  • 2017年04月
    -
    2021年03月

    情報処理学会  システムとLSIの設計技術(SLDM)研究会 運営委員

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所属学協会

  • 2016年07月
    -
    継続中

    IEEE

  • 2013年01月
    -
    継続中

    IPSJ

  • 2012年11月
    -
    継続中

    IEICE

研究分野

  • 計算機システム / ソフトコンピューティング

研究キーワード

  • 組合せ最適化

  • アニーリングプロセッサ

  • イジング計算機

  • FPGA

  • LSI設計技術

  • 高位合成

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受賞

  • 2023年度コンピュータサイエンス領域功績賞

    2024年08月   情報処理学会   システムとLSIの設計技術研究会  

    受賞者: 川村 一志

  • ISOCC Best Paper Award

    2016年10月   A high-performance circuit design algorithm using data dependent approximation  

    受賞者: Kazushi Kawamura

  • アルゴリズムデザインコンテスト特別賞

    2019年08月   DAシンポジウム2019   配置配線のためのアンサンブルソルバシステム  

    受賞者: 西澤 誠人, 石川 遼太, 長谷川 健人, 川村 一志, 多和田 雅師, 戸川 望

  • アルゴリズムデザインコンテスト特別賞

    2018年08月   DAシンポジウム2018   ナンバーリンクソルバのためのFPGA協調システム  

    受賞者: 石川 遼太, 西澤 誠人, 長谷川 健人, 川村 一志, 多和田 雅師, 戸川 望

  • アルゴリズムデザインコンテスト最優秀賞

    2017年08月   DAシンポジウム2017   組込みデバイスとFPGAを用いたナンバーリンクソルバの設計と実装  

    受賞者: 長谷川 健人, 石川 遼太, 寺田 晃太朗, 川村 一志, 多和田 雅師, 戸川 望

  • アルゴリズムデザインコンテスト最優秀賞兼特別賞

    2016年09月   DAシンポジウム2016   機械学習とFPGAを用いたナンバーリンクソルバ  

    受賞者: 寺田 晃太朗, 長谷川 健人, 川村 一志, 多和田 雅師, 戸川 望

  • 情報処理学会SLDM優秀発表学生賞

    2015年12月   タイミングエラー予測回路によるデータ依存最適化回路設計とそのFPGA評価  

    受賞者: 川村 一志

  • アルゴリズムデザインコンテスト優秀賞

    2015年08月   DAシンポジウム2015   機械学習を用いたナンバーリンクソルバ  

    受賞者: 寺田 晃太朗, 川村 一志, 多和田 雅師, 藤原 晃一, 戸川 望

  • 情報処理学会SLDM優秀発表学生賞

    2014年11月   タイミングエラー予測回路による再構成可能デバイス上でのデータ依存最適化回路設計  

    受賞者: 川村 一志

  • アルゴリズムデザインコンテスト特別賞

    2014年08月   DAシンポジウム2014   発見的アルゴリズムによるナンバーリンクソルバ  

    受賞者: 多和田 雅師, 阿部 晋矢, 川村 一志, 藤代 美佳

  • 情報処理学会SLDM優秀発表学生賞

    2013年11月   信頼性と時間オーバーヘッド間のトレードオフを考慮した面積制約にもとづくRDRアーキテクチャ向けフォールトセキュア高位合成手法  

    受賞者: 川村 一志

  • 情報処理学会SLDM優秀発表学生賞

    2012年11月   島内消費電力量見積もりにもとづく温度特性を考慮したRDRアーキテクチャ向け高位合成手法  

    受賞者: 川村 一志

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論文

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講演・口頭発表等

  • Amorphica: fully connected metamorphic annealing processor with programmable optimization strategy

    Kazushi Kawamura, Jaehoon Yu, Daiki Okonogi, Satoru Jimbo, Genta Inoue, Akira Hyodo, Ángel López García-Arias, Kota Ando, Bruno Hideki Fukushima-Kimura, Ryota Yasudo, Thiem Van Chu, Masato Motomura  [招待有り]

    30th Asia and South Pacific Design Automation Conference (ASP-DAC)  

    発表年月: 2025年01月

  • 2スピン同時更新アニーリングプロセッサを活用したナンプレソルバ

    川村 一志, 兵藤 旭, 小此木 大輝, 神保 聡, Thiem Van Chu, 本村真人

    DAシンポジウム2024  

    発表年月: 2024年08月

  • A parallel-trial double-update annealing algorithm for enabling highly-effective state transition on annealing processors

    Akira Hyodo, Satoru Jimbo, Daiki Okonogi, Genta Inoue, Thiem Van Chu, Masato Motomura, Kazushi Kawamura

    DAC 2024: The Chips to Systems Conference  

    発表年月: 2024年06月

  • イジングマシンとボルツマンマシンを活用した自律的な組合せ最適化

    川村 一志

    フォレストワークショップ2024  

    発表年月: 2024年03月

  • 自律的な組合せ最適化システムのための双方向最適化ソルバ

    川村 一志

    情報処理学会 第86回全国大会 Society 5.0時代の安心・安全・信頼を支える基盤ソフトウェア技術の構築  

    発表年月: 2024年03月

  • 学習/数理モデルに基づく時空間展開型アーキテクチャの創出と応用プロジェクトの社会実装

    川村 一志  [招待有り]

    FIT2023 第22回情報科学技術フォーラム イベント企画 Society 5.0社会のためのコンピューティング技術をどう生かすか?  

    発表年月: 2023年09月

  • 問題に応じて計算手法を選択・最適化するアニーリングプロセッサLSI「Amorphica」

    川村 一志  [招待有り]

    FIT2023 第22回情報科学技術フォーラム トップコンファレンス6-2 ハードウェア  

    発表年月: 2023年09月

  • Amorphica: 4-replica 512 fully connected spin 336MHz metamorphic annealer with programmable optimization strategy and compressed-spin-transfer multi-chip extension

    川村 一志  [招待有り]

    ISSCC 2023 国内報告会  

    発表年月: 2023年03月

  • 組合せ最適化のための最先端ハードウェア

    川村 一志

    IPSJ-ONE 2022  

    発表年月: 2022年03月

  • GPU-based acceleration of fully parallel annealing algorithm for combinatorial optimization

    Kazushi Kawamura, Kaisei Okawa, Gregory Gutmann, Thiem Van Chu, Jaehoon Yu, Masato Motomura

    34th IEEE International System-on-Chip Conference (SOCC)  

    発表年月: 2021年09月

  • Improvement in convergence speed of fully-parallel annealing algorithm with spin-update restriction

    Kazushi Kawamura, Thiem Van Chu, Jaehoon Yu, Masato Motomura

    10th International Conference on Adiabatic Quantum Computing (AQC)  

    発表年月: 2021年06月

  • 全結合・全並列型アニーリングコンセプトによる組合せ最適化ソルバーHW技術の紹介:その数理モデルからLSI実装まで

    川村 一志  [招待有り]

    第16回AIチップ設計拠点フォーラム  

    発表年月: 2020年10月

  • Ising formulations for solving grid-based LSI routing problems

    Kazushi Kawamura, Shu Tanaka, Nozomu Togawa

    8th International Conference on Adiabatic Quantum Computing (AQC)  

    発表年月: 2019年06月

  • 処理性能と消費電力のトレードオフを解消するApproximate Computing技術

    川村一志

    早稲田大学 アンビエントロニクス研究所 第2回ワークショップ  

    発表年月: 2018年11月

  • Ph.D企画セッション パネリスト

    川村一志

    IEEE SSCS Japan Chapter VDECデザイナーズフォーラム  

    発表年月: 2015年08月

  • A floorplan-aware high-level synthesis technique with delay-variation tolerance

    Kazushi Kawamura, Yuta Hagio, Youhua Shi, Nozomu Togawa  [招待有り]

    2015 IEEE International Conference on Electron Devices and Solid-State Circuits (EDSSC)  

    発表年月: 2015年06月

  • Floorplan-driven architecture and high-level synthesis for hot-spot temperature optimization

    Kazushi Kawamura, Nozomu Togawa  [招待有り]

    29th International Technical Conference on Circuits/Systems, Computers and Communications (ITC-CSCC)  

    発表年月: 2014年07月

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共同研究・競争的資金等の研究課題

  • 超高次元分散ベクトル表現を基軸とする融合型AIコンピューティング基盤の開拓

    日本学術振興会  科学研究費助成事業

    研究期間:

    2023年04月
    -
    2028年03月
     

    本村 真人, 安戸 僚汰, 安藤 洸太, Thiem Van Chu, 川村 一志

  • 解とモデルの相互最適化に基づく自律型アニーリングマシンの開発

    日本学術振興会  科学研究費助成事業

    研究期間:

    2024年04月
    -
    2027年03月
     

    川村 一志

  • AIを活用したユーザ主体の組合せ最適化システム

    国立研究開発法人科学技術振興機構  戦略的創造研究推進事業(さきがけ)

    研究期間:

    2023年10月
    -
    2027年03月
     

    川村 一志

Misc

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産業財産権

  • アニーリング処理システム、管理装置、チップ、アニーリング処理方法及びプログラム

    川村 一志, 劉 載勲, 本村 真人

    特許権

  • アニーリング処理装置、アニーリング処理方法及びプログラム

    川村 一志, 劉 載勲, 本村 真人

    特許権

  • アニーリング処理装置、アニーリング処理方法及びプログラム

    川村 一志, 神保 聡, 戸川 望, 白井 達彦

    特許権

  • 情報処理装置、情報処理方法及びプログラム

    川村 一志, 本村 真人

    特許権

 

現在担当している科目

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担当経験のある科目(授業)

  • 最適化システム設計

    早稲田大学  

    2025年04月
    -
    継続中
     

  • Javaプログラミング入門

    早稲田大学  

    2021年04月
    -
    2024年03月
     

  • IoTシステム設計

    早稲田大学  

    2019年04月
    -
    2020年03月
     

  • Cプログラミング入門

    早稲田大学  

    2018年04月
    -
    2020年03月
     

 

他学部・他研究科等兼任情報

  • 理工学術院   大学院基幹理工学研究科

特定課題制度(学内資金)

  • 準同型暗号ライブラリの高速化に向けたCPU/FPGA協調設計

    2019年  

     概要を見る

    本研究では、準同型暗号ライブラリHElibを対象に3課題(1.準同型暗号ライブラリに含まれるボトルネック演算の特定、2.ボトルネック演算に対するハードウェアの設計、3.SW/HW間の効率的なデータ転送技術の確立)に取り組んだ。課題1の解決に向けてHElibに比較演算処理を実装し、乗算オペレータ中に含まれるBluestein FFT演算がボトルネック演算であることを確認した。次に、課題2に関連してパイプライン効率の高いFFTプロセッサを開発した。最後に、SW/HW間の効率的なデータ転送を可能にするI/Oハードウェア実現に向け、循環リストベースの優先度キューをハードウェア実装し、対ベースライン実装比で22.8倍の高速化を達成した。

  • 標本数を任意に設定可能な離散フーリエ変換アクセラレータの設計と実装

    2018年  

     概要を見る

    本研究では,信号処理や暗号演算に用いられる離散フーリエ変換(DFT)の高速化に向けたハードウェアアクセラレータ設計に取り組んだ.本研究が対象とするDFTは標本数が2のべき乗でないことを前提とし,加えて,数千~数万の標本数に対応可能である点から既存研究と大きく異なる.標本数が2のべき乗でないDFTの高速アルゴリズムとしてBluesteinFFTを採用するとともに,高位合成時に適用可能な最適化技術を組み合わせることで,FPGA上で高速動作するハードウェアアクセラレータを構築した.本アクセラレータについて,計算機実験により対CPU比で3倍程度高速に動作可能であることを確認している.