経歴
-
2009年04月-継続中
早稲田大学 理工学術院 教授
-
2005年04月-2009年03月
早稲田大学 理工学術院 助教授・准教授
-
2001年04月-2005年03月
北九州市立大学 国際環境工学部 助教授
-
2000年04月-2001年03月
早稲田大学 理工学総合研究センター 講師
-
1997年04月-2000年03月
早稲田大学 理工学部 助手
2024/07/02 更新
1992年早稲田大学理工学部卒業。1997年同大学院理工学研究科博士後期課程修了。同年博士(工学)。早稲田大学助手・講師、北九州市立大学助教授等を経て、2009年より早稲田大学理工学術院教授(現在に至る)。集積システム設計、量子計算、セキュリティ等が専門。
早稲田大学 理工学術院 教授
早稲田大学 理工学術院 助教授・准教授
北九州市立大学 国際環境工学部 助教授
早稲田大学 理工学総合研究センター 講師
早稲田大学 理工学部 助手
早稲田大学大学院 理工学研究科 電気工学専攻博士後期課程
早稲田大学大学院 理工学研究科 電気工学専攻修士課程
早稲田大学 理工学部 電子通信学科
電子情報通信学会VLSI設計技術研究専門委員会 委員
内閣サイバーセキュリティセンター(NISC) 研究開発戦略専門調査会委員
総務省サイバーセキュリティタスクフォース 構成員
IEEE Circuits and Systems Society, Japan Joint Chapter Chair
電子情報通信学会基礎・境界ソサイエティ 特別委員
情報処理学会 高度交通システムとスマートコミュニティ研究会 委員
IEEE Circuits and Systems Society, Japan Joint Chapter Vice Chair
IEEE/ACM Asia South Pacific Design Automation Conference Steering Committee Secretary
電子情報通信学会VLSI設計技術研究専門委員会 委員長
IEEE Circuits and Systems Society, Japan Joint Chapter Secretary
電子情報通信学会VLSI設計技術研究専門委員会 副委員長
IPSJ Transactions on System LSI Design Methodology Editor-in-Chief
電子情報通信学会基礎・境界ソサイエティ 特別委員
情報処理学会システムとLSIの設計技術研究会 委員
電子情報通信学会VLSI設計技術研究専門委員会 専門委員
電子情報通信学会 アクレディエーション委員会 幹事
情報処理学会論文誌編集委員会基盤グループ 主査
情報処理学会システムLSI設計技術研究会 幹事
電子情報通信学会基礎・境界ソサイエティ 幹事
電子情報通信学会 リコンフィギャラブルシステム研究専門委員会 専門委員
電子情報通信学会 アクレディエーション委員会 委員
情報処理学会システムLSI設計技術研究会 委員
電子情報通信学会VLSI設計技術研究専門委員会 幹事
電子情報通信学会 VLSI設計技術研究専門委員会 専門委員
電子情報通信学会 会誌編集委員会 委員
ACM
IEEE
情報処理学会
電子情報通信学会
集積システム設計
量子計算
情報セキュリティ
テレコムシステム技術奨励賞
2024年03月 電気通信普及財団
SCOPE成果展開推進賞
2022年12月 総務省
科学技術分野の文部科学大臣表彰・科学技術賞(研究部門)
2018年04月 文部科学省 集積回路の革新的設計技術とそのセキュリティ応用研究
最優秀論文賞
2017年09月 IEEE ICCE-Berlin A robust scan-based side-channel attack method against HMAC-SHA-256 circuits
最優秀論文賞
2016年10月 IEEE International SoC Conference A high-performance circuit design algorithm using datadependent approximation
テレコムシステム技術賞
2011年03月 電気通信普及財団
(財)船井情報科学財団 船井学術賞
2010年04月
(財)丸文研究交流財団 丸文研究奨励賞
2010年03月
IEEE DAC/ISSCC Student Design Contest, 1st Place
2006年07月
(財)武田計測先端知財団,武田研究奨励賞優秀賞
2001年12月
丹羽記念会平成9年度(第21回)丹羽記念賞
1998年02月
(財)安藤研究所第9回安藤博記念学術奨励賞
1996年06月
電子情報通信学会 第8回回路とシステム軽井沢ワークショップ 研究奨励賞
1996年04月
早稲田大学平成7年度小野梓記念学術賞
1996年03月
早稲田大学平成7年度大川功記念賞
1996年03月
Best Paper Award (IEEE Asia and South Pacific Design Automation Conference 1995)
1995年08月
(財)電気通信普及財団第10回テレコムシステム技術学生賞
1995年03月
Satoru Jimbo, Tatsuhiko Shirai, Nozomu Togawa, Masato Motomura, Kazushi Kawamura
IEEE Access 12 43660 - 43673 2024年 [査読有り]
Optimization of Practical Time-Dependent Vehicle Routing Problem by Ising Machines.
Yui Tsuyumine, Kenichi Masuda, Takeshi Hachikawa, Tsuyoshi Haga, Yuta Yachi, Tatsuhiko Shirai, Masashi Tawada, Nozomu Togawa
ICCE 1 - 5 2024年 [査読有り]
担当区分:最終著者
Time-Dependent Multi-Objective Trip Planning by Ant Colony Optimization with Route API.
Etsushi Saeki, Siya Bao, Toshinori Takayama, Nozomu Togawa
ICCE 1 - 2 2024年 [査読有り]
担当区分:最終著者
Evaluation of Ensemble Learning Models for Hardware-Trojan Identification at Gate-level Netlists.
Ryotaro Negishi, Nozomu Togawa
ICCE 1 - 6 2024年 [査読有り]
担当区分:最終著者
An Interaction Coefficient Control Method for Setting Initial Solutions to Ising Machines.
Soma Kawakami, Kentaro Ohno, Dema Ba, Satoshi Yagi, Junji Teramoto, Nozomu Togawa
ICCE 1 - 2 2024年 [査読有り]
担当区分:最終著者
Carrying-Mode-Free Stair Ascent and Descent Estimation using Smartphones.
Dai Kajimoto, Etsushi Saeki, Siya Bao, Nozomu Togawa
ICCE 1 - 6 2024年 [査読有り]
担当区分:最終著者
Gen-Power: Anomaly Detection in IoT Devices Utilizing Generated Power Waveforms.
Kota Hisafuru, Nozomu Togawa
ICCE 1 - 6 2024年 [査読有り]
担当区分:最終著者
Hybrid Iterative Annealing Method Using a Quantum Annealer and a Classical Computer.
Keisuke Fukada, Tatshuhiko Shirai, Nozomu Togawa
ICCE 1 - 6 2024年 [査読有り]
担当区分:最終著者
An Anomalous Behavior Detection Method Utilizing IoT Power Waveform Shapes.
Kota Hisafuru, Kazunari Takasaki, Nozomu Togawa
IEICE Trans. Fundam. Electron. Commun. Comput. Sci. 107 ( 1 ) 75 - 86 2024年01月 [査読有り]
担当区分:最終著者
Ryotaro Negishi, Tatsuki Kurihara, Nozomu Togawa
IEICE Trans. Fundam. Electron. Commun. Comput. Sci. 107 ( 1 ) 63 - 74 2024年01月 [査読有り]
担当区分:最終著者
Soma Kawakami, Kentaro Ohno, Dema Ba, Satoshi Yagi, Junji Teramoto, Nozomu Togawa
IEICE Trans. Fundam. Electron. Commun. Comput. Sci. 107 ( 1 ) 52 - 62 2024年01月 [査読有り]
担当区分:最終著者
Ising-Machine-Based Solver for Constrained Graph Coloring Problems.
Soma Kawakami, Yosuke Mukasa, Siya Bao, Dema Ba, Junya Arai, Satoshi Yagi, Junji Teramoto, Nozomu Togawa
IEICE Trans. Fundam. Electron. Commun. Comput. Sci. 107 ( 1 ) 38 - 51 2024年01月 [査読有り]
担当区分:最終著者
An Efficient Combined Bit-Width Reducing Method for Ising Models.
Yuta Yachi, Masashi Tawada, Nozomu Togawa
IEICE Trans. Inf. Syst. 106 ( 4 ) 495 - 508 2023年04月 [査読有り]
担当区分:最終著者
Multi-Spin-Flip Engineering in an Ising Machine.
Tatsuhiko Shirai, Nozomu Togawa
IEEE Trans. Computers 72 ( 3 ) 759 - 771 2023年03月 [査読有り]
担当区分:最終著者
R-HTDetector: Robust Hardware-Trojan Detection Based on Adversarial Training.
Kento Hasegawa, Seira Hidano, Kohei Nozawa, Shinsaku Kiyomoto, Nozomu Togawa
IEEE Trans. Computers 72 ( 2 ) 333 - 345 2023年02月 [査読有り]
担当区分:最終著者
QuDASH: Quantum-Inspired Rate Adaptation Approach for DASH Video Streaming.
Bo Wei, Hang Song, Makoto Nakamura, Koichi Kimura, Nozomu Togawa, Jiro Katto
IEEE Access 11 118462 - 118473 2023年 [査読有り]
Trip Planning Based on subQUBO Annealing.
Tatsuya Noguchi, Keisuke Fukada, Siya Bao, Nozomu Togawa
IEEE Access 11 100383 - 100395 2023年 [査読有り]
担当区分:最終著者
Dynamical Process of a Bit-Width Reduced Ising Model With Simulated Annealing.
Shuta Kikuchi, Nozomu Togawa, Shu Tanaka
IEEE Access 11 95493 - 95506 2023年 [査読有り]
Fast and Accurate Smartglass Angles Inference Based on Periodic Behavior in Walking.
Dai Sato, Nozomu Togawa
ICCE 1 - 6 2023年 [査読有り]
Fast Hyperparameter Tuning for Ising Machines.
Matthieu Parizy, Norihiro Kakuko, Nozomu Togawa
ICCE 1 - 6 2023年 [査読有り]
Soma Kawakami, Kentaro Ohno, Dema Ba, Satoshi Yagi, Junji Teramoto, Nozomu Togawa
ICCE 1 - 6 2023年 [査読有り]
A Constrained Graph Coloring Solver Based on Ising Machines.
Soma Kawakami, Yosuke Mukasa, Siya Bao, Dema Ba, Junya Arai, Satoshi Yagi, Junji Teramoto, Nozomu Togawa
ICCE 1 - 6 2023年 [査読有り]
Cardinality Constrained Portfolio Optimization on an Ising Machine.
Matthieu Parizy, Przemyslaw Sadowski, Nozomu Togawa
SOCC 1 - 6 2022年 [査読有り]
Effective Hardware-Trojan Feature Extraction Against Adversarial Attacks at Gate-Level Netlists.
Kazuki Yamashita, Tomohiro Kato, Kento Hasegawa, Seira Hidano, Kazuhide Fukushima, Nozomu Togawa
IOLTS 1 - 7 2022年 [査読有り]
An Anomalous Behavior Detection Method for IoT Devices Based on Power Waveform Shapes.
Kota Hisafuru, Kazunari Takasaki, Nozomu Togawa
IOLTS 1 - 7 2022年 [査読有り]
Hardware-Trojan Detection at Gate-level Netlists using Gradient Boosting Decision Tree Models.
Ryotaro Negishi, Tatsuki Kurihara, Nozomu Togawa
ICCE-Berlin 1 - 6 2022年 [査読有り]
Autonomous driving system with feature extraction using a binarized autoencoder.
Kota Hisafuru, Ryotaro Negishi, Soma Kawakami, Dai Sato, Kazuki Yamashita, Keisuke Fukada, Nozomu Togawa
FPT 1 - 4 2022年 [査読有り]
Multi-Objective Trip Planning Based on Ant Colony Optimization Utilizing Trip Records.
Etsushi Saeki, Siya Bao, Toshinori Takayama, Nozomu Togawa
IEEE Access 10 127825 - 127844 2022年 [査読有り]
Hybrid Annealing Method Based on subQUBO Model Extraction With Multiple Solution Instances.
Yuta Atobe, Masashi Tawada, Nozomu Togawa
IEEE Transactions on Computers 71 ( 10 ) 2606 - 2619 2022年 [査読有り]
担当区分:最終著者
Hardware-Trojan Detection Based on the Structural Features of Trojan Circuits Using Random Forests.
Tatsuki Kurihara, Nozomu Togawa
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences 105-A ( 7 ) 1049 - 1060 2022年 [査読有り]
QUBO Matrix Distorting Method for Consumer Applications.
Tomokazu Yoshimura, Tatsuhiko Shirai, Masashi Tawada, Nozomu Togawa
ICCE 1 - 6 2022年 [査読有り]
Efficient Coefficient Bit-Width Reduction Method for Ising Machines.
Yuta Yachi, Yousuke Mukasa, Masashi Tawada, Nozomu Togawa
ICCE 1 - 6 2022年 [査読有り]
A PDR Method Using Smartglasses Reducing Accumulated Errors by Detecting User's Stop Motions.
Dai Sato, Nozomu Togawa
ICCE 1 - 2 2022年 [査読有り]
Carrying-mode Free Indoor Positioning Using Smartphone and Smartwatch and Its Evaluations.
Tomoya Wakaizumi, Nozomu Togawa
J. Inf. Process. 30 52 - 65 2022年 [査読有り]
Kazunari Takasaki, Ryoichi Kida, Nozomu Togawa
Proceedings - 2021 IEEE 27th International Symposium on On-Line Testing and Robust System Design, IOLTS 2021 1 - 7 2021年06月 [査読有り]
Hardware-trojan classification based on the structure of trigger circuits utilizing random forests
Tatsuki Kurihara, Nozomu Togawa
Proceedings - 2021 IEEE 27th International Symposium on On-Line Testing and Robust System Design, IOLTS 2021 1 - 4 2021年06月 [査読有り]
Data Augmentation for Machine Learning-Based Hardware Trojan Detection at Gate-Level Netlists
Kento Hasegawa, Seira Hidano, Kohei Nozawa, Shinsaku Kiyomoto, Nozomu Togawa
Proceedings - 2021 IEEE 27th International Symposium on On-Line Testing and Robust System Design, IOLTS 2021 1 - 4 2021年06月 [査読有り]
An Approach to the Vehicle Routing Problem with Balanced Pick-up Using Ising Machines
Siya Bao, Masashi Tawada, Shu Tanaka, Nozomu Togawa
2021 International Symposium on VLSI Design, Automation and Test, VLSI-DAT 2021 - Proceedings 2021年04月 [査読有り]
Natsuhito Yoshimura, Masashi Tawada, Shu Tanaka, Junya Arai, Satoshi Yagi, Hiroyuki Uchiyama, Nozomu Togawa
IEICE Transactions on Information and Systems E104.D ( 4 ) 481 - 489 2021年04月 [査読有り]
Solving constrained slot placement problems using an ising machine and its evaluations
Sho Kanamaru, Kazushi Kawamura, Shu Tanaka, Yoshinori Tomita, Nozomu Togawa
IEICE Transactions on Information and Systems E104D ( 2 ) 226 - 236 2021年02月 [査読有り]
An Indoor Positioning Method using Smartphone and Smartwatch Independent of Carrying Modes
Tomoya Wakaizumi, Nozomu Togawa
Digest of Technical Papers - IEEE International Conference on Consumer Electronics 2021-January 2021年01月 [査読有り]
Visiting-Route Recommendation in Amusement Parks and its Evaluations by an Ising Machine
Yosuke Mukasa, Tomoya Wakaizumi, Shu Tanaka, Nozomu Togawa
Digest of Technical Papers - IEEE International Conference on Consumer Electronics 2021-January 1 - 6 2021年01月 [査読有り]
Shota Matsuno, Masashi Tawada, Nozomu Togawa
Digest of Technical Papers - IEEE International Conference on Consumer Electronics 2021-January 1 - 6 2021年01月 [査読有り]
Multi-day Travel Planning Using Ising Machines for Real-world Applications.
Siya Bao, Masashi Tawada, Shu Tanaka, Nozomu Togawa
24th IEEE International Intelligent Transportation Systems Conference(ITSC) 3704 - 3709 2021年 [査読有り]
A PDR Method Combining Smartphone and Smartwatch based on Multi-Scenario Map Matching.
Tomoya Wakaizumi, Nozomu Togawa
GCCE 308 - 309 2021年 [査読有り]
An autonomous driving system utilizing image processing accelerated by FPGA.
Kazunari Takasaki, Kota Hisafuru, Ryotaro Negishi, Kazuki Yamashita, Keisuke Fukada, Tomoya Wakaizumi, Nozomu Togawa
FPT 1 - 4 2021年 [査読有り]
Toward Learning Robust Detectors from Imbalanced Datasets Leveraging Weighted Adversarial Training.
Kento Hasegawa, Seira Hidano, Shinsaku Kiyomoto, Nozomu Togawa
CANS 392 - 411 2021年 [査読有り]
A Three-Stage Annealing Method Solving Slot-Placement Problems Using an Ising Machine.
Keisuke Fukada, Matthieu Parizy, Yoshinori Tomita, Nozomu Togawa
IEEE Access 9 134413 - 134426 2021年 [査読有り]
Experimental evaluations of parallel tempering on an ising machine
Yosuke Mukasa, Shu Tanaka, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 14 27 - 29 2021年 [査読有り]
Performance Comparison of Typical Binary-Integer Encodings in an Ising Machine
Kensuke Tamura, Tatsuhiko Shirai, Hosho Katsura, Shu Tanaka, Nozomu Togawa
IEEE Access 9 81032 - 81039 2021年 [査読有り]
Generating adversarial examples for hardware-trojan detection at gate-level netlists
Kohei Nozawa, Kento Hasegawa, Seira Hidano, Shinsaku Kiyomoto, Kazuo Hashimoto, Nozomu Togawa
Journal of Information Processing 29 236 - 246 2021年 [査読有り]
Yuta Ishizaki, Yurie Koyama, Toshinori Takayama, Nozomu Togawa
Journal of Information Processing 29 81 - 92 2021年 [査読有り]
A capacitance measurement device for running hardware devices and its evaluations
Makoto Nishizawa, Kento Hasegawa, Nozomu Togawa
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E103A ( 9 ) 1018 - 1027 2020年09月 [査読有り]
Trojan-net classification for gate-level hardware design utilizing boundary net structures
Kento Hasegawa, Masao Yanagisawa, Nozomu Togawa
IEICE Transactions on Information and Systems E103D ( 7 ) 1618 - 1622 2020年07月 [査読有り]
Kazunari Takasaki, Kento Hasegawa, Ryoichi Kida, Nozomu Togawa
Proceedings - 2020 26th IEEE International Symposium on On-Line Testing and Robust System Design, IOLTS 2020 1 - 4 2020年07月 [査読有り]
Evaluation on Hardware-Trojan Detection at Gate-Level IP Cores Utilizing Machine Learning Methods
Tatsuki Kurihara, Kento Hasegawa, Nozomu Togawa
Proceedings - 2020 26th IEEE International Symposium on On-Line Testing and Robust System Design, IOLTS 2020 1 - 4 2020年07月 [査読有り]
Masashi Tawada, Nozomu Togawa
NEWCAS 2020 - 18th IEEE International New Circuits and Systems Conference, Proceedings 271 - 274 2020年06月 [査読有り]
Siya Bao, Nozomu Togawa
Proceedings - 14th IEEE International Conference on Semantic Computing, ICSC 2020 311 - 314 2020年02月 [査読有り]
Multi-Resolutional Image Format Using Stochastic Numbers and Its Hardware Implementation
Ryota Ishikawa, Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
2020 IEEE 11th Latin American Symposium on Circuits and Systems, LASCAS 2020 1 - 4 2020年02月 [査読有り]
Adversarial examples for hardware-trojan detection at gate-level netlists
Kohei Nozawa, Kento Hasegawa, Seira Hidano, Shinsaku Kiyomoto, Kazuo Hashimoto, Nozomu Togawa
Lecture Notes in Computer Science (including subseries Lecture Notes in Artificial Intelligence and Lecture Notes in Bioinformatics) 11980 LNCS 341 - 359 2020年 [査読有り]
How to Reduce the Bit-width of an Ising Model by Adding Auxiliary Spins
Daisuke Oku, Masashi Tawada, Shu Tanaka, Nozomu Togawa
IEEE Transactions on Computers 71 ( 1 ) 223 - 234 2020年 [査読有り]
Guiding Principle for Minor-Embedding in Simulated-Annealing-Based Ising Machines
Tatsuhiko Shirai, Shu Tanaka, Nozomu Togawa
IEEE Access 8 210490 - 210502 2020年 [査読有り]
A new LDPC code decoding method: Expanding the scope of ising machines
Masashi Tawada, Shu Tanaka, Nozomu Togawa
Digest of Technical Papers - IEEE International Conference on Consumer Electronics 2020-January 1 - 6 2020年01月 [査読有り]
Theory of Ising Machines and a Common Software Platform for Ising Machines
Shu Tanaka, Yoshiki Matsuda, Nozomu Togawa
Proceedings of the Asia and South Pacific Design Automation Conference, ASP-DAC 2020-January 659 - 666 2020年01月 [査読有り]
FPGA-based Heterogeneous Solver for Three-Dimensional Routing
Kento Hasegawa, Ryota Ishikawa, Makoto Nishizawa, Kazushi Kawamura, Masashi Tawada, Nozomu Togawa
Proceedings of the Asia and South Pacific Design Automation Conference, ASP-DAC 2020-January 11 - 12 2020年01月 [査読有り]
Scalable stochastic number duplicators for accuracy-flexible arithmetic circuit design
Ryota Ishikawa, Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 13 10 - 20 2020年 [査読有り]
A travel decision support algorithm: Landmark activity extraction from japanese travel comments
Siya Bao, Masao Yanagisawa, Nozomu Togawa
Studies in Computational Intelligence 849 109 - 123 2020年 [査読有り]
Implementation of a ROS-Based Autonomous Vehicle on an FPGA Board
Kento Hasegawa, Kazunari Takasaki, Makoto Nishizawa, Ryota Ishikawa, Kazushi Kawamura, Nozomu Togawa
2019 International Conference on Field-Programmable Technology (ICFPT) 2019年12月
A fully-connected ising model embedding method and its evaluation for CMOS annealing machines
Oku, D., Terada, K., Hayashi, M., Yamaoka, M., Tanaka, S., Togawa, N.
IEICE Transactions on Information and Systems E102D ( 9 ) 2019年
Usami, Y., Ishikawa, K., Takayama, T., Yanagisawa, M., Togawa, N.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E102A ( 8 ) 953 - 965 2019年 [査読有り]
Jinghao Ye, Nozomu Togawa, Masao Yanagisawa, Youhua Shi
IEEE International Symposium on Circuits and Systems, ISCAS 2019, Sapporo, Japan, May 26-29, 2019 2019-May 1 - 4 2019年 [査読有り]
Efficient Ising Model Mapping to Solving Slot Placement Problem.
Sho Kanamaru, Daisuke Oku, Masashi Tawada, Shu Tanaka, Masato Hayashi, Masanao Yamaoka, Masao Yanagisawa, Nozomu Togawa
IEEE International Conference on Consumer Electronics, ICCE 2019, Las Vegas, NV, USA, January 11-13, 2019 1 - 6 2019年 [査読有り]
An FPGA Implementation Method based on Distributed-register Architectures.
Koichi Fujiwara, Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
IPSJ Trans. System LSI Design Methodology 12 38 - 41 2019年 [査読有り]
Iwata, S., Ishikawa, K., Takayama, T., Yanagisawa, M., Togawa, N.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E102A ( 6 ) 860 - 865 2019年 [査読有り]
Nishimura, T., Ishikawa, K., Takayama, T., Yanagisawa, M., Togawa, N.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E102A ( 4 ) 641 - 653 2019年 [査読有り]
Personalized landmark recommendation algorithm based on language-specific satisfaction prediction using heterogeneous open data sources
Siya Bao, Masao Yanagisawa, Nozomu Togawa
Proceedings - 2018 10th International Conference on Computational Intelligence and Communication Networks, CICN 2018 70 - 76 2018年08月
Robust AES circuit design for delay variation using suspicious timing error prediction
Yuki Yahagi, Masao Yanagisawa, Nozomu Togawa
Proceedings - International SoC Design Conference 2017, ISOCC 2017 101 - 102 2018年05月 [査読有り]
A selector-based FFT processor and its FPGA implementation
Yuya Hirai, Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
Proceedings - International SoC Design Conference 2017, ISOCC 2017 88 - 89 2018年05月 [査読有り]
A loop structure optimization targeting high-level synthesis of fast number theoretic transform
Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
Proceedings - International Symposium on Quality Electronic Design, ISQED 2018- 106 - 111 2018年05月 [査読有り]
Sae Iwata, Tomoyuki Nitta, Toshinori Takayama, Masao Yanagisawa, Nozomu Togawa
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E101A ( 5 ) 831 - 843 2018年05月 [査読有り]
A hardware-Trojan classification method utilizing boundary net structures
Kento Hasegawa, Masao Yanagisawa, Nozomu Togawa
2018 IEEE International Conference on Consumer Electronics, ICCE 2018 2018- 1 - 4 2018年03月 [査読有り]
Road-illuminance level inference across road networks based on Bayesian analysis
Siya Bao, Masao Yanagisawa, Nozomu Togawa
2018 IEEE International Conference on Consumer Electronics, ICCE 2018 2018- 1 - 6 2018年03月 [査読有り]
Daisuke Oku, Masao Yanagisawa, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 11 16 - 28 2018年02月 [査読有り]
Designing hardware trojans and their detection based on a SVM-based approach
Tomotaka Inoue, Kento Hasegawa, Masao Yanagisawa, Nozomu Togawa
Proceedings of International Conference on ASIC 2017- 811 - 814 2018年01月 [査読有り]
A low cost and high speed CSD-based symmetric transpose block FIR implementation
Jinghao Ye, Youhua Shi, Nozomu Togawa, Masao Yanagisawa
Proceedings of International Conference on ASIC 2017- 311 - 314 2018年01月 [査読有り]
Daiki Asai, Masao Yanagisawa, Nozomu Togawa
Proceedings of International Conference on ASIC 2017- 64 - 67 2018年01月 [査読有り]
Soft error tolerant latch designs with low power consumption (invited paper)
Saki Tajima, Nozomu Togawa, Masao Yanagisawa, Youhua Shi
Proceedings of International Conference on ASIC 2017- 52 - 55 2018年01月 [査読有り]
Detecting the Existence of Malfunctions in Microcontrollers Utilizing Power Analysis.
Kento Hasegawa, Masao Yanagisawa, Nozomu Togawa
24th IEEE International Symposium on On-Line Testing And Robust System Design, IOLTS 2018, Platja D'Aro, Spain, July 2-4, 2018 97 - 102 2018年 [査読有り]
An Effective Stochastic Number Duplicator and Its Evaluations Using Composite Arithmetic Circuits.
Ryota Ishikawa, Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
24th IEEE International Symposium on On-Line Testing And Robust System Design, IOLTS 2018, Platja D'Aro, Spain, July 2-4, 2018 53 - 56 2018年 [査読有り]
Hardware Trojan Detection Utilizing Machine Learning Approaches.
Kento Hasegawa, Youhua Shi, Nozomu Togawa
17th IEEE International Conference On Trust, Security And Privacy In Computing And Communications / 12th IEEE International Conference On Big Data Science And Engineering, TrustCom/BigDataSE 2018, New York, NY, USA, August 1-3, 2018 1891 - 1896 2018年 [査読有り]
Message from the Editor-in-Chief
Togawa, N.
IPSJ Transactions on System LSI Design Methodology 11 1 - 1 2018年 [査読有り]
An Ising model mapping to solve rectangle packing problem.
Kotaro Terada, Daisuke Oku, Sho Kanamaru, Shu Tanaka, Masato Hayashi, Masanao Yamaoka, Masao Yanagisawa, Nozomu Togawa
2018 International Symposium on VLSI Design, Automation and Test (VLSI-DAT), Hsinchu, Taiwan, April 16-19, 2018 1 - 4 2018年 [査読有り]
A relaxed bit-write-reducing and error-correcting code for non-volatile memories
Kojo, T., Tawada, M., Yanagisawa, M., Togawa, N.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E101A ( 7 ) 1045 - 1052 2018年 [査読有り]
A Low Power Soft Error Hardened Latch with Schmitt-Trigger-Based C-Element.
Saki Tajima, Nozomu Togawa, Masao Yanagisawa, Youhua Shi
IEICE Transactions 101-A ( 7 ) 1025 - 1034 2018年 [査読有り]
Extension and Performance/Accuracy Formulation for Optimal GeAr-Based Approximate Adder Designs.
Ken Hayamizu, Nozomu Togawa, Masao Yanagisawa, Youhua Shi
IEICE Transactions 101-A ( 7 ) 1014 - 1024 2018年 [査読有り]
Stochastic number duplicators based on bit re-arrangement using randomized bit streams
Ishikawa, R., Tawada, M., Yanagisawa, M., Togawa, N.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E101A ( 7 ) 1002 - 1013 2018年 [査読有り]
A Multiple Cyclic-Route Generation Method for Strolling Based on Point-of-Interests.
Tensei Nishimura, Kazuaki Ishikawa, Toshinori Takayama, Masao Yanagisawa, Nozomu Togawa
8th IEEE International Conference on Consumer Electronics - Berlin, ICCE-Berlin 2018, Berlin, Germany, September 2-5, 2018 1 - 2 2018年 [査読有り]
Robust Indoor/Outdoor Detection Method based on Sparse GPS Positioning Information.
Sae Iwata, Kazuaki Ishikawa, Toshinori Takayama, Masao Yanagisawa, Nozomu Togawa
8th IEEE International Conference on Consumer Electronics - Berlin, ICCE-Berlin 2018, Berlin, Germany, September 2-5, 2018 1 - 4 2018年 [査読有り]
Designing Subspecies of Hardware Trojans and Their Detection Using Neural Network Approach.
Tomotaka Inoue, Kento Hasegawa, Yuki Kobayashi, Masao Yanagisawa, Nozomu Togawa
8th IEEE International Conference on Consumer Electronics - Berlin, ICCE-Berlin 2018, Berlin, Germany, September 2-5, 2018 1 - 4 2018年 [査読有り]
Landmark Seasonal Travel Distribution and Activity Prediction Based on Language-specific Analysis.
Siya Bao, Masao Yanagisawa, Nozomu Togawa
IEEE International Conference on Big Data, Big Data 2018, Seattle, WA, USA, December 10-13, 2018 3628 - 3637 2018年 [査読有り]
Makoto Nishizawa, Kento Hasegawa, Nozomu Togawa
2018 IEEE Asia Pacific Conference on Circuits and Systems, APCCAS 2018, Chengdu, China, October 26-30, 2018 362 - 365 2018年 [査読有り]
Hasegawa, K., Yanagisawa, M., Togawa, N.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E101A ( 12 ) 2320 - 2326 2018年 [査読有り]
Ryoya Momose, Tomoyuki Nitta, Masao Yanagisawa, Nozomu Togawa
2017 IEEE 6th Global Conference on Consumer Electronics, GCCE 2017 2017- 1 - 5 2017年12月 [査読有り]
A stayed location estimation method for sparse GPS positioning information
Sae Iwata, Tomoyuki Nitta, Toshinori Takayama, Masao Yanagisawa, Nozomu Togawa
2017 IEEE 6th Global Conference on Consumer Electronics, GCCE 2017 2017- 1 - 5 2017年12月 [査読有り]
Personalized one-day travel with multi-nearby-landmark recommendation
Siya Bao, Masao Yanagisawa, Nozomu Togawa
IEEE International Conference on Consumer Electronics - Berlin, ICCE-Berlin 2017- 239 - 242 2017年12月 [査読有り]
A robust scan-based side-channel attack method against HMAC-SHA-256 circuits
Daisuke Oku, Masao Yanagisawa, Nozomu Togawa
IEEE International Conference on Consumer Electronics - Berlin, ICCE-Berlin 2017- 79 - 84 2017年12月 [査読有り]
A bitwidth-aware high-level synthesis algorithm using operation chainings for tiled-DR architectures
Kotaro Terada, Masao Yanagisawa, Nozomu Togawa
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E100A ( 12 ) 2911 - 2924 2017年12月 [査読有り]
Siya Bao, Tomoyuki Nitta, Masao Yanagisawa, Nozomu Togawa
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E100A ( 11 ) 2439 - 2450 2017年11月 [査読有り]
Effective write-reduction method for MLC non-volatile memory
Masashi Tawada, Shinji Kimura, Masao Yanagisawa, Nozomu Togawa
Proceedings - IEEE International Symposium on Circuits and Systems 1 - 4 2017年09月 [査読有り]
Kento Hasegawa, Masao Yanagisawa, Nozomu Togawa
Proceedings - IEEE International Symposium on Circuits and Systems 1 - 4 2017年09月 [査読有り]
Kento Hasegawa, Masao Yanagisawa, Nozomu Togawa
Proceedings - IEEE International Symposium on Circuits and Systems 100-A ( 12 ) 2857 - 2868 2017年09月 [査読有り]
Hardware Trojans classification for gate-level netlists using multi-layer neural networks
Kento Hasegawa, Masao Yanagisawa, Nozomu Togawa
2017 IEEE 23rd International Symposium on On-Line Testing and Robust System Design, IOLTS 2017 227 - 232 2017年09月 [査読有り]
Hardware Trojan detection and classification based on steady state learning
Masaru Oya, Masao Yanagisawa, Nozomu Togawa
2017 IEEE 23rd International Symposium on On-Line Testing and Robust System Design, IOLTS 2017 215 - 220 2017年09月 [査読有り]
A Floorplan Aware High-Level Synthesis Algorithm with Body Biasing for Delay Variation Compensation
Koki Igawa, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E100A ( 7 ) 1439 - 1451 2017年07月 [査読有り]
Kento Hasegawa, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E100A ( 7 ) 1427 - 1438 2017年07月 [査読有り]
Efficient Multiplexer Networks for Field-Data Extractors and Their Evaluations
Koki Ito, Kazushi Kawamura, Yutaka Tamiya, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E100A ( 4 ) 1015 - 1028 2017年04月 [査読有り]
Hasegawa, K., Yanagisawa, M., Togawa, N.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E100A ( 12 ) 2017年
Tatsuro Kojo, Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E99A ( 12 ) 2398 - 2411 2016年12月 [査読有り]
A Highly-Adaptable and Small-Sized In-Field Power Analyzer for Low-Power IoT Devices
Ryosuke Kitayama, Takashi Takenaka, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E99A ( 12 ) 2348 - 2362 2016年12月 [査読有り]
Masaru Oya, Noritaka Yamashita, Toshihiko Okamura, Yukiyasu Tsunoo, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E99A ( 12 ) 2335 - 2347 2016年12月 [査読有り]
Multi-scenario high-level synthesis for dynamic delay variation and its evaluation on FPGA platforms
Koki Igawa, Masao Yanagisawa, Nozomu Togawa
IEICE ELECTRONICS EXPRESS 13 ( 18 ) 20160641 2016年09月 [査読有り]
Bi-Partitioning Based Multiplexer Network for Field-Data Extractors
Koki Ito, Kazushi Kawamura, Yutaka Tamiya, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E99A ( 7 ) 1410 - 1414 2016年07月 [査読有り]
Koichi Fujiwara, Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E99A ( 7 ) 1294 - 1310 2016年07月 [査読有り]
A Multi-Scenario High-Level Synthesis Algorithm for Variation-Tolerant Floorplan-Driven Design
Koki Igawa, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E99A ( 7 ) 1278 - 1293 2016年07月 [査読有り]
Indoor Navigation Based on Real-time Direction Information Generation Using Wearable Glasses
Ryota Iwanaji, Tomoyuki Nitta, Kazuaki Ishikawa, Masao Yanagisawa, Nozomu Togawa
2016 IEEE INTERNATIONAL CONFERENCE ON CONSUMER ELECTRONICS-ASIA (ICCE-ASIA) 2016年 [査読有り]
A High-level Synthesis Algorithm for FPGA Designs Optimizing Critical Path with Interconnection-delay and Clock-skew Consideration
Koichi Fujiwara, Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
2016 INTERNATIONAL SYMPOSIUM ON VLSI DESIGN, AUTOMATION AND TEST (VLSI-DAT) 2016年 [査読有り]
Rotator-Based Multiplexer Network Synthesis for Field-Data Extractors
Koki Ito, Kazushi Kawamura, Yutaka Tamiya, Masao Yanagisawa, Nozomu Togawa
2016 29TH IEEE INTERNATIONAL SYSTEM-ON-CHIP CONFERENCE (SOCC) 194 - 199 2016年 [査読有り]
In-situ Trojan Authentication for Invalidating Hardware-Trojan Functions
Masaru Oya, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
PROCEEDINGS OF THE SEVENTEENTH INTERNATIONAL SYMPOSIUM ON QUALITY ELECTRONIC DESIGN ISQED 2016 152 - 157 2016年 [査読有り]
A Delay Variation and Floorplan Aware High-level Synthesis Algorithm with Body Biasing
Koki Igawa, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
PROCEEDINGS OF THE SEVENTEENTH INTERNATIONAL SYMPOSIUM ON QUALITY ELECTRONIC DESIGN ISQED 2016 75 - 80 2016年 [査読有り]
A High-performance Circuit Design Algorithm using Data Dependent Approximation
Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
2016 INTERNATIONAL SOC DESIGN CONFERENCE (ISOCC) 95 - 96 2016年 [査読有り]
Hash-Table and Balanced-Tree Based FIB Architecture for CCN Routers
Kenta Shimazaki, Takashi Aoki, Takahiro Hatano, Takuya Otsuka, Akihiko Miyazaki, Toshitaka Tsuda, Nozomu Togawa
2016 INTERNATIONAL SOC DESIGN CONFERENCE (ISOCC) 67 - 68 2016年 [査読有り]
Ryosuke Kitayama, Takashi Takenaka, Masao Yanagisawa, Nozomu Togawa
2016 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS) 978 - 981 2016年 [査読有り]
Redesign for Untrusted Gate-level Netlists
Masaru Oya, Masao Yanagisawa, Nozomu Togawa
2016 IEEE 22ND INTERNATIONAL SYMPOSIUM ON ON-LINE TESTING AND ROBUST SYSTEM DESIGN (IOLTS) 219 - 220 2016年 [査読有り]
Hardware Trojans Classification for Gate-level Netlists based on Machine Learning
Kento Hasegawa, Masaru Oya, Masao Yanagisawa, Nozomu Togawa
2016 IEEE 22ND INTERNATIONAL SYMPOSIUM ON ON-LINE TESTING AND ROBUST SYSTEM DESIGN (IOLTS) 203 - 206 2016年 [査読有り]
Pedestrian Navigation Based on Landmark Recognition Using Glass-type Wearable Devices
Ryoya Yano, Tomoyuki Nitta, Kazuaki Ishikawa, Masao Yanagisawa, Nozomu Togawa
2016 IEEE 5TH GLOBAL CONFERENCE ON CONSUMER ELECTRONICS 1 - 2 2016年 [査読有り]
Keisuke Kono, Tomoyuki Nitta, Kazuaki Ishikawa, Masao Yanagisawa, Nozomu Togawa
2016 IEEE 5TH GLOBAL CONFERENCE ON CONSUMER ELECTRONICS 1 - 2 2016年 [査読有り]
A Safe and Comprehensive Route Finding Method for Pedestrian Based on Lighting and Landmark
Siya Bao, Tomoyuki Nitta, Kazuaki Ishikawa, Masao Yanagisawa, Nozomu Togawa
2016 IEEE 5TH GLOBAL CONFERENCE ON CONSUMER ELECTRONICS 1 - 5 2016年 [査読有り]
Implementation Evaluation of Scan-based Attack against a Trivium Cipher Circuit
Daisuke Oku, Masao Yanagisawa, Nozomu Togawa
2016 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 220 - 223 2016年 [査読有り]
Scan-Based Side-Channel Attack on the Camellia Block Cipher Using Scan Signatures
Huiqian Jiang, Mika Fujishiro, Hirokazu Kodera, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E98A ( 12 ) 2547 - 2555 2015年12月 [査読有り]
A Hardware-Trojans Identifying Method Based on Trojan Net Scoring at Gate-Level Netlists
Masaru Oya, Youhua Shi, Noritaka Yamashita, Toshihiko Okamura, Yukiyasu Tsunoo, Satoshi Goto, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E98A ( 12 ) 2537 - 2546 2015年12月 [査読有り]
ECC-Based Bit-Write Reduction Code Generation for Non-Volatile Memory
Masashi Tawada, Shinji Kimura, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E98A ( 12 ) 2494 - 2504 2015年12月 [査読有り]
Code Generation Limiting Maximum and Minimum Hamming Distances for Non-Volatile Memories
Tatsuro Kojo, Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E98A ( 12 ) 2484 - 2493 2015年12月 [査読有り]
An Effective Suspicious Timing-Error Prediction Circuit Insertion Algorithm Minimizing Area Overhead
Shinnosuke Yoshida, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E98A ( 7 ) 1406 - 1418 2015年07月 [査読有り]
A Floorplan-Driven High-Level Synthesis Algorithm for Multiplexer Reduction Targeting FPGA Designs
Koichi Fujiwara, Kazushi Kawamura, Shin-ya Abe, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E98A ( 7 ) 1392 - 1405 2015年07月 [査読有り]
Shin-ya Abe, Youhua Shi, Kimiyoshi Usami, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E98A ( 7 ) 1376 - 1391 2015年07月 [査読有り]
Kotaro Terada, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E98A ( 7 ) 1366 - 1375 2015年07月 [査読有り]
Energy-efficient High-level Synthesis for HDR Architecture with Multi-stage Clock Gating
Akasaka Hiroyuki, Abe Shin-ya, Yanagisawa Masao, Togawa Nozomu
Information and Media Technologies 10 ( 1 ) 1 - 7 2015年
Fast source optimization by clustering algorithm based on lithography properties
Masashi Tawada, Takaki Hashimoto, Keishi Sakanushi, Shigeki Nojima, Toshiya Kotani, Masao Yanagisawa, Nozomu Togawa
DESIGN-PROCESS-TECHNOLOGY CO-OPTIMIZATION FOR MANUFACTURABILITY IX 9427 2015年 [査読有り]
A Floorplan-Aware High-Level Synthesis Technique with Delay-Variation Tolerance
Kazushi Kawamura, Yuta Hagio, Youhua Shi, Nozomu Togawa
PROCEEDINGS OF THE 2015 IEEE INTERNATIONAL CONFERENCE ON ELECTRON DEVICES AND SOLID-STATE CIRCUITS (EDSSC) 122 - 125 2015年 [査読有り]
Scan-based Side-channel Attack against Symmetric Key Ciphers Using Scan Signatures
Mika Fujishiro, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
PROCEEDINGS OF THE 2015 IEEE INTERNATIONAL CONFERENCE ON ELECTRON DEVICES AND SOLID-STATE CIRCUITS (EDSSC) 309 - 312 2015年 [査読有り]
Partitioning-Based Multiplexer Network Synthesis for Field-Data Extractors
Koki Ito, Yutaka Tamiya, Masao Yanagisawa, Nozomu Togawa
2015 28TH IEEE INTERNATIONAL SYSTEM-ON-CHIP CONFERENCE (SOCC) 263 - 268 2015年 [査読有り]
Koki Igawa, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
2015 28TH IEEE INTERNATIONAL SYSTEM-ON-CHIP CONFERENCE (SOCC) 7 - 12 2015年 [査読有り]
Kotaro Terada, Masao Yanagisawa, Nozomu Togawa
2015 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS) 2129 - 2132 2015年 [査読有り]
Tatsuro Kojo, Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
2015 IEEE/ACM INTERNATIONAL CONFERENCE ON COMPUTER-AIDED DESIGN (ICCAD) 682 - 689 2015年 [査読有り]
Effective Parallel Algorithm for GPGPU-Accelerated Explicit Routing Optimization
Ko Kikuta, Eiji Oki, Naoaki Yamanaka, Nozomu Togawa, Hidenori Nakazato
2015 IEEE GLOBAL COMMUNICATIONS CONFERENCE (GLOBECOM) 1 - 6 2015年 [査読有り]
A Landmark-based Route Recommendation Method for Pedestrian Walking Strategies
Siya Bao, Tomoyuki Nitta, Daisuke Shindou, Masao Yanagisawa, Nozomu Togawa
2015 IEEE 4TH GLOBAL CONFERENCE ON CONSUMER ELECTRONICS (GCCE) 672 - 673 2015年 [査読有り]
A Visible Corner-Landmark Based Route Finding Algorithm for Pedestrian Navigation
Kengo Takeda, Tomoyuki Nitta, Daisuke Shindou, Masao Yanagisawa, Nozomu Togawa
2015 IEEE 4TH GLOBAL CONFERENCE ON CONSUMER ELECTRONICS (GCCE) 601 - 602 2015年 [査読有り]
A Score-Based Classification Method for Identifying Hardware-Trojans at Gate-Level Netlists
Masaru Oya, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
2015 DESIGN, AUTOMATION & TEST IN EUROPE CONFERENCE & EXHIBITION (DATE) 465 - 470 2015年 [査読有り]
A Bit-Write Reduction Method based on Error-Correcting Codes for Non-Volatile Memories
Masashi Tawada, Shinji Kimura, Masao Yanagisawa, Nozomu Togawa
2015 20TH ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE (ASP-DAC) 496 - 501 2015年 [査読有り]
Shinnosuke Yoshida, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
PROCEEDINGS OF 2015 IEEE 11TH INTERNATIONAL CONFERENCE ON ASIC (ASICON) 1 - 4 2015年 [査読有り]
A low-power soft error tolerant latch scheme
Saki Tajima, Youhua Shi, Nozomu Togawa, Masao Yanagisawa
PROCEEDINGS OF 2015 IEEE 11TH INTERNATIONAL CONFERENCE ON ASIC (ASICON) 1 - 4 2015年 [査読有り]
Small-Sized and Noise-Reducing Power Analyzer Design for Low-Power IoT Devices
Ryosuke Kitayama, Takashi Takenaka, Masao Yanagisawa, Nozomu Togawa
PROCEEDINGS OF 2015 IEEE 11TH INTERNATIONAL CONFERENCE ON ASIC (ASICON) 1 - 4 2015年 [査読有り]
Image Synthesis Circuit Design Using Selector-logic-based Alpha Blending and Its FPGA Implementation
Keita Igarashi, Masao Yanagisawa, Nozomu Togawa
PROCEEDINGS OF 2015 IEEE 11TH INTERNATIONAL CONFERENCE ON ASIC (ASICON) 1 - 4 2015年 [査読有り]
Clock Skew Estimate Modeling for FPGA High-level Synthesis and Its Application
Koichi Fujiwara, Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
PROCEEDINGS OF 2015 IEEE 11TH INTERNATIONAL CONFERENCE ON ASIC (ASICON) 1 - 4 2015年 [査読有り]
Scan-Based Side-Channel Attack on the LED Block Cipher Using Scan Signatures
Mika Fujishiro, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E97A ( 12 ) 2434 - 2442 2014年12月 [査読有り]
Scan-Based Attack against Trivium Stream Cipher Using Scan Signatures
Mika Fujishiro, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E97A ( 7 ) 1444 - 1451 2014年07月 [査読有り]
Foreword: Special section on VLSI design and CAD algorithms
Yamada, A., Higami, Y., Takagi, K., Amagasaki, M., Ikeda, M., Ishihara, T., Ito, K., Usami, K., Okada, K., Kajihara, S., Kaneko, M., Kawaguchi, H., Kimura, S., Kurokawa, A., Shibata, Y., Seto, K., Song, T., Takashima, Y., Takahashi, A., Takenaka, T., Togawa, N., Tomiyama, H., Nakatake, S., Nakamura, Y., Hashimoto, M., Hamaguchi, K., Higuchi, H., Hirose, T., Fukuda, D., Matsumoto, T., Miura, Y., Minato, S.-I., Minami, F., Yamashita, S., Yuminaka, Y., Yoshikawa, M., Watanabe, T.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E97A ( 12 ) 2366 - 2366 2014年
A Delay-variation-aware High-level Synthesis Algorithm for RDR Architectures
Hagio Yuta, Yanagisawa Masao, Togawa Nozomu
Information and Media Technologies 9 ( 4 ) 446 - 455 2014年
Throughput Driven Check Point Selection in Suspicious Timing Error Prediction based Designs
Hiroaki Igarashi, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
2014 IEEE 5TH LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS) 1 - 4 2014年 [査読有り]
Scan-based Attack on the LED Block Cipher Using Scan Signatures
Mika Fujishiro, Masao Yanagisawa, Nozomu Togawa
2014 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS) 1460 - 1463 2014年 [査読有り]
Linear and Bi-linear Interpolation Circuits Selector Logics and their Evaluations
Masashi Shio, Masao Yanagisawa, Nozomu Togawa
2014 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS) 1436 - 1439 2014年 [査読有り]
In-situ Timing Monitoring Methods for Variation-Resilient Designs
Youhua Shi, Nozomu Togawa
2014 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 735 - 738 2014年 [査読有り]
Secure scan design using improved random order and its evaluations
Masaru Oya, Yuta Atobe, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
2014 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 555 - 558 2014年 [査読有り]
A Write-Reducing and Error-Correcting Code Generation Method for Non-Volatile Memories
Tatsuro Kojo, Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
2014 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 304 - 307 2014年 [査読有り]
An Area-Overhead-Oriented Monitoring-Path Selection Algorithm for Suspicious Timing Error Prediction
Shinnosuke Yoshida, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
2014 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 300 - 303 2014年 [査読有り]
Scan-based Side-Channel Attack on Camellia Cipher Using Scan Signatures
Huiqian Jiang, Mika Fujishiro, Hirokazu Kodera, Masao Yanagisawa, Nozomu Togawa
2014 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 252 - 255 2014年 [査読有り]
Kotaro Terada, Masao Yanagisawa, Nozomu Togawa
2014 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 248 - 251 2014年 [査読有り]
A Floorplan-Aware High-level Synthesis Algorithm for Multiplexer Reduction Targeting FPGA Designs
Koichi Fujiwara, Shinya Abe, Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
2014 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 244 - 247 2014年 [査読有り]
A delay-variation-aware high-level synthesis algorithm for RDR architectures
Yuta Hagio, Masao Yanagisawa, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 7 81 - 90 2014年 [査読有り]
Energy-efficient high-level synthesis for HDR architecture with multi-stage clock gating
Hiroyuki Akasaka, Shin-Ya Abe, Masao Yanagisawa, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 7 74 - 80 2014年 [査読有り]
Shin-ya Abe, Youhua Shi, Kimiyoshi Usami, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E96A ( 12 ) 2597 - 2611 2013年12月 [査読有り]
A High-Speed Trace-Driven Cache Configuration Simulator for Dual-Core Processor L1 Caches
Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E96A ( 6 ) 1283 - 1292 2013年06月 [査読有り]
Scan-based Attack against DES and Triple DES Cryptosystems Using Scan Signatures
Kodera Hirokazu, Yanagisawa Masao, Togawa Nozomu
Information and Media Technologies 8 ( 3 ) 867 - 874 2013年
Akasaka Hiroyuki, Abe Shin-ya, Yanagisawa Masao, Togawa Nozomu
Information and Media Technologies 8 ( 4 ) 913 - 923 2013年
An Energy-efficient High-level Synthesis Algorithm Incorporating Interconnection Delays and Dynamic Multiple Supply Voltages
Shin-ya Abe, Youhua Shi, Kimiyoshi Usami, Masao Yanagisawa, Nozomu Togawa
2013 INTERNATIONAL SYMPOSIUM ON VLSI DESIGN, AUTOMATION, AND TEST (VLSI-DAT) 2013年 [査読有り]
High-Level Synthesis with Post-Silicon Delay Tuning for RDR Architectures
Yuta Hagio, Masao Yanagisawa, Nozomu Togawa
2013 INTERNATIONAL SOC DESIGN CONFERENCE (ISOCC) 194 - 197 2013年 [査読有り]
Shin-ya Abe, Youhua Shi, Kimiyoshi Usami, Masao Yanagisawa, Nozomu Togawa
2013 INTERNATIONAL SYMPOSIUM ON VLSI DESIGN, AUTOMATION, AND TEST (VLSI-DAT) 1 - 4 2013年 [査読有り]
Secure scan design with dynamically configurable connection
Yuta Atobe, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
Proceedings of IEEE Pacific Rim International Symposium on Dependable Computing, PRDC 256 - 262 2013年 [査読有り]
Suspicious Timing Error Prediction with In-Cycle Clock Gating
Youhua Shi, Hiroaki Igarashi, Nozomu Togawa, Masao Yanagisawa
PROCEEDINGS OF THE FOURTEENTH INTERNATIONAL SYMPOSIUM ON QUALITY ELECTRONIC DESIGN (ISQED 2013) 335 - 340 2013年 [査読有り]
A partial redundant fault-secure high-level synthesis algorithm for RDR architectures
Kazushi Kawamura, Sho Tanaka, Masao Yanagisawa, Nozomu Togawa
Proceedings - IEEE International Symposium on Circuits and Systems 1736 - 1739 2013年 [査読有り]
Concurrent Faulty Clock Detection for Crypto Circuits against Clock Glitch based DFA
Hiroaki Igarashi, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
2013 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS) 1432 - 1435 2013年 [査読有り]
Energy Evaluation for Two-level On-chip Cache with Non-Volatile Memory on Mobile Processors
Shota Matsuno, Masashi Tawada, Masao Yanagisawa, Shinji Kimura, Nozomu Togawa, Tadahiko Sugibayashi
2013 IEEE 10TH INTERNATIONAL CONFERENCE ON ASIC (ASICON) 1 - 4 2013年 [査読有り]
Scan-based Attack against Trivium Stream Cipher Independent of Scan Structure
Mika Fujishiro, Masao Yanagisawa, Nozomu Togawa
2013 IEEE 10TH INTERNATIONAL CONFERENCE ON ASIC (ASICON) 1 - 4 2013年 [査読有り]
Scan-based attack against DES and Triple DES cryptosystems using scan signatures
Hirokazu Kodera, Masao Yanagisawa, Nozomu Togawa
Journal of Information Processing 21 ( 3 ) 572 - 579 2013年 [査読有り]
Hiroyuki Akasaka, Shin-ya Abe, Masao Yanagisawa, Nozomu Togawa
IPSJ Trans. System LSI Design Methodology 6 101 - 111 2013年 [査読有り]
A thermal-aware high-level synthesis algorithm for RDR architectures through binding and allocation
Kazushi Kawamura, Masao Yanagisawa, Nozomu Togawa
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E96-A ( 1 ) 312 - 321 2013年 [査読有り]
Scan-Based Attack on AES through Round Registers and Its Countermeasure
Youhua Shi, Nozomu Togawa, Masao Yanagisawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E95A ( 12 ) 2338 - 2346 2012年12月 [査読有り]
Seungju Lee, Masao Yanagisawa, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E95A ( 9 ) 1538 - 1549 2012年09月 [査読有り]
Energy-efficient High-level Synthesis for HDR Architectures
Abe Shin-ya, Yanagisawa Masao, Togawa Nozomu
Information and Media Technologies 7 ( 4 ) 1319 - 1330 2012年
Dynamically Changeable Secure Scan Architecture against Scan-Based Side Channel Attack
Yuta Atobe, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
2012 INTERNATIONAL SOC DESIGN CONFERENCE (ISOCC) 155 - 158 2012年 [査読有り]
Energy-efficient High-level Synthesis for HDR Architectures with Clock Gating
Hiroyuki Akasaka, Masao Yanagisawa, Nozomu Togawa
2012 INTERNATIONAL SOC DESIGN CONFERENCE (ISOCC) 135 - 138 2012年 [査読有り]
A Novel BMNoC Configuration Algorithm Utilizing Communication Volume and Locality among Cores
Seungju Lee, Nozomu Togawa, Takashi Aoki, Akira Onozawa
2012 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS 2012) 1668 - 1671 2012年 [査読有り]
Shin-ya Abet, Masao Yanagisawa, Nozomu Togawat
2012 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS 2012) 576 - 579 2012年 [査読有り]
Yuta Atobe, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
2012 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 607 - 610 2012年 [査読有り]
Weighted Adders with Selector Logics for Super-resolution and Its FPGA-based Evaluation
Hiromine Yoshihara, Masao Yanagisawa, Nozomu Togawa
2012 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 603 - 606 2012年 [査読有り]
Scan-based Attack against DES Cryptosystems Using Scan Signatures
Hirokazu Kodera, Masao Yanagisawa, Nozomu Togawa
2012 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 599 - 602 2012年 [査読有り]
A Hybrid NoC Architecture Utilizing Packet Transmission Priority Control Method
Seungju Lee, Nozomu Togawa, Yusuke Sekihara, Takashi Aoki, Akira Onozawa
2012 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS) 404 - 407 2012年 [査読有り]
Robust Secure Scan Design Against Scan-Based Differential Cryptanalysis
Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEEE TRANSACTIONS ON VERY LARGE SCALE INTEGRATION (VLSI) SYSTEMS 20 ( 1 ) 176 - 181 2012年01月 [査読有り]
Energy-efficient high-level synthesis for HDR architectures
Shin-Ya Abe, Masao Yanagisawa, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 5 106 - 117 2012年 [査読有り]
A fastweighted adder by reducing partial product for reconstruction in super-resolution
Hiromine Yoshihara, Masao Yanagisawa, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 5 96 - 105 2012年 [査読有り]
Shin-ya Abe, Youhua Shi, Masao Yanagisawa, Nozomu Togawa
IEICE ELECTRONICS EXPRESS 9 ( 17 ) 1414 - 1422 2012年 [査読有り]
Mikiko Sode Tanaka, Nozomu Togawa, Masao Yanagisawa, Satoshi Goto
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E94A ( 12 ) 2482 - 2489 2011年12月 [査読有り]
Speeding-up exact and fast FIFO-based cache configuration simulation
Masashi Tawada, Masao Yanagisawa, Nozomu Togawa
IEICE ELECTRONICS EXPRESS 8 ( 14 ) 1161 - 1167 2011年07月 [査読有り]
Mikiko Sode Tanaka, Nozomu Togawa, Masao Yanagisawa, Satoshi Goto
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E94A ( 4 ) 1082 - 1090 2011年04月 [査読有り]
Exact and Fast L1 Cache Configuration Simulation for Embedded Systems with FIFO/PLRU Cache Replacement Policies
Masashi Tawada, Masao Yanagisawa, Tatsuo Ohtsuki, Nozomu Togawa
2011 INTERNATIONAL SYMPOSIUM ON VLSI DESIGN, AUTOMATION AND TEST (VLSI-DAT) 247 - 250 2011年 [査読有り]
Exact, fast and flexible L1 cache configuration simulation for embedded systems
Masashi Tawada, Masao Yanagisawa, Tatsuo Ohtsuki, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 4 166 - 181 2011年 [査読有り]
A fault-secure high-level synthesis algorithm for RDR architectures
Sho Tanaka, Masao Yanagisawa, Tatsuo Ohtsuki, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 4 150 - 165 2011年 [査読有り]
A fast selector-based subtract-multiplication unit and its application to butterfly unit
Youhei Tsukamoto, Masao Yanagisawa, Tatsuo Ohtsuki, Nozomu Togawa
IPSJ Transactions on System LSI Design Methodology 4 60 - 69 2011年 [査読有り]
Scan vulnerability in elliptic curve cryptosystems
Ryuta Nara, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IPSJ Transactions on System LSI Design Methodology 4 47 - 59 2011年 [査読有り]
Scan-Based Side-Channel Attack against RSA Cryptosystems Using Scan Signatures
Ryuta Nara, Kei Satoh, Masao Yanagisawa, Tatsuo Ohtsuki, Nozomu Togawa
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E93A ( 12 ) 2481 - 2489 2010年12月 [査読有り]
Improved Launch for Higher TDF Coverage With Fewer Test Patterns
Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEEE TRANSACTIONS ON COMPUTER-AIDED DESIGN OF INTEGRATED CIRCUITS AND SYSTEMS 29 ( 8 ) 1294 - 1299 2010年08月 [査読有り]
State-dependent Changeable Scan Architecture against Scan-based Side Channel Attacks
Ryuta Nara, Hiroshi Atobe, Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2010 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS 1867 - 1870 2010年 [査読有り]
Performance-driven High-level Synthesis with floorplan for GDR Architectures and its Evaluation
Akira Ohchi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2010 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS 921 - 924 2010年 [査読有り]
Scan-Based Attack against Elliptic Curve Cryptosystems
Ryuta Nara, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2010 15TH ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE (ASP-DAC 2010) 402 - 407 2010年 [査読有り]
VLSI Implementation of a Fast Intra Prediction Algorithm for H.264/AVC Encoding
Youhua Shi, Kenta Tokumitsu, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
PROCEEDINGS OF THE 2010 IEEE ASIA PACIFIC CONFERENCE ON CIRCUIT AND SYSTEM (APCCAS) 1139 - 1142 2010年 [査読有り]
A Fast Selector-Based Subtract-Multiplication Unit and Its Application to Radix-2 Butterfly Unit
Youhei Tsukamoto, Masao Yanagisawa, Tatsuo Ohtsuki, Nozomu Togawa
PROCEEDINGS OF THE 2010 IEEE ASIA PACIFIC CONFERENCE ON CIRCUIT AND SYSTEM (APCCAS) 1083 - 1086 2010年 [査読有り]
BusMesh NoC: A Novel NoC Architecture Comprised of Bus-based Connection and Global Mesh Routers
SeungJu Lee, Masao Yanagisawa, Tatsuo Ohtsuki, Nozomu Togawa
PROCEEDINGS OF THE 2010 IEEE ASIA PACIFIC CONFERENCE ON CIRCUIT AND SYSTEM (APCCAS) 712 - 715 2010年 [査読有り]
A Two-Level Cache Design Space Exploration System for Embedded Applications
Nobuaki Tojo, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E92A ( 12 ) 3238 - 3247 2009年12月 [査読有り]
A Scan-Based Attack Based on Discriminators for AES Cryptosystems
Ryuta Nara, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E92A ( 12 ) 3229 - 3237 2009年12月 [査読有り]
Floorplan-Aware High-Level Synthesis for Generalized Distributed-Register Architectures
Akira Ohchi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E92A ( 12 ) 3169 - 3179 2009年12月 [査読有り]
X-Handling for Current X-Tolerant Compactors with More Unknowns and Maximal Compaction
Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E92A ( 12 ) 3119 - 3127 2009年12月 [査読有り]
Unified Dual-Radix Architecture for Scalable Montgomery Multiplications in GF(P) and GF(2(n))
Kazuyuki Tanimura, Ryuta Nara, Shunitsu Kohara, Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E92A ( 9 ) 2304 - 2317 2009年09月 [査読有り]
An L1 Cache Design Space Exploration System for Embedded Applications
Nobuaki Tojo, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E92A ( 6 ) 1442 - 1453 2009年06月 [査読有り]
Design-for-Secure-Test for Crypto Cores
Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
ITC: 2009 INTERNATIONAL TEST CONFERENCE 618 - 618 2009年 [査読有り]
Exact and Fast L1 Cache Simulation for Embedded Systems
Nobuaki Tojo, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
PROCEEDINGS OF THE ASP-DAC 2009: ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 2009 817 - 822 2009年 [査読有り]
A Unified Test Compression Technique for Scan Stimulus and Unknown Masking Data with No Test Loss
Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E91A ( 12 ) 3514 - 3523 2008年12月 [査読有り]
Floorplan-driven high-level synthesis for distributed/shared-register architectures
Akira Ohchi, Shunitsu Kohara, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IPSJ Transactions on System LSI Design Methodology 1 78 - 90 2008年08月 [査読有り]
Low power LDPC code decoder architecture based on intermediate message compression technique
Kazunori Shimizu, Nozomu Togawa, Takeshi Ikenaga, Satoshi Goto
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E91A ( 4 ) 1054 - 1061 2008年04月 [査読有り]
A secure test technique for pipelined advanced encryption standard
Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE TRANSACTIONS ON INFORMATION AND SYSTEMS E91D ( 3 ) 776 - 780 2008年03月 [査読有り]
High-level synthesis algorithms with floorplaning for distributed/shared-register architectures
Akira Ohchi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2008 INTERNATIONAL SYMPOSIUM ON VLSI DESIGN, AUTOMATION AND TEST (VLSI-DAT), PROCEEDINGS OF TECHNICAL PROGRAM 164 - 167 2008年 [査読有り]
Scalable unified dual-radix architecture for Montgomery multiplication in GF(P) and GF(2(n))
Kazuyuki Tanimura, Ryuta Nara, Shunitsu Kohara, Kazunori Shimizu, Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2008 ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, VOLS 1 AND 2 667 - 672 2008年 [査読有り]
GECOM: Test data compression combined with all unknown response masking
Youhua Shi, Nozontu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2008 ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, VOLS 1 AND 2 537 - 542 2008年 [査読有り]
Unknown Response Masking with Minimized Observable Response Loss and Mask Data
Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2008 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS 2008), VOLS 1-4 1779 - + 2008年 [査読有り]
Dynamically Reconfigurable Architecture for Multi-Rate Compatible Regular LDPC Decoding
Akiyuki Nagashima, Yuta Imai, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2008 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS 2008), VOLS 1-4 705 - 708 2008年 [査読有り]
FIR Filter Design on Flexible Engine/Generic ALU Array and Its Dedicated Synthesis Algorithm
Ryo Tamura, Masayuki Honma, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki, Makoto Satoh
2008 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS 2008), VOLS 1-4 701 - + 2008年 [査読有り]
携帯機器向けMPEG-A Photo Playerのメタデータ生成システムのハードウェア化に関する一考察
元橋雅人, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2006 ( 552 ) 31 - 36 2007年03月
アプリケーションプロセッサ向けデータキャッシュ構成最適化システムとその評価
堀内一央, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2006 2007年03月
SIMD型プロセッサコア最適化設計のための多重ループに対応したSIMD命令合成手法
中島裕貴, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2006 ( 551 ) 13 - 18 2007年03月
SIMD型プロセッサコアを対象としたハードウェア/ソフトウェア分割フレームワーク
大東真崇, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2006 ( 551 ) 7 - 12 2007年03月
SIMD型プロセッサコア設計におけるプロセッシングユニット最適化手法
繁田裕之, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2006 ( 551 ) 1 - 6 2007年03月
Power-Efficient LDPC Code Decoder Architecture
Kazunori Shimizu, Nozomu Togawa, Takeshi Ikenaga, Satoshi Goto
ISLPED'07: PROCEEDINGS OF THE 2007 INTERNATIONAL SYMPOSIUM ON LOW POWER ELECTRONICS AND DESIGN 359 - 362 2007年 [査読有り]
Design for secure test - A case study on pipelined Advanced Encryption Standard
Youhua Shi, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
2007 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOLS 1-11 149 - 152 2007年 [査読有り]
XMLをベースとしたCDFGマニピュレーションフレームワーク: CoDaMa
小原俊逸, 史又華, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2006-97 19 - 24 2007年01月
楕円曲線暗号向けGF(2m)上のDigit-Serial乗算器の設計
奈良竜太, 小原俊逸, 清水一範, 戸川望, 池永剛, 柳澤政生, 後藤敏, 大附辰夫
電子情報通信学会技術研究報告 VLD2006-89 ( 455 ) 25 - 30 2007年01月
Power-efficient LDPC decoder architecture based on accelerated message-passing schedule
Kazunori Shimizu, Tatsuyuki Ishikawa, Nozomu Togawa, Takeshi Ikenaga, Satoshi Goto
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E89A ( 12 ) 3602 - 3612 2006年12月 [査読有り]
アプリケーションプロセッサのフォワーディングユニット最適化手法
日浦敏俊, 小原俊逸, 史又華, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ( VLD2006-80 ) 2006年11月
今井優太, 清水一範, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 RECONF2006-43 ( 393 ) 35 - 40 2006年11月
歩行者ナビゲーションにおける微小画面での視認性とユーザの迷いにくさを考慮した略地図生成手法
二宮直也, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ITS2006-34 ( 266 ) 53 - 58 2006年09月
屋内用歩行者ナビゲーションにおける歩行者の嗜好を反映させる経路探索手法
荒井亨, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ITS2006-33 ( 266 ) 47 - 52 2006年09月
屋内向け歩行者ナビゲーションにおけるユーザの嗜好性と混雑状況を考慮した目的地決定手法
小林和馬, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ITS2006-32 ( 266 ) 41 - 45 2006年09月
大高宏介, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ITS2006-18 ( 265 ) 19 - 24 2006年09月
H.264符号化向けDSPにおける動き予測演算器の設計
高橋豊和, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ( VLD2006 ) 2006年06月
アプリケーションプロセッサの面積/遅延見積もり手法
山崎大輔, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 CAS2006-1 ( VLD2006-14, SIP2006-24 ) 2006年06月
Selective low-care coding: A means for test data compression in circuits with multiple scan chains
YH Shi, N Togawa, S Kimura, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E89A ( 4 ) 996 - 1004 2006年04月 [査読有り]
Partially-parallel LDPC decoder achieving high-efficiency message-passing schedule
K Shimizu, T Ishikawa, N Togawa, T Ikenaga, S Goto
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E89A ( 4 ) 969 - 978 2006年04月 [査読有り]
Hardware architecture of efficient message-passing schedule based on modified min-sum algorithm for decoding LDPC codes
Proc. Synthesis and System Integration of Mixed Technologies (SASIMI 2006) 2006年04月
A pipelined functional unit generation method in HW/SW cosynthesis for SIMD processor cores
Proc. Synthesis and System Integration of Mixed Technologies (SASIMI 2006) 2006年04月
Hardware architecture of efficient message-passing schedule based on modified min-sum algorithm for decoding LDPC codes
清水一範, 石川達之, 戸川望, 池永剛, 後藤敏
Proc. Synthesis and System Integration of Mixed Technologies (SASIMI 2006) 2006年04月
A pipelined functional unit generation method in HW/SW cosynthesis for SIMD processor cores
小原俊逸, 栗原輝, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
Proc. Synthesis and System Integration of Mixed Technologies (SASIMI 2006) 2006年04月
堀内一央, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会第19回回路とシステム軽井沢ワークショップ論文集 19 583 - 588 2006年04月
FIFOバッファによる高効率Message-Passingスケジュールを用いたLDPC復号器
清水一範, 石川達之, 戸川望, 池永剛, 後藤敏
電子情報通信学会第19回回路とシステム軽井沢ワークショップ論文集 19 211 - 216 2006年04月
A fast elliptic curve cryptosystem LSI embedding word-based Montgomery multiplier
J Uchida, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON ELECTRONICS E89C ( 3 ) 243 - 249 2006年03月 [査読有り]
歩行者向け地図情報配信システムにおける道路交通標識を用いた位置特定手法
中口智史, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ( ITS2005-114 ) 2006年03月
SIMD型プロセッサコアの自動合成におけるパイプライン構成最適化手法
栗原輝, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 105 ( VLD2005-115, ICD2005-232 ) 43 - 48 2006年03月
動的フローに対応したネットワークプロセッサの改良とその評価
田淵英孝, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ( VLD2005-112, ICD2005-229 ) 2006年03月
設計ナビゲーション機構を有するシステムLSI設計のためのHW/SW分割システム
小島洋平, 戸川望, 橘昌良, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 105 ( VLD2005-111, ICD2005-228 ) 19 - 24 2006年03月
高速移動体のためのハンドオフメッセージ数を最小化した高速ハンドオフ手法
伊藤光司, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 ( IN2005-222 ) 2006年03月
ASIC implementation of LDPC decoder accelerating message-passing schedule
SHIMIZU Kazunori
IEEE International Solid State Circuits Confeference (ISSCC), DAC/ISSCC2006 Student Design Contest (Conceptual Category: 1st Place Winner), San Franscisco 2006年02月
ASIC implementation of LDPC decoder accelerating message-passing schedule
清水一範, 石川達之, 戸川望, 池永剛, 後藤敏
IEEE International Solid State Circuits Confeference (ISSCC), DAC/ISSCC2006 Student Design Contest (Conceptual Category: 1st Place Winner), San Franscisco 2006年02月
Special section on VLSI Design and CAD Algorithms
Onodera, H., Ikeda, M., Ishihara, T., Isshiki, T., Inoue, K., Okada, K., Kajihara, S., Kaneko, M., Kawaguchi, H., Kimura, S., Kuga, M., Kurokawa, A., Sato, T., Shibuya, T., Shiraishi, Y., Takagi, K., Takahashi, A., Takeuchi, Y., Togawa, N., Tomiyama, H., Nakamura, Y., Hamaguchi, K., Miura, Y., Minato, S.-I., Yamaguchi, R., Yamada, M., Yuminaka, Y., Watanabe, T., Hashimoto, M., Miyazaki, M.
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E89-A ( 12 ) 3377 - 3377 2006年
A parallel LSI architecture for LDPC decoder improving message-passing schedule
Kazunori Shimizu, Tatsuyuki Ishikawa, Nozomu Togawa, Takeshi Ikenaga, Satoshi Gotot
2006 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOLS 1-11, PROCEEDINGS 5099 - + 2006年 [査読有り]
FCSCAN: An efficient multiscan-based test compression technique for test cost reduction
Youhua Shi, Nozomu Togawa, Shinji Kimura, Masao Yanagisawa, Tatsuo Ohtsuki
ASP-DAC 2006: 11TH ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, PROCEEDINGS 653 - 658 2006年 [査読有り]
An interface-circuit synthesis method with configurable processor core in IP-based SoC designs
Shunitsu Kohara, Naoki Tomono, Jumpei Uchida, Yuichiro Miyaoka, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
ASP-DAC 2006: 11TH ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, PROCEEDINGS 594 - 599 2006年 [査読有り]
Memory-efficient accelerating schedule for LDPC decoder
Kazunori Shimizu, Nozonm Togawa, Takeshi Ikenaga, Satoshi Goto
2006 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS 1317 - + 2006年 [査読有り]
A parallel LSI architecture for LDPC decoder improving message-passing schedule
Kazunori Shimizu, Tatsuyuki Ishikawa, Nozomu Togawa, Takeshi Ikenaga, Satoshi Gotot
2006 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOLS 1-11, PROCEEDINGS 5099 - + 2006年
Selective low-care coding: A means for test data compression in circuits with multiple scan chains
Youhua Shi, Nozomu Togawa, Shinji Kimura, Masao Yanagisawa, Tatsuo Ohtsuki
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E89-A ( 4 ) 996 - 1003 2006年
FCSCAN: An efficient multiscan-based test compression technique for test cost reduction
Youhua Shi, Nozomu Togawa, Shinji Kimura, Masao Yanagisawa, Tatsuo Ohtsuki
ASP-DAC 2006: 11TH ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, PROCEEDINGS 653 - 658 2006年
An interface-circuit synthesis method with configurable processor core in IP-based SoC designs
Shunitsu Kohara, Naoki Tomono, Jumpei Uchida, Yuichiro Miyaoka, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
ASP-DAC 2006: 11TH ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, PROCEEDINGS 594 - 599 2006年
MPEG-4形状符号化/復号化に対応したDSP組み込み向け専用演算器の設計
古宇多朋史, 小原俊逸, 史又華, 戸川望, 柳澤政生, 大附辰夫
情報処理学会組込みシステムシンポジウム2006論文集(ESS2006) 2006年
連携処理を考慮したネットワークプロセッサ合成システム
中山敬史, 戸川望, 柳澤政生, 大附辰夫
情報処理学会DAシンポジウム2006論文集 2006年
レジスタ分散・共有併用型アーキテクチャを対象としたフロアプランを考慮した高位合成手法
大智輝, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
情報処理学会DAシンポジウム2006論文集 2006年
SIMD型プロセッサコアの自動合成のためのパイプライン演算ユニット生成手法
栗原輝, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
情報処理学会論文誌 vol. 47 ( no. 6 ) 2006年
高橋豊和, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 CAS2006-10 ( VLD2006-23, SIP2006-33 ) 13 - 18 2006年
A parallel LSI architecture for LDPC decoder improving message-passing schedule
Kazunori Shimizu, Tatsuyuki Ishikawa, Nozomu Togawa, Takeshi Ikenaga, Satoshi Gotot
2006 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOLS 1-11, PROCEEDINGS 5099 - + 2006年
FCSCAN: An efficient multiscan-based data compression technique for test cost reduction
史又華, 戸川望, 木村晋二, 柳澤政生, 大附辰夫
Proc. IEEE Asia and South Pacific Design Automation Conference 2006 (ASP-DAC 2006) 653 - 658 2006年01月
An interface-circuit synthesizer with configurable processor core in IP-based SOC design
小原俊逸, 友野直紀, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
Proc. IEEE Asia and South Pacific Design Automation Conference 2006 (ASP-DAC 2006) 594 - 599 2006年01月
重回帰分析により得られた1次式によるインダクタンスを考慮した配線遅延の見積り
鈴木康成, マルタディナタ アンワル, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 105 ( VLD2005-72 ) 67 - 72 2005年12月
レジスタ分散・共有アーキテクチャを対象としたフロアプラン指向高位合成手法
大智輝, 戸川望, 柳澤雅夫, 大附辰夫
電子情報通信学会技術研究報告 105 ( VLD2005-66 ) 31 - 36 2005年12月
SIMD型プロセッサの自動合成におけるパイプライン演算ユニット生成手法
栗原輝, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
情報処理学会DAシンポジウム2005論文集 25 - 30 2005年08月
画像処理向けシステムLSI設計における設計ナビゲーションを考慮したHW/SW分割システム
小島洋平, 戸川望, 橘昌良, 柳澤政生, 大附辰夫
情報処理学会DAシンポジウム2005論文集 19 - 24 2005年08月
Reconfigurable adaptive FEC system based on Reed-Solomon code with interleaving
K Shimizu, N Togawa, T Ikenaga, S Goto
IEICE TRANSACTIONS ON INFORMATION AND SYSTEMS E88D ( 7 ) 1526 - 1537 2005年07月 [査読有り]
A SIMD instruction set and functional unit synthesis algorithm with SIMD operation decomposition
N Togawa, K Tachikake, Y Miyaoka, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON INFORMATION AND SYSTEMS E88D ( 7 ) 1340 - 1349 2005年07月 [査読有り]
Reconfigurable adaptive FEC system based on Reed-Solomon code with interleaving
IEICE Trans. on Information and Systems E88-D ( 7 ) 1538 - 1545 2005年07月
レジスタ分散型アーキテクチャを対象とするフロアプランとタイミング制約を考慮した高位合成手法
田中真, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
情報処理学会論文誌 46 ( 6 ) 1383 - 1394 2005年05月
Sub-operation parallelism optimization in SIMD processor core synthesis
H Kawazu, J Uchida, Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E88A ( 4 ) 876 - 884 2005年04月 [査読有り]
IP再利用を考慮したシステムLSI設計におけるインタフェース回路生成システム
小原俊逸, 友野直紀, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会第18回回路とシステム軽井沢ワークショップ論文集 581 - 586 2005年04月
SIMD型プロセッサコア向けHW/SW協調合成システムにおけるパイプライン演算ユニット生成手法
栗原輝, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会第18回回路とシステム軽井沢ワークショップ論文集 575 - 580 2005年04月
A selective care bits coding method for test data compression
史又華, 戸川望, 木村晋二, 柳澤政生, 大附辰夫
電子情報通信学会第18回回路とシステム軽井沢ワークショップ論文集 241 - 246 2005年04月
信頼度の伝播効率を改善する部分並列LDPC復号器の実装と評価
清水一範, 石川達之, 戸川望, 池永剛, 後藤敏
電子情報通信学会第18回回路とシステム軽井沢ワークショップ論文集 181 - 186 2005年04月
インダクタンスを考慮した配線遅延の近似式による見積もり
鈴木康成, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会第18回回路とシステム軽井沢ワークショップ論文集 1 - 6 2005年04月
ネットワークプロセッサ合成システムの改良とその評価
升本英行, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2004 2005年03月
細田宗一郎, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2004 ( 709 ) 79 - 84 2005年03月
ワードベースモンゴメリ乗算器を搭載した高速楕円曲線暗号LSI
内田純平, 奈良竜太, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2004 ( 708 ) 5 - 10 2005年03月
面積制約を考慮したマルチスレッドプロセッサの合成手法
麻生雄一, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 2005年03月
Sub-operation parallelism optimization in SIMD processor synthesis and its experimental evaluations
N Togawa, Y Miyaoka, H Kawazu, M Yanagisawa, J Uchida, T Ohtsuki
2005 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS), VOLS 1-6, CONFERENCE PROCEEDINGS 3499 - 3502 2005年 [査読有り]
Partially-parallel LDPC decoder based on high-efficiency message-passing algorithm
K Shimizu, T Ishikawa, N Togawa, T Ikenaga, S Goto
2005 IEEE International Conference on Computer Design: VLSI in Computers & Processors, Proceedings 503 - 510 2005年 [査読有り]
Low power test compression technique for designs with multiple scan chains
YH Shi, N Togawa, S Kimura, M Yanagisawa, T Ohtsuki
14TH ASIAN TEST SYMPOSIUM, PROCEEDINGS 386 - 389 2005年 [査読有り]
Reconfigurable adaptive FEC system with interleaving
Kazunori Shimizu, Nozomu Togawa, Takeshi Ikenaga, Satoshi Goto
ASP-DAC 2005: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, VOLS 1 AND 2 1252 - 1255 2005年 [査読有り]
A processor core synthesis system in IP-based SoC design
Naoki Tomono, Shunitsu Kohara, Jumpei Uchida, Yuichiro Miyaoka, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
ASP-DAC 2005: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, VOLS 1 AND 2 286 - 291 2005年 [査読有り]
A processor core synthesis system in IP-based SoC design
Naoki Tomono, Shunitsu Kohara, Jumpei Uchida, Yuichiro Miyaoka, Nozomu Togawa, Masao Yanagisawa, Tatsuo Ohtsuki
ASP-DAC 2005: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE, VOLS 1 AND 2 286 - 291 2005年
A Processor Core Synthesis System in IP-based SoC Design
友野直紀, 小原俊逸, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
Proceedings of the ASP-DAC 2005 2005年01月
FPGA-based reconfigurable adaptive FEC
K Shimizu, J Uchida, Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E87A ( 12 ) 3036 - 3046 2004年12月
High-level power optimization based on thread partitioning
J Uchida, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E87A ( 12 ) 3075 - 3082 2004年12月
レジスタ分散型アーキテクチャを対象とするフロアプランを考慮した高位合成手法
田中真, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2004 2004年12月
FPGA-based reconfigurable adaptive FEC
K Shimizu, J Uchida, Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E87A ( 12 ) 3036 - 3046 2004年12月
High-level power optimization based on thread partitioning
J Uchida, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E87A ( 12 ) 3075 - 3082 2004年12月
A sub-operation parallelism optimization algorithmin HW/SW partitioning for SIMD processor cores
SASIMI2004 483 - 490 2004年10月
A sub-operation parallelism optimization algorithmin HW/SW partitioning for SIMD processor cores
川津秀樹, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
SASIMI2004 483 - 490 2004年10月
IP再利用を考慮したシステムLSIにおけるプロセッサコア合成システム
友野直紀, 小原俊逸, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
情報処理学会 DAシンポジウム 2004 19 - 24 2004年07月
フロアプランとタイミング制約に基づくレジスタ間データ転送を考慮した高位合成手法
田中真, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
情報処理学会 DAシンポジウム 2004 283 - 288 2004年07月
A hardware/software cosynthesis algorithm for processors with heterogeneous datapaths
Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E87A ( 4 ) 830 - 836 2004年04月
SIMD型プロセッサコア向けHW/SW分割におけるSIMD型演算最適化手法
川津秀樹, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会第17回 回路とシステム(軽井沢)ワークショップ 579 - 584 2004年04月
A hardware/software cosynthesis algorithm for processors with heterogeneous datapaths
Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E87A ( 4 ) 830 - 836 2004年04月
ネットワークプロセッサ合成システム
松浦努, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2003-145 55 - 60 2004年03月
小田雄一, 内田純平, 宮岡祐一郎, 戸川望, 橘昌良, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2003-158 ( 703 ) 47 - 52 2004年03月
Packed SIMD型命令を持つプロセッサ合成システムのためのリターゲッタブルコンパイラ
加藤久晴, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2003-157 41 - 46 2004年03月
面積制約を考慮したCAMプロセッサ最適化手法
石川裕一朗, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2003-152 13 - 18 2004年03月
インターリーブを考慮したReconfigurable Adaptive FEC
清水一範, 内田純平, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2003-151 ( 703 ) 7 - 12 2004年03月
携帯機器を対象としたJava動的コンパイラにおけるプロファイリングシステム
船田雅史, 内田純平, 戸川望, 柳澤政生, 大附辰夫
情報処理学会研究報告,2004-MBL-28 2004 ( 21 ) 55 - 62 2004年03月
YH Shi, S Kimura, N Togawa, M Yanagisawa, T Ohtsuki
13TH ASIAN TEST SYMPOSIUM, PROCEEDINGS 432 - 437 2004年 [査読有り]
Instruction set and functional unit synthesis for SIMD processor cores
N Togawa, K Tachikake, Y Miyaoka, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 743 - 750 2004年 [査読有り]
A cosynthesis algorithm for application specific processors with heterogeneous datapaths
Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 250 - 255 2004年 [査読有り]
A thread partitioning algorithm in low power high-level synthesis
J Uchida, N Togawa, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 74 - 79 2004年 [査読有り]
A reconfigurable adaptive FEC system for reliable wireless communications
K Shimizu, N Togawa, T Ikenaga, M Yanagisawa, S Goto, T Ohtsuki
PROCEEDINGS OF THE 2004 IEEE ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS, VOL 1 AND 2 13 - 16 2004年
Experimental evaluation of high-level energy optimization based on thread partitioning
J Uchida, Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF THE 2004 IEEE ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS, VOL 1 AND 2 161 - 164 2004年
An efficient algorithm/architecture codesign for image encoders
J Choi, N Togawa, T Ikenaga, S Goto, M Yanagisawa, T Ohtsuki
2004 47TH MIDWEST SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOL II, CONFERENCE PROCEEDINGS 469 - 472 2004年
Reducing test data volume for multiscan-based designs through single/sequence mixed encoding
Y Shi, S Kimura, N Togawa, M Yanagisawa, T Ohtsuki
2004 47TH MIDWEST SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOL II, CONFERENCE PROCEEDINGS 445 - 448 2004年
Instruction set and functional unit synthesis for SIMD processor cores
N Togawa, K Tachikake, Y Miyaoka, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 743 - 750 2004年
A cosynthesis algorithm for application specific processors with heterogeneous datapaths
Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 250 - 255 2004年
A thread partitioning algorithm in low power high-level synthesis
J Uchida, N Togawa, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 74 - 79 2004年
A reconfigurable adaptive FEC system for reliable wireless communications
K Shimizu, N Togawa, T Ikenaga, M Yanagisawa, S Goto, T Ohtsuki
PROCEEDINGS OF THE 2004 IEEE ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS, VOL 1 AND 2 13 - 16 2004年
Experimental evaluation of high-level energy optimization based on thread partitioning
J Uchida, Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF THE 2004 IEEE ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS, VOL 1 AND 2 161 - 164 2004年
An efficient algorithm/architecture codesign for image encoders
J Choi, N Togawa, T Ikenaga, S Goto, M Yanagisawa, T Ohtsuki
2004 47TH MIDWEST SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOL II, CONFERENCE PROCEEDINGS 469 - 472 2004年
Reducing test data volume for multiscan-based designs through single/sequence mixed encoding
Y Shi, S Kimura, N Togawa, M Yanagisawa, T Ohtsuki
2004 47TH MIDWEST SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOL II, CONFERENCE PROCEEDINGS 445 - 448 2004年
Instruction set and functional unit synthesis for SIMD processor cores
N Togawa, K Tachikake, Y Miyaoka, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 743 - 750 2004年
A cosynthesis algorithm for application specific processors with heterogeneous datapaths
Y Miyaoka, N Togawa, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 250 - 255 2004年
A thread partitioning algorithm in low power high-level synthesis
J Uchida, N Togawa, M Yanagisawa, T Ohtsuki
ASP-DAC 2004: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 74 - 79 2004年
A hardware/software partitioning algorithm for processor cores with packed SIMD-type instructions
N Togawa, K Tachikake, Y Miyaoka, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E86A ( 12 ) 3218 - 3224 2003年12月
A retargetable simulator generator for DSP processor cores with packed SIMD-type instructions
N Togawa, K Kasahara, Y Miyaoka, J Choi, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E86A ( 12 ) 3099 - 3109 2003年12月
A hardware/software partitioning algorithm for processor cores with packed SIMD-type instructions
N Togawa, K Tachikake, Y Miyaoka, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E86A ( 12 ) 3218 - 3224 2003年12月
A retargetable simulator generator for DSP processor cores with packed SIMD-type instructions
N Togawa, K Kasahara, Y Miyaoka, J Choi, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E86A ( 12 ) 3099 - 3109 2003年12月
石川裕一朗, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術研究報告 VLD2003-89 ( 478 ) 115 - 120 2003年11月
面積制約を考慮したCAMプロセッサ向けハードウェア/ソフトウェア協調設計手法
石川裕一朗, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 IE2003-98 ( 380 ) 83 - 88 2003年10月
FPGAを用いたReconfigurable Adaptive FECの実装と評価
清水一範, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 Reconf2003-9 2003年09月
公共空間におけるハンドオフ時間短縮を考慮したBluetoothネットワークの手順に関する一検討
寺崎暁, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 CQ2003-58 25 - 28 2003年09月
動的再構成可能システムによるAdaptive FECの実装
清水一範, 戸川望, 柳澤政生, 大附辰夫
情報処理学会 DAシンポジウム 2003 25 - 30 2003年07月
システムLSI設計における定性的側面を考慮したハードウェア/ソフトウェア分割システム
小田雄一, 宮岡祐一郎, 戸川望, 橘昌良, 柳澤政生, 大附辰夫
情報処理学会 DAシンポジウム 2003 169 - 174 2003年07月
冗長記述を利用したVHDLへの透かし埋め込み手法
久保ゆきこ, 戸川望, 柳澤政生, 大附辰夫
情報処理学会 DAシンポジウム 2003 37 - 42 2003年07月
System Architecture based on Hardware/Software Codesign for Optimization of Video Encoders
The 2003 International Technical Conference on Circuits/Systems,Computers and Communications 2003年06月
System Architecture based on Hardware/Software Codesign for Optimization of Video Encoders
崔鎮求, 戸川望, 柳澤政生, 大附辰夫
The 2003 International Technical Conference on Circuits/Systems,Computers and Communications 2003年06月
A hardware/software cosynthesis system for processor cores with content addressable memories
N Togawa, T Totsuka, T Wakui, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E86A ( 5 ) 1082 - 1092 2003年05月
A hardware/software cosynthesis system for processor cores with content addressable memories
N Togawa, T Totsuka, T Wakui, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E86A ( 5 ) 1082 - 1092 2003年05月
An Instruction-Set Simulator Generator for SIMD Processor Cores
Proceedings of workshop SASIMI2003 160 - 167 2003年04月
ネットワークスイッチング処理を対象としたCAMプロセッサ自動合成システム
田中英夫, 戸川望, 柳澤政生, 大附辰夫
回路とシステム(軽井沢)ワークショップ 435 - 440 2003年04月
不規則なデータパスを持つプロセッサのハードウェア/ソフトウェア協調合成手法
宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
回路とシステム(軽井沢)ワークショップ 441 - 446 2003年04月
An Instruction-Set Simulator Generator for SIMD Processor Cores
宮岡祐一郎, 戸川望, 笠原亨介, 崔鎮求, 柳澤政生, 大附辰夫
Proceedings of SASIMI2003 160 - 167 2003年04月
閾値検索機能付きCAMプロセッサの最適化手法
戸塚崇夫, 宮岡祐一郎, 石川裕一朗, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-158 19 - 24 2003年03月
SIMD型プロセッサコア向けHW/SW分割におけるSIMD型演算最適化手法
太刀掛宏一, 宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-157 13 - 18 2003年03月
高位合成システムにおけるスレッド分割を用いた低消費電力化手法
内田純平, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-156 7 - 12 2003年03月
A hardware/software partitioning algorithm for SIMD processor cores
K Tachikake, N Togawa, Y Miyaoka, J Choi, M Yanagisawa, T Ohtsuki
ASP-DAC 2003: PROCEEDINGS OF THE ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 135 - 140 2003年 [査読有り]
ハードウェアIPの応答時間を考慮したプロセッサコアのハードウェア/ソフトウェア分割手法
田川博規, 小原俊逸, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-136 ( 609 ) 37 - 42 2003年01月
ハードウェアIPの応答時間を考慮したプロセッサコア合成システム
小原俊逸, 田川博規, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-135 ( 609 ) 31 - 36 2003年01月
MPEG-4コアプロファイル符号化向けDSP
石本剛, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-134 25 - 30 2003年01月
A high-level energy-optimizing algorithm for system VLSIs based on area/time/power estimation
S Noda, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E85A ( 12 ) 2655 - 2666 2002年12月
An algorithm and a flexible architecture for fast block-matching motion estimation
J Choi, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E85A ( 12 ) 2603 - 2611 2002年12月
A high-level energy-optimizing algorithm for system VLSIs based on area/time/power estimation
S Noda, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E85A ( 12 ) 2655 - 2666 2002年12月
An algorithm and a flexible architecture for fast block-matching motion estimation
J Choi, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E85A ( 12 ) 2603 - 2611 2002年12月
戸塚崇夫, 石川裕一朗, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-113 ( 476 ) 197 - 192 2002年11月
動的再構成可能システムによるプロトコルブースタの実装
清水一範, 陳暁梅, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-103 127 - 132 2002年11月
ストリーミングを主目的としたアクセスネットワークでの最大許容遅延を考慮した制御方式
柳澤政生, 佐藤隆之, 戸川望, 大附辰夫
電子情報通信学会技術報告,MoMuC 2-Jul ( 251 ) 13 - 18 2002年07月
仮想IP類推機構を有する動画像処理向けシステムVLSIのためのハードウェア/ソフトウェア分割システム
小田雄一, 磯田新平, 戸川望, 橘昌良, 柳澤政生, 大附辰夫
情報処理学会 DAシンポジウム 2002 173 - 178 2002年07月
A Software/Hardware Codesign for MPEG Encoder
FIT(Forum on Information Technology)2002 2002年06月
System-level Function and Architecture Codesign for Optimization of MPEG Encoder
ITC-CSCC'02 2002年06月
Packed SIMD 型命令を持つプロセッサを対象としたハードウェア/ソフトウェア協調合成システムのための並列化コンパイル手法
鈴木伸治, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-78 ( 168 ) 79 - 84 2002年06月
Packed SIMD型命令セットを持った画像処理プロセッサのためのハードウェア/ソフトウェア分割手法
太刀掛宏一, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2002-53 ( 168 ) 85 - 90 2002年06月
A Software/Hardware Codesign for MPEG Encoder
崔鎮求, 戸川望, 柳澤政生, 大附辰夫
FIT(Forum on Information Technology)2002 2002年06月
System-level Function and Architecture Codesign for Optimization of MPEG Encoder
崔鎮求, 戸川望, 柳澤政生, 大附辰夫
ITC-CSCC'02 2002年06月
モバイル環境における一対多通信 −シミュレーションによるFTPとSRMの比較−
佐藤隆之, 柳生健吾, 戸川望, 大附辰夫
電子情報通信学会技術報告,MoMuC 2-Jun 33 - 38 2002年05月
ディジタル信号処理向けプロセッサのためのシミュレータ生成手法
笠原亨介, 戸川望, 柳澤政生, 大附辰夫
情報処理学会論文誌 vol.43 No.5 1202 - 1213 2002年05月
Packed SIMD型命令を持つプロセッサを対象としたハードウェア/ソフトウェア協調合成システムのためのハードウェアユニット生成手法
宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
情報処理学会論文誌 vol.43 No.5 ( 5 ) 1191 - 1201 2002年05月
High-level area/delay/power estimation for low power system VLSIs with gated clocks
S Noda, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E85A ( 4 ) 827 - 834 2002年04月
DSPプロセッサコアのハードウェア/ソフトウェア協調合成システムのための演算語長縮小化手法
田川博規, 嶋下和宏, 戸川望, 柳澤政生, 大附辰夫
回路とシステム軽井沢ワークショップ 429 - 434 2002年04月
High-level area/delay/power estimation for low power system VLSIs with gated clocks
S Noda, N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E85A ( 4 ) 827 - 834 2002年04月
制御処理ハードウェア高位合成のためのコントロールデータフローグラフ変形手法
石井哲雄, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2001-165 ( 695 ) 41 - 48 2002年03月
IP再利用を考慮した動画像処理システムVLSI向けハードウェア/ソフトウェア分割設計支援システム
磯田新平, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2001-164 ( 695 ) 33 - 40 2002年03月
Packed SIMD 型演算器を持つディジタル信号処理プロセッサのためのリターゲッタブルシミュレータ生成手法
笠原亨介, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2001-162 24 - 17 2002年03月
VLSI architecture for a flexible motion estimation with parameters
J Choi, N Togawa, M Yanagisawa, T Ohtsuki
ASP-DAC/VLSI DESIGN 2002: 7TH ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE AND 15TH INTERNATIONAL CONFERENCE ON VLSI DESIGN, PROCEEDINGS 452 - 457 2002年 [査読有り]
Y Miyaoka, A Choi, N Togawa, M Yanagisawa, T Ohtsuki
APCCAS 2002: ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS, VOL 1, PROCEEDINGS 171 - 176 2002年 [査読有り]
An algorithm of hardware unit generation for processor core synthesis with packed SIMD type instructions
Y Miyaoka, A Choi, N Togawa, M Yanagisawa, T Ohtsuki
APCCAS 2002: ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS, VOL 1, PROCEEDINGS 171 - 176 2002年
ロジック入力用レベルシフトコンパレーター設計考察
宮崎英敏, 戸川望, 柳澤政生, 大附辰夫, 茨木栄武, 新谷悟
電子回路研究会,ETC-02-16 13 - 17 2002年01月
システムVLSIのための高位面積/遅延/消費電力見積もりに基づく低消費電力指向高位合成手法
野田真一, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2001-144 ( 577 ) 93 - 100 2002年01月
A new hardware/software partitioning algorithm for DSP processor cores with two types of register files
N Togawa, T Sakurai, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E84A ( 11 ) 2802 - 2807 2001年11月
Area and delay estimation in hardware/software cosynthesis for digital signal processor cores
N Togawa, Y Kataoka, Y Miyaoka, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E84A ( 11 ) 2639 - 2647 2001年11月
メモリとのインターフェース仕様を考慮した演算語長縮小に基づくプロセッサコアのハードウェア/ソフトウェア協調合成システム
嶋下和宏, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2001-110 ( 467 ) 127 - 132 2001年11月
A new hardware/software partitioning algorithm for DSP processor cores with two types of register files
N Togawa, T Sakurai, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E84A ( 11 ) 2802 - 2807 2001年11月
Area and delay estimation in hardware/software cosynthesis for digital signal processor cores
N Togawa, Y Kataoka, Y Miyaoka, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E84A ( 11 ) 2639 - 2647 2001年11月
A Hardware/Software Cosynthesis System for CAM Processors
SASIMI2001 2001年10月
A Hardware/Software Cosynthesis System for CAM Processors
戸川望, 涌井達彦, 柳澤政生, 大附辰夫
SASIMI2001 2001年10月
Implementation of Motion Estimation IP Core for MPEG Encoder
ITC-CSCC 2001 2001年07月
Packed SIMD型命令を持つプロセッサを対象としたハードウェア/ソフトウェア協調合成システムのためのハードウェアユニット生成手法
宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
情報処理学会 DAシンポジウム 2001 223 - 228 2001年07月
Implementation of Motion Estimation IP Core for MPEG Encoder
崔鎮求, 戸川望, 柳澤政生, 大附辰夫
ITC-CSCC 2001 2001年07月
An area/time optimizing algorithm in high-level synthesis of control-based hardwares
N Togawa, M Ienaga, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E84A ( 5 ) 1166 - 1176 2001年05月
An area/time optimizing algorithm in high-level synthesis of control-based hardwares
N Togawa, M Ienaga, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E84A ( 5 ) 1166 - 1176 2001年05月
ディジタル信号処理向けプロセッサコアのPacked SIMD型ハードウェアユニット生成手法
宮岡祐一郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2001-2 ( 45 ) 7 - 13 2001年05月
Gated Clockによる低消費電力化システムVLSIの高位面積/遅延/消費電力見積り
野田真一, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会第14回 回路とシステム(軽井沢)ワークショップ 591 - 596 2001年04月
ソフトIPのための保護アルゴリズム
堀川哲郎, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会第14回 回路とシステム(軽井沢)ワークショップ 411 - 416 2001年04月
システムLSIを対象としたハードウェア/ソフトウェア分割システム
小田龍之介, 磯田新平, 戸川望, 橘昌良, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2000-140 ( 646 ) 37 - 42 2001年03月
画像処理を対象としたPacked SIMD型命令セットを持つプロセッサのハードウェア/ソフトウェア協調合成システムにおける並列化Cコンパイラ
野々垣直浩, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2000-139 ( 646 ) 31 - 36 2001年03月
制御処理ハードウェアの高位合成システムのための面積/遅延見積もり手法
余田貴幸, 戸川望, 柳澤政生, 大附辰夫
情報処理学会研究報告 2001-SLDM-100-4,pp.25-32 ( 12 ) 25 - 32 2001年02月
RC等価回路に基づくクロストーク低減配線手法
曽根原理仁, 戸川望, 柳澤政生, 大附辰夫
情報処理学会研究報告 2001-SLDM-100-3,pp.17-24 17 - 24 2001年02月
Area/delay estimation for digital signal processor cores
Y Miyaoka, Y Kataoka, N Togawa, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF THE ASP-DAC 2001: ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 2001 156 - 161 2001年 [査読有り]
発見的算法と分枝限定法を用いた時間的予測に基づくリソースバイディング
中村洋, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2000-119 ( 532 ) 17 - 24 2001年01月
FPGAを用いた動的再構成可能システムを対象とするスケジューリング手法
石飛貴志, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2000-115 33 - 40 2001年01月
香西伸治, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2000-114 ( 531 ) 25 - 32 2001年01月
CAM processor synthesis based on behavioral descriptions
N Togawa, T Wakui, T Yoden, M Terajima, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E83A ( 12 ) 2464 - 2473 2000年12月
CAM processor synthesis based on behavioral descriptions
N Togawa, T Wakui, T Yoden, M Terajima, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E83A ( 12 ) 2464 - 2473 2000年12月
CAMプロセッサを対象とするハードウェア/ソフトウェア協調合成システム
涌井達彦, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2000-84 89 - 94 2000年11月
機能メモリを使用したプロセッサの面積/遅延見積もり手法
余傅達彦, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD2000-83 83 - 88 2000年11月
制御処理ハードウェアの高位合成システムのための面積/時間最適化アルゴリズム
家長真行, 戸川望, 柳澤政生, 大附辰夫
情報処理学会DAシンポジウム2000 27 - 32 2000年07月
A Behavioral Synthesis System for Processors with Content Addressable Memories
涌井達彦, 余傅達彦, 寺島信, 戸川望, 柳澤政生, 大附辰夫
Proc.SASIMI2000 56 - 63 2000年04月
システムVLSIの動作合成におけるレイアウト面積・遅延見積もり手法
諏訪勝, 戸川望, 柳澤政生, 大附辰夫
電子情報通信学会第13回回路とシステム(軽井沢)ワークショップ 125 - 130 2000年04月
A hardware/software cosynthesis system for digital signal processor cores with two types of register files
N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E83A ( 3 ) 442 - 451 2000年03月
歩行者を対象とした地図データ配信システムにおける専用プロセッサの設計と評価
伊澤義貴, 濱未希子, 柳澤政生, 大附辰夫
電子情報通信学会技術報告 VLD99-267 ( 658 ) 15 - 22 2000年03月
A hardware/software cosynthesis system for digital signal processor cores with two types of register files
N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E83A ( 3 ) 442 - 451 2000年03月
An area/time optimizing algorithm in high-level synthesis for control-based hardwares
Nozomu Togawa, Masayuki Ienaga, Masao Yanagisawa, Tatsuo Ohtsuki
Proceedings of the Asia and South Pacific Design Automation Conference, ASP-DAC 309 - 312 2000年 [査読有り]
A hardware/software partitioning algorithm for digital signal processor cores with two types of register files
N Togawa, T Sakurai, M Yanagisawa, T Ohtsuki
2000 IEEE ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS 544 - 547 2000年
A Behavioral Synthesis System for Processors with Content Addressable Memories
Proc. SASIMI 2000 56 - 63 2000年
A hardware/software partitioning algorithm for digital signal processor cores with two types of register files
N Togawa, T Sakurai, M Yanagisawa, T Ohtsuki
2000 IEEE ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS pp.544-547 544 - 547 2000年
An area/time optimizing algorithm in high-level synthesis for control-based hardwares
戸川望, 家長真行, 柳澤政生, 大附辰夫
Proceedings of IEEE Asia and South Pacific Design Automation Conference 2000 (ASP-DAC 2000) 2000年01月
A simultaneous placement and routing algorithm for FPGAs with power optimization
Journal of Circuits, Systems and Computers 9;1,2 99 - 112 1999年12月
A hardware/software cosynthesis system for digital signal processor cores
N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E82A ( 11 ) 2325 - 2337 1999年11月
2種類のレジスタファイルを持つディジタル信号処理向けプロセッサのハードウェア/ソフトウェア分割手法
電子情報通信学会技術報告 VLD99-76 1999年11月
片岡 義治, 吉澤 大, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術報告 VLD99-75 ( 475 ) 1 - 8 1999年11月
A hardware/software cosynthesis system for digital signal processor cores
IEICE Trans. on Fundamentals of Electronics, Communications and Computer Sciences E82-A;11 2325 - 2337 1999年11月
制御処理ハードウェアの高位合成システムのための面積/時間最適化アルゴリム
家長 真行, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術報告 VLD99-66 ( 317 ) 15 - 22 1999年09月
制御処理を主体としたハードウェアを対象とする高位合成システムとその適用
情報処理学会DAシンポジウム'99論文集 1999年07月
2種類のレジスタファイルを持ったディジタル信号処理向けプロセッサのハードウェア/ソフトウェア協調合成システム
電子情報通信学会第12回回路とシステム軽井沢ワークショップ論文集 1999年04月
分枝限定法に基づく最適解を保証するリソースバインディング手法
情報処理学会論文誌 40;4 1565 - 1577 1999年04月
A depth-constrained technology mapping algorithm for logic-blocks composed of tree-structured LUTs
N Togawa, K Ara, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E82A ( 3 ) 473 - 482 1999年03月
FPGAを用いた再構成可能システムとその応用
電子情報通信学会技術研究報告 VLD98;143 1999年03月
A depth-constrained technology mapping algorithm for logic-blocks composed of tree-structured LUTs
N Togawa, K Ara, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E82A ( 3 ) 473 - 482 1999年03月
A simultaneous placement and global routing algorithm for FPGAS with power optimization
N Togawa, K Ukai, M Yanagisawa, T Ohtsuki
JOURNAL OF CIRCUITS SYSTEMS AND COMPUTERS 9 ( 1-2 ) 99 - 112 1999年02月 [査読有り]
A simultaneous placement and global routing algorithm for FPGAS with power optimization
N Togawa, K Ukai, M Yanagisawa, T Ohtsuki
JOURNAL OF CIRCUITS SYSTEMS AND COMPUTERS 9 ( 1-2 ) 99 - 112 1999年02月
2種類のレジスタファイルを持ったディジタル信号処理向けプロセッサのハードウェア/ソフトウェア協調合成システムとその並列化コンパイラ
中村剛, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告 FTS98;132 71 - 78 1999年02月
A hardware/software partitioning algorithm for processor cores of digital signal processing
N Togawa, T Sakurai, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF ASP-DAC '99 335 - 338 1999年 [査読有り]
A hardware/software partitioning algorithm for processor cores of digital signal processing
N Togawa, T Sakurai, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF ASP-DAC '99 335 - 338 1999年
A high-level synthesis system for digital signal processing based on data-flow graph enumeration
N Togawa, T Hisaki, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E81A ( 12 ) 2563 - 2575 1998年12月
FPGAのマクロブロックを対象とした配置概略配線同時処理手法
情報処理学会研究報告 98-DA;90 1998年12月
A high-level synthesis system for digital signal processing based on data-flow graph enumeration
N Togawa, T Hisaki, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E81A ( 12 ) 2563 - 2575 1998年12月
N Togawa, M Yanagisawa, T Ohtsuki
IEEE TRANSACTIONS ON COMPUTER-AIDED DESIGN OF INTEGRATED CIRCUITS AND SYSTEMS 17 ( 9 ) 803 - 818 1998年09月 [査読有り]
最適解を保証するリソースバインディング手法
情報処理学会DAシンポジウム'98論文集 1998年07月
A fast scheduling algorithm based on gradual time-frame reduction for datapath synthesis
N Togawa, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E81A ( 6 ) 1231 - 1241 1998年06月
An FPGA layout reconfiguration algorithm based on global routes for engineering changes in system design specifications
N Togawa, K Hagi, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E81A ( 5 ) 873 - 884 1998年05月
中嶋 雄一郎, 鈴木 将貴, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告 98-DA;88 ( 43 ) 21 - 28 1998年05月
An FPGA layout reconfiguration algorithm based on global routes for engineering changes in system design specifications
N Togawa, K Hagi, M Yanagisawa, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E81A ( 5 ) 873 - 884 1998年05月
ツリー状に接続されたLUTを対象とした深さ制約付きテクノロジーマッピング手法
電子情報通信学会第11回回路とシステム軽井沢ワークショップ論文集 1998年04月
パイプラインプロセッサのハードウェア記述自動生成手法
電子情報通信学会技術研究報告 VLD97;117 1998年03月
ディジタル信号処理向けプロセッサの自動合成システムにおける並列化コンパイラ
電子情報通信学会技術研究報告 VLD97;116 1998年03月
ディジタル信号処理向けプロセッサのハードウェア/ソフトウェア協調合成システム
戸川 望, 桜井 崇志, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告 VLD97;115 ( 576 ) 17 - 24 1998年03月
平成9年度(第21回)丹羽記念賞
丹羽記念会 1998年02月
An incremental placement and global routing algorithm for field-programmable gate arrays
N Togawa, K Hagi, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF THE ASP-DAC '98 - ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 1998 WITH EDA TECHNO FAIR '98 519 - 526 1998年 [査読有り]
A high-level synthesis system for digital signal processing based on enumerating data-flow graphs
N Togawa, T Hisaki, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF THE ASP-DAC '98 - ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 1998 WITH EDA TECHNO FAIR '98 265 - 274 1998年 [査読有り]
A Fast Scheduling Algorithm Based on Gradual Time-Frame Reduction for Datapath Synthesis
IEICE Trans on Fundamentals of Electronics, Communications and Computer Sciences E81-A/6 1231 - 1240 1998年
A simultaneous placement and global routing algorithm for FPGAs with power optimization
N Togawa, K Ukai, M Yanagisawa, T Ohtsuki
APCCAS '98 - IEEE ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS 125 - 128 1998年
An incremental placement and global routing algorithm for field-programmable gate arrays
N Togawa, K Hagi, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF THE ASP-DAC '98 - ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 1998 WITH EDA TECHNO FAIR '98 519 - 526 1998年
A high-level synthesis system for digital signal processing based on enumerating data-flow graphs
N Togawa, T Hisaki, M Yanagisawa, T Ohtsuki
PROCEEDINGS OF THE ASP-DAC '98 - ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 1998 WITH EDA TECHNO FAIR '98 265 - 274 1998年
N Togawa, M Sato, T Ohtsuki
JOURNAL OF CIRCUITS SYSTEMS AND COMPUTERS 7 ( 5 ) 373 - 393 1997年10月 [査読有り]
A performance-oriented simultaneous placement and global routing algorithm for transport-processing FPGAs
N Togawa, M Sato, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E80A ( 10 ) 1795 - 1806 1997年10月
連想メモリを搭載したハードウェアエンジンによる故障回路並列故障シミュレーションの高速化手法
福山 誠一郎, 戸川 望, 佐藤政生, 大附 辰夫
電子情報通信学会技術研究報告 CPSY97;76 ( 103 ) 81 - 88 1997年10月
Fast scheduling and allocation algorithms for entropy CODEC
K Suzuki, N Togawa, M Sato, T Ohtsuki
IEICE TRANSACTIONS ON INFORMATION AND SYSTEMS E80D ( 10 ) 982 - 992 1997年10月
A performance-oriented simultaneous placement and global routing algorithm for transport-processing FPGAs
N Togawa, M Sato, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E80A ( 10 ) 1795 - 1806 1997年10月
機能メモリを使用したプロセッサを対象とするハードウェア/ソフトウェア協調合成システム
電子情報通信学会技術研究報告 CPSY98;85 1997年09月
ディジタル信号処理を対象とした高位合成システムにおける高速なスケジューリングアルゴリズム
情報処理学会DAシンポジウム'97論文集 1997年07月
FPGAを対象とした低消費電力指向配置・概略配線同時処理手法
鵜飼 薫, 戸川 望, 佐藤 政生, 大附 辰夫
電子情報通信学会技術研究報告 VLD97;42 ( 141 ) 191 - 198 1997年06月
システム設計仕様部分的変更を実現する概略配線径路を考慮したFPGA向けレイアウト再構成手法
電子情報通信学会第10回回路とシステム軽井沢ワークショップ論文集 1997年04月
A circuit partitioning algorithm with path delay constraints for multi-FPGA systems
N Togawa, M Sato, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E80A ( 3 ) 494 - 505 1997年03月
A circuit partitioning algorithm with path delay constraints for multi-FPGA systems
N Togawa, M Sato, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E80A ( 3 ) 494 - 505 1997年03月
スケッチレイアウトシステムにおけるBGAパッケージ配線手法
電子情報通信学会VLSI設計技術研究会 VLD96;96 1997年03月
接続コストの最小化を目的とした高速アロケーション手法
加藤 健吉, 戸川 望, 佐藤 政生, 大附 辰夫
電子情報通信学会VLSI設計技術研究会 VLD96;96 ( 556 ) 1 - 8 1997年03月
A Circuit Partitioning Alglrithm with Replication Capability for Multi-FPGA Systems
IEICE Trans,on Fundementals of Eledtronics,Communications and Computer Sciences E78-A/13 1118 - 1123 1997年
Simultaneous placement and global routing for transport-processing FPGA layout
N Togawa, M Sato, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E79A ( 12 ) 2140 - 2150 1996年12月
Dharmaアーキテクチャに基づくFPGAチップの試作
マイクロエレクトロニクス研究開発機構第15回研究交流会 1996年12月
Scheduling and Allocation Algorithms for Entropy CODEC
SUZUKI K.
Proceedings of the Sixth Workshop on Synthesis and System Integration of Mixed Technologies (SASIMI'96) 149 - 154 1996年11月
パス長制約を考慮した通信処理用FPGA向け配置・概略配線同時処理手法
戸川 望, 佐藤 政生, 大附 辰夫
情報処理学会設計自動化研究会 DA96;81 ( 299 ) 9 - 16 1996年10月
高位合成システムを用いた画像符号化アルゴリズムのハードウェア合成法
情報処理学会DAシンポジウム'96論文集 1996年08月
安藤研究所第9回安藤博記念学術奨励賞
1996年06月
金井 宏和, 戸川 望, 佐藤政生, 大附 辰夫
情報処理学会設計自動化研究会 DA96;80 ( 51 ) 9 - 14 1996年05月
電子情報通信学会第8回回路とシステム軽井沢ワークショップ研究奨励賞
1996年04月
A simultaneous technology mapping, placement, and global routing algorithm for FPGAs with path delay constraints
N Togawa, M Sato, T Ohtsuki
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E79A ( 3 ) 321 - 329 1996年03月 [査読有り]
N Togawa, M Sato, T Ohtsuki
PROCEEDINGS OF THE ASP-DAC '97 - ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 1997 569 - 578 1996年 [査読有り]
A simultaneous placement and global routing algorithm with path length constraints for transport-processing FPGAs
N Togawa, M Sato, T Ohtsuki
PROCEEDINGS OF THE ASP-DAC '97 - ASIA AND SOUTH PACIFIC DESIGN AUTOMATION CONFERENCE 1997 569 - 578 1996年
A performance-oriented circuit partitioning algorithm with logic-block replication for multi-FPGA systems
N Togawa, M Sato, T Ohtsuki
APCCAS '96 - IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS '96 294 - 297 1996年
Nozomu Togawa, Masao Sato, Tatsuo Ohtsuki
Proceedings of the 1995 Conference on Asia Pacific Design Automation, Makuhari, Massa, Chiba, Japan, August 29 - September 1, 1995 319 - 327 1995年 [査読有り]
MAPLE - A SIMULTANEOUS TECHNOLOGY MAPPING, PLACEMENT, AND GLOBAL ROUTING ALGORITHM FOR FIELD-PROGRAMMABLE GATE ARRAYS
N TOGAWA, M SATO, T OHTSUKI
IEICE TRANSACTIONS ON FUNDAMENTALS OF ELECTRONICS COMMUNICATIONS AND COMPUTER SCIENCES E77A ( 12 ) 2028 - 2038 1994年12月 [査読有り]
MAPLE - A SIMULTANEOUS TECHNOLOGY MAPPING, PLACEMENT, AND GLOBAL ROUTING ALGORITHM FOR FPGAS
N TOGAWA, M SATO, T OHTSUKI
APCCAS '94 - 1994 IEEE ASIA-PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS 554 - 559 1994年 [査読有り]
A SIMULTANEOUS PLACEMENT AND GLOBAL ROUTING ALGORITHM FOR FPGAS
N TOGAWA, M SATO, T OHTSUKI
1994 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS, VOL 1 A483 - A486 1994年 [査読有り]
Nozomu Togawa, Masao Sato, Tatsuo Ohtsuki
Proceedings of the 1994 IEEE/ACM International Conference on Computer-Aided Design, ICCAD 1994, San Jose, California, USA, November 6-10, 1994 156 - 163 1994年 [査読有り]
CMOS VLSI 回路設計 応用編
ウェスト,ハリス著, 宇佐美公良, 池田誠, 小林和淑監訳, 戸川望他分担共訳( 担当: 共訳)
丸善出版 2014年01月 ISBN: 9784621087206
組込みシステム概論
戸川望編著
CQ出版 2008年02月 ISBN: 9784789845502
ライフサイエンス
量子・古典ハイブリッドテストベッドの利用環境整備
戦略的イノベーション創造プログラム(SIP)第三期
研究期間:
再構成アクセラレータのための近似最適化手法
日本学術振興会 科学研究費助成事業
研究期間:
木村 晋二, 戸川 望, 孫 鶴鳴
量子計算及びイジング計算システムの統合型研究開発
NEDO 高効率・高速処理を可能とするAIチップ・次世代コンピューティングの技術開発
研究期間:
攻撃に耐性を持つ機械学習モデルによる設計工程ハードウェアトロイ検知
日本学術振興会 科学研究費助成事業
研究期間:
戸川 望, 木村 晋二
次世代アクセラレータ基盤に係る研究開発
戦略的イノベーション創造プログラム(SIP)第二期
研究期間:
機械学習による集積回路設計データ中のハードウェアトロイ検知
日本学術振興会 科学研究費助成事業 基盤研究(B)
研究期間:
戸川 望, 木村 晋二
再構成アクセラレータにおけるデータ形式最適化と精度保証
日本学術振興会 科学研究費助成事業 基盤研究(B)
研究期間:
木村 晋二, 戸川 望
イジングマシン共通ソフトウェア基盤の研究開発
NEDO 高効率・高速処理を可能とするAIチップ・次世代コンピューティングの技術開発
研究期間:
戸川 望
設計・製造におけるチップの脆弱性検知手法の研究開発
総務省・ICT重点技術の研究開発プロジェクト
研究期間:
超微細加工技術にも適応する抽象LSIモデルの構築と高位・物理 統合化LSI合成技術
科学研究費助成事業(早稲田大学) 科学研究費助成事業(基盤研究(B))
研究期間:
戸川 望
認知科学とプリント基板配線を応用した屋内経路探索とその表示手法
科学研究費助成事業(早稲田大学) 科学研究費助成事業(挑戦的萌芽研究)
研究期間:
戸川 望
選択論理を利用した超高速な差積演算回路とその実応用回路の設計
産学が連携した研究開発成果の展開 研究成果展開事業 研究成果最適展開支援プログラム(A-STEP) 探索タイプ
研究期間:
戸川 望
ディープサブミクロン技術を想定した次世代高位合成システムに関する研究
科学研究費助成事業(早稲田大学) 科学研究費助成事業(若手研究(B))
研究期間:
戸川 望
高速大容量ネットワークプロセッサ設計システムに関する研究
科学研究費助成事業(北九州市立大学) 科学研究費助成事業(若手研究(B))
研究期間:
戸川 望
FPGAを対象とした動的再構成可能システムとその設計環境に関する研究
科学研究費助成事業(早稲田大学) 科学研究費助成事業(奨励研究(A))
研究期間:
戸川 望
画像処理向け組込みプロセッサのハ-ドウェア/ソフトウェア協調設計手法に関する研究
科学研究費助成事業(早稲田大学) 科学研究費助成事業(奨励研究(A))
研究期間:
戸川 望
高信頼IoT社会を実現する分散型基盤アーキテクチャの研究開発
NEDO エネルギー・環境新技術先導プログラム
戸川 望
極低エネルギー化を実現する統合化システムLSI設計技術
NEDO 先導的産業技術創出事業
戸川 望
IoT部品・機器・ネットワークの階層横断セキュリティ技術の研究開発
総務省 戦略的情報通信研究開発推進事業(SCOPE)
戸川 望
設計工程に侵入したハードウェアトロイの検出と耐ハードウェアトロイ設計技術の研究開発
総務省 戦略的情報通信研究開発推進事業(SCOPE)
戸川 望
不揮発メモリの書込みビット数を厳密に最小化する符号化とノーマリオフ計算への応用
科学研究費助成事業(早稲田大学) 科学研究費助成事業(挑戦的研究(萌芽))
戸川 望
セレクタ論理を利用し部分積項数を半減する差積演算回路設計とその画像処理応用
科学研究費助成事業(早稲田大学) 科学研究費助成事業(挑戦的萌芽研究)
戸川 望
大域的超低エネルギー化を実現するLSI抽象モデルと上位下位統合化LSI設計技術
科学研究費助成事業(早稲田大学) 科学研究費助成事業(基盤研究(B))
戸川 望
ランダムフォレストに基づくハードウェアトロイ検知に対する強化学習を用いた自律的なハードウェアトロイ生成手法
池上, 裕香, 根岸, 良太郎, 長谷川, 健人, 披田野, 清良, 福島, 和英, 戸川, 望
コンピュータセキュリティシンポジウム2023論文集 684 - 690 2023年10月
佐伯, 越志, 鮑, 思雅, 高山, 敏典, 戸川, 望
マルチメディア,分散,協調とモバイルシンポジウム2023論文集 2023 490 - 503 2023年06月
梶本, 大, 佐伯, 越志, 鮑, 思雅, 戸川, 望
マルチメディア,分散,協調とモバイルシンポジウム2023論文集 2023 329 - 335 2023年06月
補正処理を導入した部分QUBOアニーリングによる複数日旅程最適化
野口竜弥, 深田佳佑, 鮑思雅, 戸川望
電子情報通信学会技術研究報告(Web) 123 ( 258(VLD2023 30-79) ) 2023年
グラフ学習を用いたゲートレベルハードウェアトロイ識別に対するメンバシップ推論攻撃
山下, 一樹, 長谷川, 健人, 披田野, 清良, 福島, 和英, 戸川, 望
コンピュータセキュリティシンポジウム2022論文集 408 - 415 2022年10月
実環境を想定したハードウェアトロイ回路を対象としたXGBoostによるハードウェアトロイ識別
根岸, 良太郎, 長谷川, 健人, 福島, 和英, 清本, 晋作, 戸川, 望
コンピュータセキュリティシンポジウム2022論文集 416 - 423 2022年10月
佐伯, 越志, 鮑, 思雅, 高山, 敏典, 戸川, 望
マルチメディア,分散,協調とモバイルシンポジウム2022論文集 2022 1556 - 1569 2022年07月
量子アニーリングマシンと非量子イジングマシンを利用したハイブリッド最適化手法に向けた解析
菊池脩太, 戸川望, 田中宗, 田中宗, 田中宗
日本物理学会講演概要集(CD-ROM) 77 ( 2 ) 2022年
ビット幅削減イジングモデルのシミュレーテッドアニーリングにおける動的プロセスの解析
菊池脩太, 戸川望, 田中宗, 田中宗
日本物理学会講演概要集(CD-ROM) 77 ( 1 ) 2022年
ニューラルネットワークを用いたハードウェアトロイ識別に対するデータ拡張と敵対的学習の応用と評価
野澤 康平, 披田野 清良, 清本 晋作, 戸川 望
コンピュータセキュリティシンポジウム2020論文集 1206 - 1213 2020年10月
スマートフォンとスマートウォッチを併用したPDRによる屋内位置推定
若泉 朋弥, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2205論文集 ( 2020 ) 1290 - 1302 2020年06月
モンテカルロ木探索を用いたユーザ個人の嗜好を考慮した経路推薦手法の高速化
石崎 雄太, 高山 敏典, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2206論文集 ( 2020 ) 1303 - 1310 2020年06月
メタヒューリスティクスの制約なし二次形式二値変数最適化問題への適用 (システム数理と応用)
多和田 雅師, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 119 ( 470 ) 43 - 48 2020年03月
イジング計算機による3次元直方体パッキング問題の解法 (VLSI設計技術)
金丸 翔, 寺田 晃太朗, 川村 一志, 田中 宗, 富田 憲範, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 119 ( 443 ) 173 - 178 2020年03月
トリガ回路の性質にもとづく特徴量を利用したニューラルネットワークによるハードウェアトロイ識別 (VLSI設計技術)
井上 智貴, 長谷川 健人, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 119 ( 443 ) 227 - 232 2020年03月
イジングマシンを用いたアミューズメントパークの経路最適化手法 (VLSI設計技術)
武笠 陽介, 若泉 朋弥, 田中 宗, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 119 ( 443 ) 167 - 172 2020年03月
乱数化関数を用いた乱数生成回路を共有するストカスティック数生成器 (VLSI設計技術)
多和田 雅師, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 119 ( 443 ) 163 - 166 2020年03月
イジングモデルによる類似誘導部分グラフ同型問題の解法 (VLSI設計技術) -- (デザインガイア2019 : VLSI設計の新しい大地)
吉村 夏一, 多和田 雅師, 田中 宗, 新井 淳也, 巴 徳瑪, 八木 哲志, 内山 寛之, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 119 ( 282 ) 103 - 108 2019年11月
ストカスティック計算におけるステップ関数の実装と評価 (VLSI設計技術) -- (デザインガイア2019 : VLSI設計の新しい大地)
石川 遼太, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 119 ( 282 ) 69 - 74 2019年11月
低密度パリティ検査符号復号問題を制約なし二次形式二値変数最適化問題に変換した解法
多和田 雅師, 田中 宗, 戸川 望
DAシンポジウム2019論文集 ( 2019 ) 45 - 50 2019年08月
スリープ状態をもつ組込みシステムを対象とした電力解析にもとづく異常動作検知とその実証的評価
長谷川 健人, 近松 聖, 戸川 望
DAシンポジウム2019論文集 ( 2019 ) 93 - 98 2019年08月
ストカスティック数を用いた再帰的分割による解像度解釈可変な画像形式 (VLSI設計技術)
石川 遼太, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 119 ( 154 ) 71 - 76 2019年07月
モンテカルロ木探索によるユーザ個人の嗜好を考慮した経路推薦手法とその評価
石崎 雄太, 高山 敏典, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2019論文集 ( 2019 ) 854 - 862 2019年06月
動的な歩幅更新をベースとするマップマッチングによるPDR手法
西村 天晴, 高山 敏典, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2019論文集 ( 2019 ) 1663 - 1669 2019年06月
宇佐見 友理, 石川 和明, 高山 敏典, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2019論文集 ( 2019 ) 1670 - 1675 2019年06月
2ⁿRRR : 高度な並び替えにより誤り耐性を強化したストカスティック数複製器 (VLSI設計技術) -- (デザインガイア2018 : VLSI設計の新しい大地)
石川 遼太, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 118 ( 334 ) 95 - 100 2018年12月
高位合成時のモジュール分割におけるバッファコスト最小化問題とその解法
大場 諒介, 川村 一志, 田宮 豊, 柳澤 政生, 戸川 望
DAシンポジウム2018論文集 ( 2018 ) 63 - 68 2018年08月
西澤 誠人, 長谷川 健人, 柳澤 政生, 戸川 望
DAシンポジウム2018論文集 ( 2018 ) 112 - 117 2018年08月
マイクロコントローラのスリープ状態に着目した消費電力にもとづく悪意のある機能の発現検知
長谷川 健人, 柳澤 政生, 戸川 望
DAシンポジウム2018論文集 ( 2018 ) 118 - 123 2018年08月
スマートフォン搭載3軸加速度センサと3軸ジャイロセンサを用いた自転車の挙動認識
宇佐見 友理, 石川 和明, 高山 敏典, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2018論文集 ( 2018 ) 32 - 42 2018年06月
西村 天晴, 石川 和明, 高山 敏典, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2018論文集 ( 2018 ) 1612 - 1621 2018年06月
再収斂による計算誤りに耐性を持つストカスティック数複製器を用いた活性化関数の実装と評価 (VLSI設計技術)
石川 遼太, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 118 ( 83 ) 167 - 172 2018年06月
金丸翔, 於久太祐, 多和田雅師, 田中宗, 田中宗, 林真人, 山岡雅直, 柳澤政生, 戸川望
電子情報通信学会技術研究報告 118 ( 85(MSS2018 1-36) ) 161‐166 2018年06月
亜種ハードウェアトロイの設計とそのニューラルネットワークを用いた検出
井上智貴, 長谷川健人, 小林悠記, 柳澤政生, 戸川望
電子情報通信学会技術研究報告 118 ( 85(MSS2018 1-36) ) 173‐178 2018年06月
リーク削減による低消費電力SRAMの設計—A low power SRAM design with leakage power reduction
伊藤 卓, 戸川 望, 柳澤 政生, 史 又華
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 31 197 - 202 2018年05月
低周波圧電エネルギーハーベスティングにおけるMOSs SP-SSHI手法—MOSs SP-SSHI for low frequency piezoelectric energy harvesting
杉山 貴紀, 戸川 望, 柳澤 政生, 史 又華
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 31 86 - 91 2018年05月
CNNに対する概算加算器の適用と評価—Application and evaluation of CNN with approximate adders
井上 雄太, 戸川 望, 柳澤 政生, 史 又華
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 31 191 - 196 2018年05月
効率的なストカスティック数複製器と合成関数回路を用いたその評価 (ディペンダブルコンピューティング) -- (組込み技術とネットワークに関するワークショップETNET2018)
石川 遼太, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 117 ( 480 ) 209 - 214 2018年03月
於久 太祐, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 117 ( 480 ) 251 - 256 2018年03月
鍵長128ビット,192ビット,256ビットの軽量暗号CLEFIAに対するスキャンベース攻撃手法 (コンピュータシステム) -- (組込み技術とネットワークに関するワークショップETNET2018)
於久 太祐, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 117 ( 479 ) 251 - 256 2018年03月
複数エリアへの近接度を用いたパーティクルフィルタによる屋内測位手法の適用
百瀬凌也, 石川和明, 柳澤政生, 戸川望
電子情報通信学会大会講演論文集(CD-ROM) 2018 ROMBUNNO.A‐14‐7 2018年03月
凍結ビットパタンの偏りを利用した高速Polar符号復号器とそのハードウェア実装の検討
多和田雅師, 神谷典史, 井手口裕太, 井上浩明, 戸川望
電子情報通信学会大会講演論文集(CD-ROM) 2018 ROMBUNNO.A‐1‐12 2018年03月
LSIの配線問題―DAシンポジウムの配線問題解法コンテスト―2 機械学習とFPGAを用いた配線問題解法への取り組み
川村一志, 長谷川健人, 多和田雅師, 戸川望
情報処理 59 ( 3 ) 228‐231 2018年02月
低周波圧電エネルギーハーベスティングにおけるMOSs SP‐SSHI手法
杉山貴紀, 戸川望, 柳澤政生, SHI Youhua
回路とシステムワークショップ論文集(CD-ROM) 31st ROMBUNNO.A2‐1 2018年
伊藤卓, 戸川望, 柳澤政生, SHI Youhua
回路とシステムワークショップ論文集(CD-ROM) 31st ROMBUNNO.C4‐3 2018年
トリガ条件の異なるハードウェアトロイの設計とSVMを用いた検出 (VLSI設計技術) -- (デザインガイア2017 : VLSI設計の新しい大地)
井上 智貴, 長谷川 健人, 小林 悠記, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 117 ( 273 ) 133 - 138 2017年11月
暗号回路に挿入されたハードウェアトロイとその抑止回路のFPGA実装 (VLSI設計技術) -- (デザインガイア2017 : VLSI設計の新しい大地)
長谷川 健人, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 117 ( 273 ) 139 - 144 2017年11月
静的な定数を係数とする乱数生成器を使用しないストカスティック論理回路 (VLSI設計技術) -- (デザインガイア2017 : VLSI設計の新しい大地)
多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 117 ( 273 ) 121 - 124 2017年11月
スキャンシグネチャを用いた周辺回路を含む軽量暗号CLEFIAに対するスキャンベース攻撃
於久 太祐, 多和田 雅師, 柳澤 政生, 戸川 望
DAシンポジウム2017論文集 ( 2017 ) 116 - 121 2017年08月
20KスピンCMOSアニーリングマシンを対象とした完全結合イジングモデルマッピング手法と評価
寺田 晃太朗, 田中 宗, 林 真人, 山岡 雅直, 柳澤 政生, 戸川 望
DAシンポジウム2017論文集 ( 2017 ) 163 - 168 2017年08月
平井 勇也, 川村 一志, 柳澤 政生, 戸川 望
DAシンポジウム2017論文集 ( 2017 ) 180 - 185 2017年08月
石川 遼太, 多和田 雅師, 柳澤 政生, 戸川 望
DAシンポジウム2017論文集 ( 2017 ) 169 - 174 2017年08月
百瀬 凌也, 新田 知之, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2017論文集 ( 2017 ) 514 - 522 2017年06月
疎な GPS 測位情報を対象にした測位精度と短時間滞在除去に基づく滞在地推定手法
岩田 紗瑛, 新田 知之, 高山 敏典, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2017論文集 ( 2017 ) 523 - 531 2017年06月
C-elementを用いたソフトエラー耐性をもつSHCラッチの設計
田島 咲季, 戸川 望, 柳澤 政生, 史 又華
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 30 214 - 219 2017年05月
中垣 直道, 戸川 望, 柳澤 政生, 史 又華
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 30 220 - 225 2017年05月
早水 謙, 戸川 望, 柳澤 政生, 史 又華
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 30 7 - 12 2017年05月
自己動力型スイッチング磁気変圧回路を用いたエネルギーハーベスティングシステム
川合 洋平, 戸川 望, 柳澤 政生, 史 又華
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 30 1 - 6 2017年05月
連続してハッシュ値を出力しないHMAC-SHA-256回路へのスキャンベース攻撃手法 (ディペンダブルコンピューティング) -- (組込み技術とネットワークに関するワークショップETNET2017)
於久 太祐, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 511 ) 129 - 134 2017年03月
ネットの特徴量を用いた多層ニューラルネットワークによるハードウェアトロイ識別 (ディペンダブルコンピューティング) -- (組込み技術とネットワークに関するワークショップETNET2017)
長谷川 健人, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 511 ) 135 - 140 2017年03月
連続してハッシュ値を出力しないHMAC-SHA-256回路へのスキャンベース攻撃手法 (コンピュータシステム) -- (組込み技術とネットワークに関するワークショップETNET2017)
於久 太祐, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 510 ) 129 - 134 2017年03月
ネットの特徴量を用いた多層ニューラルネットワークによるハードウェアトロイ識別 (コンピュータシステム) -- (組込み技術とネットワークに関するワークショップETNET2017)
長谷川 健人, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 510 ) 135 - 140 2017年03月
ニューラルネットワークにもとづく概算回路設計手法 (VLSI設計技術)
川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 478 ) 25 - 30 2017年03月
PDRの測位誤差補正のためのマルチシナリオ化マップマッチング手法 (画像工学)
岩名地 良太, 新田 知之, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 464 ) 387 - 392 2017年02月
岩名地 良太, 新田 知之, 柳澤 政生, 戸川 望
映像情報メディア学会技術報告 = ITE technical report 41 ( 5 ) 387 - 392 2017年02月
高精度ストカスティック演算のためのFSM設計 (VLSI設計技術)
多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 415 ) 171 - 174 2017年01月
道路照明灯とランドマークを用いた道路照度レベルの評価法
BAO Siya, YANAGISAWA Masao, TOGAWA Nozomu
電子情報通信学会大会講演論文集(CD-ROM) 2017 2017年
セレクタ論理に帰着させたバタフライ演算器のFPGA実装評価 (VLSI設計技術) -- (デザインガイア2016 : VLSI設計の新しい大地)
伊東 光希, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 330 ) 67 - 72 2016年11月
CCNルータのためのコンテンツのネーム長による分割ハッシュテーブルと平衡木によるFIBの構築 (VLSI設計技術) -- (デザインガイア2016 : VLSI設計の新しい大地)
島崎 健太, 右近 祐太, 宮崎 昭彦, 津田 俊隆, 中里 秀則, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 330 ) 123 - 128 2016年11月
動作中のIoTデバイスに対する電気容量変化の測定を用いた不正改変検知装置の設計 (VLSI設計技術) -- (デザインガイア2016 : VLSI設計の新しい大地)
北山 遼育, 竹中 崇, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 330 ) 129 - 134 2016年11月
経年劣化を考慮したフロアプラン統合化高位合成手法 (VLSI設計技術) -- (デザインガイア2016 : VLSI設計の新しい大地)
井川 昂輝, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 330 ) 141 - 146 2016年11月
スキャンシグネチャを用いたスキャンデータ解析に基づくHMAC-SHA-256ハッシュ回路のスキャンベース攻撃
於久 太祐, 多和田 雅師, 柳澤 政生, 戸川 望
DAシンポジウム2016論文集 2016 ( 2 ) 2 - 7 2016年09月
Random Forestを用いたネットリスト特徴選択と機械学習によるハードウェアトロイ識別
長谷川 健人, 柳澤 政生, 戸川 望
DAシンポジウム2016論文集 2016 ( 3 ) 8 - 13 2016年09月
リードソロモン符号に基づいたマルチレベルセル不揮発性メモリ書き込み削減
多和田 雅師, 柳澤 政生, 戸川 望
DAシンポジウム2016論文集 2016 ( 31 ) 163 - 168 2016年09月
EDA研究の観点から (小特集 VDECとLSI設計研究・教育 : LSI設計試作のコモディティ化20年の歩みと今後)
戸川 望
電子情報通信学会誌 = The journal of the Institute of Electronics, Information and Communication Engineers 99 ( 9 ) 901 - 906 2016年09月
歩行者の方向判断基準を用いた腕時計型ウェアラブル端末向け略地図生成手法
河野 圭亮, 新田 知之, 石川 和明, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2016論文集 ( 2016 ) 411 - 418 2016年07月
眼鏡型ウェアラブル端末を用いたランドマーク確認に基づく屋外歩行者ナビゲーション
矢野 椋也, 新田 知之, 石川 和明, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2016論文集 ( 2016 ) 419 - 427 2016年07月
岩名地 良太, 新田 知之, 石川 和明, 柳澤 政生, 戸川 望
マルチメディア,分散協調とモバイルシンポジウム2016論文集 ( 2016 ) 1748 - 1756 2016年07月
Trivium暗号回路に対するスキャンベース攻撃の実装評価 (システム数理と応用)
於久 太祐, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 96 ) 7 - 12 2016年06月
ニューラルネットを利用したネットリストの特徴にもとづくハードウェアトロイ識別 (システム数理と応用)
長谷川 健人, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 96 ) 1 - 6 2016年06月
ニューラルネットを利用したネットリストの特徴にもとづくハードウェアトロイ識別 (信号処理)
長谷川 健人, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 95 ) 1 - 6 2016年06月
Trivium暗号回路に対するスキャンベース攻撃の実装評価 (信号処理)
於久 太祐, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 95 ) 7 - 12 2016年06月
高速かつ低電力なソフトエラー耐性をもつFast-SEHラッチの設計
田島 咲季, 史 又華, 戸川 望, 柳澤 政生
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 29 220 - 224 2016年05月
DFGのクリティカルパス最適化に基づく演算チェイニングを用いたRDRアーキテクチャ対象高位合成手法 (VLSI設計技術)
寺田 晃太朗, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 116 ( 21 ) 41 - 46 2016年05月
A-6-4 FPGA実装を考慮したセレクタ論理型ボリュームレンダリング回路の改良と評価(A-6.VLSI設計技術,一般セッション)
五十嵐 啓太, 柳澤 政生, 戸川 望
電子情報通信学会基礎・境界ソサイエティ/NOLTAソサイエティ大会講演論文集 2016 78 - 78 2016年03月
A-6-5 クリティカルパス最適化フロアプラン指向FPGA高位合成手法のアプリケーション適用評価(A-6.VLSI設計技術,一般セッション)
藤原 晃一, 川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会基礎・境界ソサイエティ/NOLTAソサイエティ大会講演論文集 2016 79 - 79 2016年03月
FPGA実装を考慮したセレクタ論理型ボリュームレンダリング回路の設計評価 (VLSI設計技術)
五十嵐 啓太, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 115 ( 465 ) 119 - 124 2016年02月
動的遅延ばらつきに対する適応性を考慮したフロアプラン指向高位合成手法の検討 (VLSI設計技術)
井川 昂輝, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 115 ( 398 ) 209 - 214 2016年01月
15nmプロセスにおける低電力な耐ソフトエラーラッチの設計 (VLSI設計技術)
田島 咲季, 史 又華, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 115 ( 338 ) 123 - 127 2015年12月
タイミングエラー予測回路によるデータ依存最適化回路設計とそのFPGA評価 (VLSI設計技術)
川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 115 ( 338 ) 183 - 188 2015年12月
A-3-7 不揮発メモリを対象に最悪書込みビット数削減と誤り訂正を両立する一対多符号構成手法(A-3.VLSI設計技術,一般セッション)
古城 辰朗, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会基礎・境界ソサイエティ/NOLTAソサイエティ大会講演論文集 2015 52 - 52 2015年08月
A-9-2 低電力なソフトエラー耐性をもつNew-SEHラッチの設計(A-9.信頼性,一般セッション)
田島 咲季, 史 又華, 戸川 望, 柳澤 政生
電子情報通信学会基礎・境界ソサイエティ/NOLTAソサイエティ大会講演論文集 2015 106 - 106 2015年08月
クラスタリングによる書き込みビット数削減と誤り訂正を実現する不揮発メモリを対象とした符号の構成手法
古城 辰朗, 多和田 雅師, 柳澤 政生, 戸川 望
DAシンポジウム2015論文集 ( 2015 ) 11 - 16 2015年08月
演算チェイニングの候補列挙・選択アルゴリズムを用いたフロアプラン指向高位合成手法
寺田 晃太朗, 柳澤 政生, 戸川 望
DAシンポジウム2015論文集 ( 2015 ) 17 - 22 2015年08月
基板バイアス制御による遅延ばらつき補償および配線遅延を考慮した低エネルギーオーバーヘッド指向の高位合成手法
井川 昂輝, 史 又華, 柳澤 政生, 戸川 望
DAシンポジウム2015論文集 ( 2015 ) 23 - 28 2015年08月
ローテータベースマルチプレクサネットワークによるフィールドデータ抽出器の構成手法
伊東 光希, 川村 一志, 田宮 豊, 柳澤 政生, 戸川 望
DAシンポジウム2015論文集 ( 2015 ) 29 - 34 2015年08月
セレクタ論理に帰着させたアルファブレンド演算器を用いた画像間合成回路のFPGA実装
五十嵐 啓太, 柳澤 政生, 戸川 望
DAシンポジウム2015論文集 ( 2015 ) 143 - 148 2015年08月
低電力IoTデバイスを対象とするノイズに強く測定の長さが制約されない小型電力解析装置の設計
北山 遼育, 竹中 崇, 柳澤 正生, 戸川 望
DAシンポジウム2015論文集 ( 2015 ) 161 - 166 2015年08月
クロックグリッチに基づく故障解析に耐性を持つAES暗号回路 (VLSI設計技術)
平野 大輔, 史 又華, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 115 ( 21 ) 51 - 55 2015年05月
平野 大輔, 史 又華, 戸川 望, 柳澤 政生
情報処理学会研究報告. SLDM, [システムLSI設計技術] 2015 ( 10 ) 1 - 5 2015年05月
製造ばらつきと配線遅延を同時に考慮した低レイテンシ指向のマルチシナリオ高位合成の評価 (ディペンダブルコンピューティング)
井川 昂輝, 阿部 晋矢, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 507 ) 155 - 160 2015年03月
鍵長に依存しないLED暗号に対するスキャンベース攻撃 (ディペンダブルコンピューティング)
藤代 美佳, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 507 ) 149 - 154 2015年03月
鍵長に依存しないLED暗号に対するスキャンベース攻撃 (コンピュータシステム)
藤代 美佳, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 506 ) 149 - 154 2015年03月
ゲートレベルネットリストを対象としたスコアに基づくハードウェアトロイ識別手法 (VLSI設計技術)
大屋 優, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 476 ) 165 - 170 2015年03月
藤代 美佳, 柳澤 政生, 戸川 望
情報処理学会研究報告. SLDM, [システムLSI設計技術] 2015 ( 47 ) 1 - 6 2015年02月
製造ばらつきと配線遅延を同時に考慮した低レイテンシ指向のマルチシナリオ高位合成の評価
井川 昂輝, 阿部 晋矢, 柳澤 政生, 戸川 望
情報処理学会研究報告. SLDM, [システムLSI設計技術] 2015 ( 48 ) 1 - 6 2015年02月
A-3-1 FPGA向けフロアプラン指向高位合成手法のための配線遅延モデリング(A-3.VLSI設計技術,一般セッション)
藤原 晃一, 柳澤 政生, 戸川 望
電子情報通信学会総合大会講演論文集 2015 80 - 80 2015年02月
A-3-8 FPGAを対象としたセレクタ論理型アルファブレンディング回路の実装と評価(A-3.VLSI設計技術,一般セッション)
五十嵐 啓太, 柳澤 政生, 戸川 望
電子情報通信学会総合大会講演論文集 2015 87 - 87 2015年02月
トロイネットの特徴に基づくハードウェアトロイ検出手法 (VLSI設計技術)
大屋 優, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 426 ) 157 - 162 2015年01月
トロイネットの特徴に基づくハードウェアトロイ検出手法 (コンピュータシステム)
大屋 優, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 427 ) 157 - 162 2015年01月
トロイネットの特徴に基づくハードウェアトロイ検出手法
大屋 優, 史 又華, 柳澤 政生, 戸川 望
情報処理学会研究報告. SLDM, [システムLSI設計技術] 2015 ( 28 ) 1 - 6 2015年01月
マルチプレクサ木分割によるフィールドデータ抽出器の構成手法 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
伊東 光希, 川村 一志, 柳澤 政生, 戸川 望, 田宮 豊
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 197 - 202 2014年11月
吉田 慎之介, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 57 - 62 2014年11月
HDR-mcvを対象とした複数クロックドメインおよび複数電源電圧による低電力化高位合成手法 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
阿部 晋矢, 史 又華, 宇佐美 公良, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 203 - 208 2014年11月
HDRアーキテクチャを対象とした製造ばらつき耐性と低レイテンシを両立可能なマルチシナリオ高位合成手法 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
井川 昂輝, 阿部 晋矢, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 105 - 110 2014年11月
不揮発メモリを対象とした最大ハミング距離と最小ハミング距離を制約した符号による書き込み手法のエネルギー評価 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
古城 辰朗, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 221 - 226 2014年11月
不揮発メモリの書き込み削減手法のための小面積なエンコーダ/デコーダ回路構成 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
多和田 雅師, 木村 晋二, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 227 - 232 2014年11月
タイミングエラー予測回路による再構成可能デバイス上でのデータ依存最適化回路設計 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
川村 一志, 阿部 晋矢, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 51 - 56 2014年11月
タイミングエラーへの耐性を持つフリップフロップ設計 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
鈴木 大渡, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 45 - 50 2014年11月
FPGAの配線遅延特性を利用したフロアプラン指向高位合成手法 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
藤原 晃一, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 99 - 104 2014年11月
DTMOSを用いたサブスレッショルド回路の高速化設計 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
福留 祐治, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 117 - 121 2014年11月
ハードウェアトロイに含まれるネットに着目したハードウェアトロイ検出手法 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
大屋 優, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 135 - 140 2014年11月
遅延ばらつき許容量を最適化するRDRアーキテクチャ向け高位合成手法 (VLSI設計技術) -- (デザインガイア2014 : VLSI設計の新しい大地)
萩尾 勇太, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 328 ) 209 - 214 2014年11月
タイミングエラーへの耐性を持つフリップフロップ設計 (ディペンダブルコンピューティング) -- (デザインガイア2014 : VLSI設計の新しい大地)
鈴木 大渡, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 329 ) 45 - 50 2014年11月
FPGAの配線遅延特性を利用したフロアプラン指向高位合成手法 (ディペンダブルコンピューティング) -- (デザインガイア2014 : VLSI設計の新しい大地)
藤原 晃一, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 329 ) 99 - 104 2014年11月
DTMOSを用いたサブスレッショルド回路の高速化設計 (ディペンダブルコンピューティング) -- (デザインガイア2014 : VLSI設計の新しい大地)
福留 祐治, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 329 ) 117 - 121 2014年11月
ハードウェアトロイに含まれるネットに着目したハードウェアトロイ検出手法 (ディペンダブルコンピューティング) -- (デザインガイア2014 : VLSI設計の新しい大地)
大屋 優, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 329 ) 135 - 140 2014年11月
遅延ばらつき許容量を最適化するRDRアーキテクチャ向け高位合成手法 (ディペンダブルコンピューティング) -- (デザインガイア2014 : VLSI設計の新しい大地)
萩尾 勇太, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 329 ) 209 - 214 2014年11月
伊東 光希, 川村 一志, 柳澤 政生, 戸川 望, 田宮 豊
研究報告システムとLSIの設計技術(SLDM) 2014 ( 39 ) 1 - 6 2014年11月
不揮発メモリを対象とした最大ハミング距離と最小ハミング距離を制約した符号による書き込み手法のエネルギー評価
古城 辰朗, 多和田 雅師, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 34 ) 1 - 6 2014年11月
HDR-mcvを対象とした複数クロックドメインおよび複数電源電圧による低電力化高位合成手法
阿部 晋矢, 史 又華, 宇佐美 公良, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 40 ) 1 - 6 2014年11月
不揮発メモリの書き込み削減手法のための小面積なエンコーダ/デコーダ回路構成
多和田 雅師, 木村 晋二, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 35 ) 1 - 6 2014年11月
回路面積を考慮したSuspicious Timing Error Prediction 回路の挿入位置決定手法の改良と評価
吉田 慎之介, 史 又華, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 3 ) 1 - 6 2014年11月
ハードウェアトロイに含まれるネットに着目したハードウェアトロイ検出手法
大屋 優, 史 又華, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 24 ) 1 - 6 2014年11月
鈴木 大渡, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
研究報告システムとLSIの設計技術(SLDM) 2014 ( 1 ) 1 - 6 2014年11月
HDRアーキテクチャを対象とした製造ばらつき耐性と低レイテンシを両立可能なマルチシナリオ高位合成手法
井川 昂輝, 阿部 晋矢, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 15 ) 1 - 6 2014年11月
福留 祐治, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
研究報告システムとLSIの設計技術(SLDM) 2014 ( 21 ) 1 - 5 2014年11月
FPGAの配線遅延特性を利用したフロアプラン指向高位合成手法
藤原 晃一, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 14 ) 1 - 6 2014年11月
遅延ばらつき許容量を最適化するRDRアーキテクチャ向け高位合成手法
萩尾 勇太, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 41 ) 1 - 6 2014年11月
タイミングエラー予測回路による再構成可能デバイス上でのデータ依存最適化回路設計
川村 一志, 阿部 晋矢, 史 又華, 柳澤 政生, 戸川 望
研究報告システムとLSIの設計技術(SLDM) 2014 ( 2 ) 1 - 6 2014年11月
迷いにくい可視ランドマークに基づく屋外歩行者ナビゲーションシステム
竹田 健吾, 柳澤 政生, 戸川 望, 新田 知之, 進藤 大介, 田中 清貴
組込みシステムシンポジウム2014論文集 2014 102 - 107 2014年10月
折原 照崇, 柳澤 政生, 戸川 望, 新田 知之, 進藤 大介, 田中 清貴
組込みシステムシンポジウム2014論文集 2014 69 - 74 2014年10月
歩行通路形状を考慮した可視グラフに基づく屋内環境ナビゲーションシステム
町田 理, 柳澤 政生, 戸川 望, 新田 知之, 進藤 大介, 田中 清貴
組込みシステムシンポジウム2014論文集 2014 96 - 101 2014年10月
可変パイプラインのローカルなパルス生成による低消費エネルギー化手法 (VLSI設計技術)
新井 孝将, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 231 ) 7 - 12 2014年10月
可変パイプラインのローカルなパルス生成による低消費エネルギー化手法 (画像工学)
新井 孝将, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 233 ) 7 - 12 2014年10月
可変パイプラインのローカルなパルス生成による低消費エネルギー化手法 (集積回路)
新井 孝将, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 232 ) 7 - 12 2014年10月
可変パイプラインのローカルなパルス生成による低消費エネルギー化手法
新井 孝将, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
研究報告システムとLSIの設計技術(SLDM) 2014 ( 2 ) 1 - 6 2014年09月
A-3-12 フロアプラン統合化アーキテクチャを対象とした低面積指向フォールトセキュア高位合成(A-3.VLSI設計技術,一般セッション)
川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2014 56 - 56 2014年09月
A-3-13 ばらつき耐性を最大化するRDRアーキテクチャ向け高位合成手法(A-3.VLSI設計技術,一般セッション)
萩尾 勇太, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2014 57 - 57 2014年09月
A-17-10 可視グラフに基づく屋内環境ナビゲーションシステムにおける出発地点・目的地点の決定手法(A-17.ITS,一般セッション)
町田 理, 柳澤 政生, 戸川 望, 新田 知之, 進藤 大介, 田中 清貴
電子情報通信学会ソサイエティ大会講演論文集 2014 119 - 119 2014年09月
A-17-11 可視グラフに基づくセンサとBluetooth Beaconを用いたモバイル端末向け屋内現在位置測位(A-17.ITS,一般セッション)
藤田 博, 柳澤 政生, 戸川 望, 新田 知之, 進藤 大介, 田中 清貴
電子情報通信学会ソサイエティ大会講演論文集 2014 120 - 120 2014年09月
A-17-12 特徴点抽出と3次ベジェ曲線によるリンク列曲線化アルゴリズムの検討(A-17.ITS,一般セッション)
折原 照崇, 柳澤 政生, 戸川 望, 新田 知之, 進藤 大介, 田中 清貴
電子情報通信学会ソサイエティ大会講演論文集 2014 121 - 121 2014年09月
ネットワーク型マルチFPGAシステムを対象としたタスク割り当て手法
片野 弘規, 戸川 望, 青木 孝, 関原 悠介, 中西 衛
DAシンポジウム2014論文集 2014 21 - 26 2014年08月
フロアプランを考慮したマルチプレクサ削減FPGA高位合成手法
藤原 晃一, 阿部 晋矢, 川村 一志, 柳澤 政生, 戸川 望
DAシンポジウム2014論文集 2014 109 - 114 2014年08月
セレクタ論理を適用したバイリニア補間演算器を用いた画像拡大縮小回路のFPGA実装と評価
五十嵐 啓太, 柳澤 政生, 戸川 望
DAシンポジウム2014論文集 2014 169 - 174 2014年08月
Suspicious Timing Error Prediction を用いた回路全体の遅延ばらつきに対するロバスト設計
吉田 慎之介, 史 又華, 柳澤 政生, 戸川 望
DAシンポジウム2014論文集 2014 61 - 66 2014年08月
4-to-1セレクタ論理及び2-to-1セレクタ論理を利用したバイリニア補間演算器の設計と評価
塩 雅史, 柳澤 政生, 戸川 望
DAシンポジウム2014論文集 2014 163 - 168 2014年08月
演算チェイニング候補列挙に基づく配線遅延を考慮した高位合成手法
寺田 晃太朗, 柳澤 政生, 戸川 望
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 27 440 - 445 2014年08月
フロアプランを考慮したマルチプレクサ入力数制限FPGA向け高位合成手法 (スマートインフォメディアシステム)
藤原 晃一, 阿部 晋矢, 川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 126 ) 219 - 224 2014年07月
フロアプランを考慮したマルチプレクサ入力数制限FPGA向け高位合成手法 (システム数理と応用)
藤原 晃一, 阿部 晋矢, 川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 125 ) 219 - 224 2014年07月
フロアプランを考慮したマルチプレクサ入力数制限FPGA向け高位合成手法 (回路とシステム)
藤原 晃一, 阿部 晋矢, 川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 122 ) 219 - 224 2014年07月
フロアプランを考慮したマルチプレクサ入力数制限FPGA向け高位合成手法 (VLSI設計技術)
藤原 晃一, 阿部 晋矢, 川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 114 ( 123 ) 219 - 224 2014年07月
スキャンチェイン長に依存しないLED暗号に対するスキャンベース攻撃 (VLSI設計技術)
藤代 美佳, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 454 ) 31 - 36 2014年03月
故障解析に耐性を持つラッチを利用したAES暗号回路 (VLSI設計技術)
史 又華, 谷口 寛彰, 戸川 望, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 454 ) 37 - 42 2014年03月
改良ランダムオーダースキャンによるセキュアスキャン設計とその評価 (VLSI設計技術)
大屋 優, 跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 454 ) 43 - 48 2014年03月
クラスタリングによる高速なリソグラフィ照明形状最適化 (VLSI設計技術)
多和田 雅師, 柳澤 政生, 戸川 望, 橋本 隆希, 坂主 圭史, 野嶋 茂樹, 小谷 敏也
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 454 ) 105 - 110 2014年03月
サブスレッショルド回路における遅延・エネルギーの温度依存性に関する実験および考察 (VLSI設計技術)
櫛田 浩樹, 史 又華, 戸川 望, 宇佐美 公良, 柳澤 政生
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 454 ) 147 - 151 2014年03月
局所性を考慮したマルチFPGAシステム向けタスクマッピング手法 (VLSI設計技術)
片野 弘規, 李 昇周, 戸川 望, 青木 孝, 関原 悠介, 中西 衛
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 416 ) 143 - 148 2014年01月
局所性を考慮したマルチFPGAシステム向けタスクマッピング手法
片野 弘規, 李 昇周, 戸川 望, 青木 孝, 関原 悠介, 中西 衛
研究報告システムLSI設計技術(SLDM) 2014 ( 26 ) 1 - 6 2014年01月
川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 321 ) 129 - 134 2013年11月
チェックポイント観測によるタイミングエラー予測手法 (ディペンダブルコンピューティング デザインガイア2013 : VLSI設計の新しい大地)
五十嵐 博昭, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 321 ) 39 - 44 2013年11月
不揮発メモリを対象とした書き込み削減手法のエネルギー評価 (ディペンダブルコンピューティング デザインガイア2013 : VLSI設計の新しい大地)
多和田 雅師, 木村 晋二, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 321 ) 141 - 146 2013年11月
HDR-mcdを対象としたクロックエネルギー優位な高位合成と実験評価 (ディペンダブルコンピューティング デザインガイア2013 : VLSI設計の新しい大地)
阿部 晋矢, 史 又華, 宇佐美 公良, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 321 ) 263 - 268 2013年11月
HDR-mcdを対象としたクロックエネルギー優位な高位合成と実験評価
阿部 晋矢, 史 又華, 宇佐美 公良, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2013 ( 47 ) 1 - 6 2013年11月
多和田 雅師, 木村 晋二, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2013 ( 26 ) 1 - 6 2013年11月
信頼性と時間オーバーヘッド間のトレードオフを考慮した面積制約にもとづくRDRアーキテクチャ向けフォールトセキュア高位合成手法
川村 一志, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2013 ( 24 ) 1 - 6 2013年11月
五十嵐 博昭, 史 又華, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2013 ( 8 ) 1 - 6 2013年11月
スキャンシグネチャを用いたLED暗号へのスキャンベース攻撃 (画像工学)
藤代 美佳, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 237 ) 47 - 52 2013年10月
スキャンシグネチャを用いたLED暗号へのスキャンベース攻撃 (集積回路)
藤代 美佳, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 236 ) 47 - 52 2013年10月
製造後遅延調整機能を持つRDRアーキテクチャ向け高位合成手法の評価
萩尾 勇太, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2013 ( 9 ) 1 - 6 2013年09月
製造後遅延調整機能を持つRDRアーキテクチャ向け高位合成手法の評価(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
萩尾 勇太, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 113 ( 235 ) 41 - 46 2013年09月
スキャンシグネチャを用いたLED暗号へのスキャンベース攻撃(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
藤代 美佳, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 113 ( 235 ) 47 - 52 2013年09月
セレクタ論理を利用したバイリニア補間演算器設計と評価(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
塩 雅史, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 113 ( 235 ) 53 - 58 2013年09月
A-17-10 滑らかな接続表現のための道路ネットワーク整形手法(A-17.ITS,一般セッション)
折原 照崇, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2013 143 - 143 2013年09月
A-3-6 故障差分解析に耐性を持つデータ修復可能なAES暗号回路(A-3.VLSI設計技術,一般セッション)
谷口 寛彰, 史 又華, 戸川 望, 柳澤 政生
電子情報通信学会ソサイエティ大会講演論文集 2013 49 - 49 2013年09月
A-3-5 トロイパスによるハードウェアトロイ検出の一手法(A-3.VLSI設計技術,一般セッション)
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2013 48 - 48 2013年09月
スキャンシグネチャを利用したブロック暗号に対するスキャンベース攻撃
戸川 望, 小寺 博和
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 26 197 - 202 2013年07月
RDRアーキテクチヤを対象とした時間・面積制約にもとづくフォールドセキュア高位合成手法
川村 一志, 柳澤 政生, 戸川 望
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 26 454 - 459 2013年07月
IL1およびIL2キャッシュに不揮発メモリを利用した二階層キャッシュにおける消費エネルギーの評価 (システム数理と応用)
松野 翔太, 多和田 雅師, 柳澤 政生, 木村 晋二, 戸川 望, 杉林 直彦
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 121 ) 89 - 94 2013年07月
最大ハミング距離を制限した符号とこれを用いた不揮発メモリの書き込み削減手法 (システム数理と応用)
多和田 雅師, 木村 晋二, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 121 ) 95 - 100 2013年07月
IL1およびIL2キャッシュに不揮発メモリを利用した二階層キャッシュにおける消費エネルギーの評価 (回路とシステム)
松野 翔太, 多和田 雅師, 柳澤 政生, 木村 晋二, 戸川 望, 杉林 直彦
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 118 ) 89 - 94 2013年07月
最大ハミング距離を制限した符号とこれを用いた不揮発メモリの書き込み削減手法 (回路とシステム)
多和田 雅師, 木村 晋二, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 118 ) 95 - 100 2013年07月
IL1およびIL2キャッシュに不揮発メモリを利用した二階層キャッシュにおける消費エネルギーの評価 (信号処理)
松野 翔太, 多和田 雅師, 柳澤 政生, 木村 晋二, 戸川 望, 杉林 直彦
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 120 ) 89 - 94 2013年07月
IL1およびIL2キャッシュに不揮発メモリを利用した二階層キャッシュにおける消費エネルギーの評価 (VLSI設計技術)
松野 翔太, 多和田 雅師, 柳澤 政生, 木村 晋二, 戸川 望, 杉林 直彦
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 119 ) 89 - 94 2013年07月
折原照崇, 柳澤政生, 戸川望
マルチメディア、分散協調とモバイルシンポジウム2013論文集 2013 2036 - 2043 2013年07月
町田理, 町田直哉, 柳澤政生, 戸川望
マルチメディア、分散協調とモバイルシンポジウム2013論文集 2013 688 - 701 2013年07月
藤田博, 柳澤政生, 戸川望
マルチメディア、分散協調とモバイルシンポジウム2013論文集 2013 175 - 181 2013年07月
岩田裕樹, 柳澤政生, 戸川望
マルチメディア、分散協調とモバイルシンポジウム2013論文集 2013 702 - 716 2013年07月
セレクタ論理を利用した線形補間演算器設計と評価 (VLSI設計技術)
塩 雅史, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 30 ) 49 - 54 2013年05月
スキャンシグネチャを用いたストリーム暗号Triviumへのスキャンベース攻撃手法 (VLSI設計技術)
藤代 美佳, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 30 ) 61 - 66 2013年05月
RDRアーキテクチャを対象とした時間及び面積オーバーヘッドのないフォールトセキュア高位合成手法 (VLSI設計技術)
川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 113 ( 30 ) 67 - 72 2013年05月
RDRアーキテクチャを対象とした時間及び面積オーバーヘッドのないフォールトセキュア高位合成手法
川村 一志, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2013 ( 12 ) 1 - 6 2013年05月
スキャンシグネチャを用いたストリーム暗号Triviumへのスキャンベース攻撃手法
藤代 美佳, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2013 ( 11 ) 1 - 6 2013年05月
2コアアーキテクチャを対象とするトレースベースキャッシュシミュレーションの精度評価 (ディペンダブルコンピューティング 組込み技術とネットワークに関するワークショップETNET2013)
多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 : 信学技報 112 ( 482 ) 85 - 90 2013年03月
フロアプランを考慮したマルチクロックドメイン指向の低電力化高位合成手法 (コンピュータシステム 組込み技術とネットワークに関するワークショップETNET2013)
阿部 晋矢, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 : 信学技報 112 ( 481 ) 115 - 120 2013年03月
2コアアーキテクチャを対象とするトレースベースキャッシュシミュレーションの精度評価 (コンピュータシステム 組込み技術とネットワークに関するワークショップETNET2013)
多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 : 信学技報 112 ( 481 ) 85 - 90 2013年03月
フロアプランを考慮したマルチクロックドメイン指向の低電力化高位合成手法
阿部晋矢, 史又華, 柳澤政生, 戸川望
研究報告組込みシステム(EMB) 2013 ( 20 ) 1 - 6 2013年03月
2コアアーキテクチャを対象とするトレースベースキャッシュシミュレーションの精度評価
多和田 雅師, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2013 ( 15 ) 1 - 6 2013年03月
2コアアーキテクチャを対象とするトレースベースキャッシュシミュレーションの精度評価
多和田 雅師, 柳澤 政生, 戸川 望
研究報告組込みシステム(EMB) 2013 ( 15 ) 1 - 6 2013年03月
A-17-13 ランドマークを用いた携帯端末向けユニバーサルナビゲーションシステム(A-17.ITS)
石田 健, 柳澤 政生, 戸川 望
電子情報通信学会総合大会講演論文集 2013 244 - 244 2013年03月
A-17-7 携帯端末画面で表示するわかりやすい略地図経路の検討(A-17.ITS)
辻 和貴, 柳澤 政生, 戸川 望
電子情報通信学会総合大会講演論文集 2013 238 - 238 2013年03月
B-6-56 センサネットワーク低消費電力化のためのSMACプロトコルduty cycle最適化手法と実装評価(B-6.ネットワークシステム)
大岸 龍司, 柳澤 政生, 戸川 望
電子情報通信学会総合大会講演論文集 2013 ( 2 ) 56 - 56 2013年03月
SAAV:AVHDRアーキテクチャを対象とした動的複数電源電圧指向の低電力化高位合成手法
阿部 晋矢, 史 又華, 宇佐美 公良, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 24 ) 1 - 6 2012年11月
HDRアーキテクチャを対象とした同時実行指向スケジューリングを用いたクロック設計考慮低電力化高位合成手法
赤坂 宏行, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 23 ) 1 - 6 2012年11月
小寺 博和, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 10 ) 1 - 6 2012年11月
島内消費電力量見積もりにもとづく温度特性を考慮したRDRアーキテクチャ向け高位合成手法
川村 一志, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 3 ) 1 - 6 2012年11月
鍵ベース構成のState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャ
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 9 ) 1 - 6 2012年11月
島内消費電力量見積もりにもとづく温度特性を考慮したRDRアーキテクチャ向け高位合成手法
川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 112 ( 320 ) 13 - 18 2012年11月
鍵ベース構成のState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャ
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 112 ( 320 ) 45 - 50 2012年11月
Camellia暗号回路に対するスキャンベース攻撃手法
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 112 ( 320 ) 51 - 56 2012年11月
HDRアーキテクチャを対象とした同時実行指向スケジューリングを用いたクロック設計考慮低電力化高位合成手法
赤坂 宏行, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 112 ( 320 ) 129 - 134 2012年11月
SAAV:AVHDRアーキテクチャを対象として動的複数電源電圧指向の低電力化高位合成手法
阿部 晋矢, 史 又華, 宇佐美 公良, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 112 ( 320 ) 135 - 140 2012年11月
島内消費電力量見積もりにもとづく温度特性を考慮したRDRアーキテクチャ向け高位合成手法
川村 一志, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 112 ( 321 ) 13 - 18 2012年11月
鍵ベース構成のState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャ
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 112 ( 321 ) 45 - 50 2012年11月
Camellia暗号回路に対するスキャンベース攻撃手法
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 112 ( 321 ) 51 - 56 2012年11月
HDRアーキテクチャを対象とした同時実行指向スケジューリングを用いたクロック設計考慮低電力化高位合成手法
赤坂 宏行, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 112 ( 321 ) 129 - 134 2012年11月
SAAV:AVHDRアーキテクチャを対象として動的複数電源電圧指向の低電力化高位合成手法
阿部 晋矢, 史 又華, 宇佐美 公良, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 112 ( 321 ) 135 - 140 2012年11月
鍵ベース構成のState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装 (集積回路)
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 : 信学技報 112 ( 247 ) 95 - 100 2012年10月
鍵ベース構成の State Dependent Scan Flip-Flop を用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. ICD, 集積回路 112 ( 247 ) 95 - 100 2012年10月
鍵ベース構成の State Dependent Scan Flip-Flop を用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. SIP, 信号処理 : IEICE technical report 112 ( 246 ) 95 - 100 2012年10月
鍵ベース構成の State Dependent Scan Flip-Flop を用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 112 ( 245 ) 95 - 100 2012年10月
鍵ベース構成の State Dependent Scan Flip-Flop を用いたセキュアスキャンアーキテクチャのRSA暗号回路への実装
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. IE, 画像工学 112 ( 248 ) 95 - 100 2012年10月
A-17-7 略地図を用いた迷いにくい歩行者向けナビゲーション(A-17.ITS,一般セッション)
辻 和貴, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2012 166 - 166 2012年08月
A-3-4 クロックの立下りを利用した耐故障攻撃AES暗号回路(A-3.VLSI設計技術,一般セッション)
五十嵐 博昭, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2012 51 - 51 2012年08月
A-3-1 キャッシュ構成の高速シミュレーションを利用したIL1およびUL2キャッシュに不揮発メモリ(A-3.VLSI設計技術,一般セッション)
松野 翔太, 多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2012 48 - 48 2012年08月
A-3-5 Feedback付きState Dependent Scan Flip-Flopを用いたセキュアスキャンアーキテクチャ(A-3.VLSI設計技術,一般セッション)
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2012 52 - 52 2012年08月
高集積かつ高周波な回路に対応した複数電源電圧指向の高位合成手法
阿部 晋矢, 柳澤 政生, 戸川 望
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 25 160 - 165 2012年07月
複数のキャッシュ構成を同時に表現するデータ構造とこれを用いた高速で正確な2コアキャッシュシミュレーション
多和田 雅師, 柳澤 政生, 戸川 望
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 25 414 - 419 2012年07月
State Dependent Scan Flip Flop を用いたRSA暗号回路へのセキュアスキャンンアーキテクチャの実装
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. SIP, 信号処理 : IEICE technical report 112 ( 115 ) 115 - 120 2012年06月
State Dependent Scan Flip Flop を用いたRSA暗号回路へのセキュアスキャンンアーキテクチャの実装
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. MSS, システム数理と応用 : IEICE technical report 112 ( 116 ) 115 - 120 2012年06月
State Dependent Scan Flip Flop を用いたRSA暗号回路へのセキュアスキャンンアーキテクチャの実装
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. CAS, 回路とシステム 112 ( 113 ) 115 - 120 2012年06月
State Dependent Scan Flip Flop を用いたRSA暗号回路へのセキュアスキャンンアーキテクチャの実装
跡部 悠太, 史 又華, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 112 ( 114 ) 115 - 120 2012年06月
HDRアーキテクチャを対象とした高速かつ効率的な複数電源電圧指向の高位合成手法
阿部 晋矢, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 2 ) 1 - 6 2012年05月
HDRアーキテクチャを対象とした高速かつ効率的な複数電源電圧指向の高位合成手法
阿部 晋矢, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 112 ( 71 ) 7 - 12 2012年05月
A-3-7 多数ビデオ入力に対する画像認識ハードウェアの制御方式の提案(A-3.VLSI設計技術,一般セッション)
大塚 卓哉, 細谷 英一, 青木 孝, 小野澤 晃, 李 昇周, 戸川 望
電子情報通信学会総合大会講演論文集 2012 91 - 91 2012年03月
2コアプロセッサL1キャッシュ構成の正確で高速なシミュレーション手法
多和田 雅師, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 3 ) 1 - 6 2012年02月
RDRアーキテクチャを対象とした部分2重化フォールトセキュア高位合成手法
田中 翔, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 4 ) 1 - 6 2012年02月
セレクタ論理を利用した高速補間演算器設計
岩田 愛実, 吉原 弘峰, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2012 ( 7 ) 1 - 6 2012年02月
2コアプロセッサL1キャッシュ構成の正確で高速なシミュレーション手法
多和田 雅師, 柳澤 政生, 戸川 望
研究報告組込みシステム(EMB) 2012 ( 3 ) 1 - 6 2012年02月
RDRアーキテクチャを対象とした部分2重化フォールトセキュア高位合成手法
田中 翔, 柳澤 政生, 戸川 望
研究報告組込みシステム(EMB) 2012 ( 4 ) 1 - 6 2012年02月
2コアプロセッサL1キャッシュ構成の正確で高速なシミュレーション手法
多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 111 ( 462 ) 13 - 18 2012年02月
RDRアーキテクチャを対象とした部分2重化フォールドセキュア高位合成手法
田中 翔, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 111 ( 462 ) 19 - 24 2012年02月
セレクタ論理を利用した高速補間演算器設計
岩田 愛実, 吉原 弘峰, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 111 ( 462 ) 37 - 42 2012年02月
2コアプロセッサL1キャッシュ構成の正確で高速なシミュレーション手法
多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 111 ( 461 ) 13 - 18 2012年02月
RDRアーキテクチャを対象とした部分2重化フォールドセキュア高位合成手法
田中 翔, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 111 ( 461 ) 19 - 24 2012年02月
セレクタ論理を利用した高速補間演算器設計
岩田 愛実, 吉原 弘峰, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 111 ( 461 ) 37 - 42 2012年02月
キャッシュ構成の高速シミュレーションを利用した不揮発メモリによる二階層キャッシュ構成の評価
松野翔太, 多和田雅師, 柳澤政生, 戸川望
情報処理学会シンポジウム論文集 2012 ( 5 ) 2012年
スキャンシグネチャを用いたTriple DESに対するスキャンベース攻撃手法 (VLSI設計技術)
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 : 信学技報 111 ( 324 ) 7 - 12 2011年11月
スキャンシグネチャを用いたTriple DESに対するスキャンベース攻撃手法 (ディペンダブルコンピューティング)
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告 : 信学技報 111 ( 325 ) 7 - 12 2011年11月
スキャンシグネチャを用いた Triple DES に対するスキャンベース攻撃手法
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 111 ( 325 ) 7 - 12 2011年11月
スキャンシグネチャを用いた Triple DES に対するスキャンベース攻撃手法
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 111 ( 324 ) 7 - 12 2011年11月
スキャンシグネチャを用いたTriple DESに対するスキャンベース攻撃手法
小寺 博和, 柳澤 政生, 戸川 望
研究報告システムLSI設計技術(SLDM) 2011 ( 2 ) 1 - 6 2011年11月
スキャンチェイン構造に依存しないDESに対するスキャンベース攻撃手法
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. SIP, 信号処理 : IEICE technical report 111 ( 257 ) 61 - 66 2011年10月
HDRアーキテクチャを対象とした複数電源電圧指向の低電力化高位合成手法
阿部 晋矢, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. SIP, 信号処理 : IEICE technical report 111 ( 257 ) 95 - 100 2011年10月
スキャンチェイン構造に依存しないDESに対するスキャンベース攻撃手法
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. IE, 画像工学 111 ( 259 ) 61 - 66 2011年10月
HDRアーキテクチャを対象とした複数電源電圧指向の低電力化高位合成手法
阿部 晋矢, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. IE, 画像工学 111 ( 259 ) 95 - 100 2011年10月
スキャンチェイン構造に依存しないDESに対するスキャンベース攻撃手法
小寺 博和, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. ICD, 集積回路 111 ( 258 ) 61 - 66 2011年10月
HDRアーキテクチャを対象とした複数電源電圧指向の低電力化高位合成手法
阿部 晋矢, 柳澤 政生, 戸川 望
電子情報通信学会技術研究報告. ICD, 集積回路 111 ( 258 ) 95 - 100 2011年10月
A-3-1 動きベクトルを考慮した遅延オーバーヘッドのないハードウェア向き適応的並列補間手法(A-3.VLSI設計技術,一般セッション)
栗岡 大生, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2011 75 - 75 2011年08月
A-3-3 セレクタ論理帰着型重み付き加算器を用いた超解像処理と比較実験(A-3.VLSI設計技術,一般セッション)
吉原 弘峰, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2011 77 - 77 2011年08月
A-3-11 2コアプロセッサアーキテクチャを対象とする正確なキャッシュ構成シミュレーションの高速化に対する一考察(A-3.VLSI設計技術,一般セッション)
多和田 雅師, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2011 85 - 85 2011年08月
A-3-13 共有バス方式とバスマトリクス方式を用いたネットワークプロセッサのバス競合の性能比較評価(A-3.VLSI設計技術,一般セッション)
出口 健介, 柳澤 政生, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2011 87 - 87 2011年08月
超解像技術におけるセレクタ論理帰着型重み付き加算による再構築処理ハードウェア設計 (システム設計)
吉原 弘峰, 柳澤 政生, 戸川 望
回路とシステムワークショップ論文集 Workshop on Circuits and Systems 24 ( 266 ) 431 - 436 2011年08月
杉岡基行, 柳澤政生, 戸川望
マルチメディア、分散協調とモバイルシンポジウム2011論文集 2011 1065 - 1079 2011年06月
吉原 弘峰, 柳澤 政生, 大附 辰夫, 戸川 望
研究報告システムLSI設計技術(SLDM) 2011 ( 6 ) 1 - 6 2011年05月
セレクタ論理帰着型重み付き加算器を用いた超解像処理
吉原 弘峰, 柳澤 政生, 大附 辰夫, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 111 ( 40 ) 27 - 32 2011年05月
NARA RYUTA, TOGAWA NOZOMU, YANAGISAWA MASAO
情報処理学会論文誌 論文誌トランザクション 2010 ( 2 ) 47 - 59 2011年04月
DS-2-4 エッジ情報を用いたAngularイントラ予測モード高速決定手法(DS-2.HEVCの標準化に向けた新規映像符号化技術,シンポジウムセッション)
徳満 健太, 蝶野 慶一, 矢崎 健太, 仙田 裕三, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会総合大会講演論文集 2011 ( 2 ) "S - 7" 2011年02月
柔軟な置換ポリシをもつ2階層キャッシュの正確で高速なシミュレーション手法
多和田 雅師, 柳澤 政生, 大附 辰夫, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 110 ( 432 ) 13 - 18 2011年02月
スクラッチパッドメモリとコード配置最適化による低消費エネルギーASIP合成手法
嶋田 吉倫, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 110 ( 432 ) 25 - 30 2011年02月
FIFOをキャッシュ置換ポリシとする正確なキャッシュ構成シミュレーションの高速化
多和田 雅師, 柳澤 政生, 大附 辰夫, 戸川 望
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 110 ( 317 ) 55 - 60 2010年11月
FIFOをキャッシュ置換ポリシとする正確なキャッシュ構成シミュレーションの高速化
多和田 雅師, 柳澤 政生, 大附 辰夫, 戸川 望
電子情報通信学会技術研究報告. VLD, VLSI設計技術 110 ( 316 ) 55 - 60 2010年11月
A-3-6 RSA暗号に対するスキャンベース攻撃の評価実験(A-3.VLSI設計技術,一般セッション)
奈良 竜太, 柳澤 政生, 大附 辰夫, 戸川 望
電子情報通信学会ソサイエティ大会講演論文集 2010 68 - 68 2010年08月
未来を切り拓く最先端 VLSI テクノロジー : 1.メディア処理における超低消費電力SoC技術
後藤 敏, 池永 剛, 吉村 猛, 木村 晋二, 戸川 望
情報処理 51 ( 7 ) 837 - 845 2010年07月
一般化レジスタ分散アーキテクチャを対象とした高位合成手法とその評価
大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 110 ( 36 ) 19 - 24 2010年05月
道路標識とランドマークを用いた歩行者位置特定システムと実地調査による評価
児島 伴幸, 山根 和也, 柳澤 政生, 大附 辰夫, 戸川 望
情報処理学会論文誌 51 ( 3 ) 899 - 913 2010年03月
常時着用型センサ"ビジネス顕微鏡"による組織変革
荒 宏視, 佐藤 信夫, 矢野 和男, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 109 ( 462 ) 43 - 47 2010年03月
歩行者の現在地認識に基づく道路標識とランドマークを用いた位置特定システムの改良とシミュレーション評価
児島 伴幸, 柳澤 政生, 大附 辰夫, 戸川 望
電子情報通信学会技術研究報告. ITS 109 ( 414 ) 153 - 158 2010年02月
アドホックネットワークにおけるクラスタの接続性とクラスタヘッドの負荷分散を考慮したルーティング (アドホックネットワーク)
板橋 裕介, 戸川 望, 柳澤 政生
電子情報通信学会技術研究報告 109 ( 381 ) 85 - 90 2010年01月
複数のグループを持つ無線アドホックネットワークにおける衝突回避型マルチキャストプロトコル (アドホックネットワーク)
竹内 博是, 戸川 望, 柳澤 政生
電子情報通信学会技術研究報告 109 ( 381 ) 95 - 100 2010年01月
部分マッチングを考慮しMISO構造に対応した専用演算器合成手法
橋本 識弘, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 109 ( 395 ) 89 - 94 2010年01月
部分マッチングを考慮しMISO構造に対応した専用演算器合成手法
橋本 識弘, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 109 ( 394 ) 89 - 94 2010年01月
部分マッチングを考慮しMISO構造に対応した専用演算器合成手法
橋本 識弘, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 109 ( 393 ) 89 - 94 2010年01月
組み込みアプリケーションを対象とした2階層ユニファイドキャッシュのシミュレーション手法
小林 優太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 109 ( 316 ) 37 - 42 2009年11月
2階層キャッシュメモリにおけるシミュレーションベースのバス幅最適化手法
渡辺 信太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 109 ( 316 ) 43 - 48 2009年11月
組み込みアプリケーションを対象とした2階層ユニファイドキャッシュのシミュレーション手法
小林 優太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 109 ( 315 ) 37 - 42 2009年11月
2階層キャッシュメモリにおけるシミュレーションベースのバス幅最適化手法
渡辺 信太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 109 ( 315 ) 43 - 48 2009年11月
セレクタ論理を用いた高速な差積演算器の設計とバタフライ演算への応用 (画像工学)
塚本 洋平, 戸川 望, 柳澤 政生
電子情報通信学会技術研究報告 109 ( 227 ) 101 - 106 2009年10月
セレクタ論理を用いた高速な差積演算器の設計とバタフライ演算への応用
塚本 洋平, 戸川 望, 柳澤 政生, 大附 辰夫, 外村 元伸
研究報告システムLSI設計技術(SLDM) 2009 ( 18 ) 1 - 6 2009年10月
セレクタ論理を用いた高速な差積演算器の設計とバタフライ演算への応用
塚本 洋平, 戸川 望, 柳澤 政生, 大附 辰夫, 外村 元伸
電子情報通信学会技術研究報告. SIP, 信号処理 : IEICE technical report 109 ( 226 ) 101 - 106 2009年10月
IEEE802.11nに対応した高効率列処理演算器による高スループットイレギュラーLDPC復号器の実装と評価
長島 諒侑, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 109 ( 201 ) 51 - 56 2009年09月
ディジタルメディア向け動的再構成型プロセッサFE-GAへのDFGマッピングとその自動化手法
田村 亮, 戸川 望, 柳澤 政生, 大附 辰夫, 佐藤 真琴
電子情報通信学会技術研究報告. VLD, VLSI設計技術 109 ( 201 ) 57 - 62 2009年09月
ビットレベル処理を考慮したセレクタ帰着型重み付き加算器
原 智昭, 戸川 望, 柳澤 政生, 大附 辰夫, 外村 元伸
電子情報通信学会技術研究報告. VLD, VLSI設計技術 109 ( 34 ) 7 - 12 2009年05月
Odd-Even Turn Model を対象としたNoCの負荷分散による遅延時間削減手法
脇田 慎吾, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 478 ) 153 - 158 2009年03月
連携処理を考慮したネットワークプロセッサへの処理割り当て手法
齊藤 啓太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 478 ) 147 - 152 2009年03月
命令メモリアクセス数削減に基づく低エネルギーASIP合成手法
小林 優太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 108 ( 413 ) 147 - 152 2009年01月
組み込みシステム向けMPSoCのためのマルチレイヤ構造をとるバスアーキテクチャ最適化手法
吉田 陽信, 戸川 望, 柳澤 政生, 大附 辰夫, 橘 昌良
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 108 ( 413 ) 141 - 146 2009年01月
アプリケーションプロセッサのための高速かつ最適なパイプライン構成を持つSIMD演算ユニット合成手法
渡辺 隆行, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 108 ( 413 ) 99 - 104 2009年01月
フロアプランを考慮した高位合成のための高速なモジュール配置手法
佐藤 亘, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 108 ( 413 ) 93 - 98 2009年01月
命令メモリアクセス数削減に基づく低エネルギーASIP合成手法
小林 優太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 108 ( 414 ) 147 - 152 2009年01月
組み込みシステム向けMPSoCのためのマルチレイヤ構造をとるバスアーキテクチャ最適化手法
吉田 陽信, 戸川 望, 柳澤 政生, 大附 辰夫, 橘 昌良
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 108 ( 414 ) 141 - 146 2009年01月
アプリケーションプロセッサのための高速かつ最適なパイプライン構成を持つSIMD演算ユニット合成手法
渡辺 隆行, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 108 ( 414 ) 99 - 104 2009年01月
フロアプランを考慮した高位合成のための高速なモジュール配置手法
佐藤 亘, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 108 ( 414 ) 93 - 98 2009年01月
アプリケーションプロセッサのための高速かつ最適なパイプライン構成を持つ SIMD 演算ユニット合成手法
渡辺 隆行, 戸川 望, 柳澤 政生, 大附 辰夫
研究報告システムLSI設計技術(SLDM) 2009 ( 7 ) 99 - 104 2009年01月
フロアプランを考慮した高位合成のための高速なモジュール配置手法
佐藤 亘, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
研究報告システムLSI設計技術(SLDM) 2009 ( 7 ) 93 - 98 2009年01月
命令メモリアクセス数削減に基づく低エネルギー ASIP 合成手法
小林 優太, 戸川 望, 柳澤 政生, 大附 辰夫
研究報告システムLSI設計技術(SLDM) 2009 ( 7 ) 147 - 152 2009年01月
組み込みシステム向け MPSoC のためのマルチレイヤ構造をとるバスアーキテクチャ最適化手法
吉田 陽信, 戸川 望, 柳澤 政生, 大附 辰夫, 橘 昌良
研究報告システムLSI設計技術(SLDM) 2009 ( 7 ) 141 - 146 2009年01月
命令メモリアクセス数削減に基づく低エネルギーASIP合成手法
小林 優太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 412 ) 147 - 152 2009年01月
組み込みシステム向けMPSoCのためのマルチレイヤ構造をとるバスアーキテクチャ最適化手法
吉田 陽信, 戸川 望, 柳澤 政生, 大附 辰夫, 橘 昌良
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 412 ) 141 - 146 2009年01月
アプリケーションプロセッサのための高速かつ最適なパイプライン構成を持つSIMD演算ユニット合成手法
渡辺 隆行, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 412 ) 99 - 104 2009年01月
フロアプランを考慮した高位合成のための高速なモジュール配置手法
佐藤 亘, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 412 ) 93 - 98 2009年01月
ルータの負荷分散と制御パケット数削減を目的としたエニーキャスト経路選択手法
横田 雅之, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. NS, ネットワークシステム 108 ( 359 ) 13 - 18 2008年12月
高速移動体のためのNEMOを用いた高速ハンドオフ手法
田中 敦樹, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. NS, ネットワークシステム 108 ( 359 ) 89 - 94 2008年12月
レジスタ分散型アーキテクチャを対象としたフロアプラン指向高位合成のためのマルチプレクサ削減手法
遠藤 哲弥, 大智輝, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 111 ) 145 - 150 2008年11月
組み込みシステムの2階層キャッシュとスクラッチパッドメモリのシミュレーション手法
東條 信明, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 111 ) 97 - 102 2008年11月
クロスバスイッチを用いたS-Box切替によるAES暗号処理回路のパワーマスキング手法
川畑 伸幸, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 111 ) 61 - 66 2008年11月
暗号回路における動的に構造変化するセキュアスキャンアーキテクチャ
跡部 浩士, 奈良 竜太, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 111 ) 55 - 59 2008年11月
周辺回路を含むAES-LSIヘのスキャンベース攻撃
奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 111 ) 49 - 53 2008年11月
歩行者向けデフォルメ地図生成のための並列処理ハードウェアエンジンの設計
荒幡 明, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 111 ) 43 - 48 2008年11月
高効率列処理演算器によるマルチレート対応高スループットイレギュラーLDPC復号器の実装と評価
長島 諒侑, 今井 優太, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 111 ) 37 - 42 2008年11月
レジスタ分散型アーキテクチャを対象としたフロアプラン指向高位合成のためのマルチプレクサ削減手法
遠藤 哲弥, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 298 ) 145 - 150 2008年11月
組み込みシステムの2階層キャッシュとスクラッチパッドメモリのシミュレーション手法
東條 信明, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 298 ) 97 - 102 2008年11月
クロスバスイッチを用いた S-Box 切替によるAES暗号処理回路のパワーマスキング手法
川畑 伸幸, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 298 ) 61 - 66 2008年11月
暗号回路における動的に構造変化するセキュアスキャンアーキテクチャ
跡部 浩士, 奈良 竜太, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 298 ) 55 - 59 2008年11月
周辺回路を含むAES-LSIへのスキャンベース攻撃
奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 298 ) 49 - 53 2008年11月
歩行者向けデフォルメ地図生成のための並列処理ハードウェアエンジンの設計
荒幡 明, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 298 ) 43 - 48 2008年11月
高効率列処理演算器によるマルチレート対応高スループットイレギュラーLDPC復号器の実装と評価
長島 諒侑, 今井 優太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 298 ) 37 - 42 2008年11月
レジスタ分散型アーキテクチャを対象としたフロアプラン指向高位合成のためのマルチプレクサ削減手法
遠藤 哲弥, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 108 ( 299 ) 145 - 150 2008年11月
組み込みシステムの2階層キャッシュとスクラッチパッドメモリのシミュレーション手法
東條 信明, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 108 ( 299 ) 97 - 102 2008年11月
クロスバスイッチを用いた S-Box 切替によるAES暗号処理回路のパワーマスキング手法
川畑 伸幸, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 108 ( 299 ) 61 - 66 2008年11月
暗号回路における動的に構造変化するセキュアスキャンアーキテクチャ
跡部 浩士, 奈良 竜太, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 108 ( 299 ) 55 - 59 2008年11月
周辺回路を含むAES-LSIへのスキャンベース攻撃
奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 108 ( 299 ) 49 - 53 2008年11月
歩行者向けデフォルメ地図生成のための並列処理ハードウェアエンジンの設計
荒幡 明, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 108 ( 299 ) 43 - 48 2008年11月
高効率列処理演算器によるマルチレート対応高スループットイレギュラーLDPC復号器の実装と評価
長島 諒侑, 今井 優太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング : IEICE technical report 108 ( 299 ) 37 - 42 2008年11月
OHCHI AKIRA, KOHARA SHUNITSU, TOGAWA NOZOMU
情報処理学会論文誌 論文誌トランザクション 2008 ( 1 ) 78 - 90 2008年11月
MANETにおけるGPSの位置情報を用いたハイブリッド型ルーティングプロトコル (アドホックネットワーク)
三浦 俊祐, 戸川 望, 柳澤 政生
電子情報通信学会技術研究報告 108 ( 251 ) 17 - 22 2008年10月
SIMD型プロセッサコアの面積/遅延見積り
山崎 大輔, 小原俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会論文誌 49 ( 10 ) 3462 - 3481 2008年10月
再構成型プロセッサFE-GAへのデータフローグラフマッピング手法
本間 雅行, 田村 亮, 戸川 望, 柳澤 政生, 大附 辰夫, 佐藤 真琴
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 224 ) 7 - 12 2008年09月
ディジタルメディア向け動的再構成型プロセッサFE-GAへのFFTマッピングとその自動化手法
田村 亮, 本間 雅行, 戸川 望, 柳澤 政生, 大附 辰夫, 佐藤 真琴
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 224 ) 13 - 18 2008年09月
ビットレベル式変形によるセレクタ帰着型バタフライ演算器の設計と評価
名村 健, 戸川 望, 柳澤 政生, 大附 辰夫, 外村 元伸
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 224 ) 31 - 36 2008年09月
認知科学を応用した微小画面向け略地図生成手法とその統計的評価
二宮 直也, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会論文誌. A, 基礎・境界 = The transactions of the Institute of Electronics, Information and Communication Engineers. A 91 ( 9 ) 869 - 882 2008年09月
道路ネットワーク分割に基づく高速エリア略地図生成手法
松本 和也, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 108 ( 171 ) 25 - 30 2008年07月
屋内環境におけるユーザの経路嗜好調査とこれに基づく経路探索手法
山岸 敬弘, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 108 ( 171 ) 31 - 36 2008年07月
歩行者ナビゲーションにおける道路標識を用いた位置特定システムのための撮影状況に依存した認識度調査
児島 伴幸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 108 ( 171 ) 37 - 42 2008年07月
セレクタ論理を用いたバタフライ演算器の設計
名村 健, 戸川 望, 柳澤 政生, 大附 辰夫, 外村 元伸
電子情報通信学会技術研究報告. VLD, VLSI設計技術 108 ( 22 ) 25 - 30 2008年05月
セレクタ論理を用いたバタフライ演算器の設計
名村 健, 戸川 望, 柳澤 政生, 大附 辰夫, 外村 元伸
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 38 ) 25 - 30 2008年05月
アプリケーションプロセッサのL1キャッシュ最適化手法 (第21回 回路とシステム軽井沢ワークショップ論文集) -- (メモリ最適化)
東條 信明, 戸川 望, 柳澤 政生
回路とシステム軽井沢ワークショップ論文集 21 243 - 248 2008年04月
エニーキャストにおけるルータの負荷に基づく経路選択手法
横田 雅之, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. NS, ネットワークシステム 107 ( 443 ) 13 - 18 2008年04月
MAPドメイン間移動のためのハンドオフ時間とパケットロスの削減手法
田中 敦樹, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. NS, ネットワークシステム 107 ( 443 ) 41 - 46 2008年04月
LAMR : アドホックネットワークにおける負荷分散を考慮したマルチパスルーティング
清水 悠司, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. NS, ネットワークシステム 107 ( 443 ) 51 - 56 2008年04月
応用指向型動的再構成可能ネットワークプロセッサアーキテクチャとその最適化手法
大田 元則, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ICD, 集積回路 107 ( 511 ) 47 - 52 2008年03月
応用指向型動的再構成可能ネットワークプロセッサアーキテクチャとその最適化手法 (VLSI設計技術)
大田 元則, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告 107 ( 508 ) 47 - 52 2008年03月
命令メモリビット幅削減に基づく低エネルギーASIP合成手法
小原 俊逸, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ICD, 集積回路 107 ( 509 ) 25 - 30 2008年03月
命令メモリビット幅削減に基づく低エネルギーASIP合成手法 (VLSI設計技術)
小原 俊逸, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告 107 ( 506 ) 25 - 30 2008年03月
レジスタ分散型アーキテクチャを対象とした高位合成のためのマルチプレクサ削減手法
遠藤 哲弥, 大智輝, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 2 ) 85 - 90 2008年01月
アプリケーションプロセッサのL1データキャッシュ最適化手法
東條 信明, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 2 ) 155 - 160 2008年01月
アプリケーションプロセッサのカーネル記述自動生成手法
日浦 敏宏, 小原俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2008 ( 2 ) 161 - 166 2008年01月
レジスタ分散型アーキテクチャを対象とした高位合成のためのマルチプレクサ削減手法
遠藤 哲弥, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 107 ( 419 ) 7 - 12 2008年01月
アプリケーションプロセッサのL1データキャッシュ最適化手法
東條 信明, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 107 ( 419 ) 77 - 82 2008年01月
アプリケーションプロセッサのカーネル記述自動生成手法
日浦 敏宏, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 107 ( 419 ) 83 - 88 2008年01月
レジスタ分散型アーキテクチャを対象とした高位合成のためのマルチプレクサ削減手法
遠藤 哲弥, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 107 ( 417 ) 7 - 12 2008年01月
アプリケーションプロセッサのL1データキャッシュ最適化手法
東條 信明, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 107 ( 417 ) 77 - 82 2008年01月
アプリケーションプロセッサのカーネル記述自動生成手法
日浦 敏宏, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 107 ( 417 ) 83 - 88 2008年01月
レジスタ分散型アーキテクチャを対象とした高位合成のためのマルチプレクサ削減手法
遠藤 哲弥, 大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 107 ( 415 ) 7 - 12 2008年01月
アプリケーションプロセッサのL1データキャッシュ最適化手法
東條 信明, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 107 ( 415 ) 77 - 82 2008年01月
アプリケーションプロセッサのカーネル記述自動生成手法
日浦 敏宏, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 107 ( 415 ) 83 - 88 2008年01月
歩行者向けデフォルメ地図生成ハードウェアエンジンの設計
荒幡 明, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2007 ( 114 ) 175 - 180 2007年11月
AESにおける合成体SubBytes向けパワーマスキング乗算回路の設計
川畑 伸幸, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2007 ( 114 ) 109 - 114 2007年11月
歩行者向けデフォルメ地図生成ハードウェアエンジンの設計
荒幡 明, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 107 ( 336 ) 61 - 66 2007年11月
歩行者向けデフォルメ地図生成ハードウェアエンジンの設計
荒幡 明, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング 107 ( 339 ) 61 - 66 2007年11月
列処理演算法に着目したマルチレート対応イレギュラーLDPC符号復号器
今井 優太, 清水 一範, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. RECONF, リコンフィギャラブルシステム : IEICE technical report 107 ( 342 ) 19 - 24 2007年11月
AESにおける合成体 SubBytes 向けパワーマスキング乗算回路の設計
川畑 伸幸, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 107 ( 335 ) 37 - 42 2007年11月
AESにおける合成体 SubBytes 向けパワーマスキング乗算回路の設計
川畑 伸幸, 奈良 竜太, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. DC, ディペンダブルコンピューティング 107 ( 338 ) 37 - 42 2007年11月
移動体を対象としたアプリケーションとデータサイズによる階層 Network Mobilityの負荷分散方式
月木 英治, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告高度交通システム(ITS) 2007 ( 90 ) 65 - 70 2007年09月
歩行者ナビゲーションにおけるGPS誤差補正のための道路標識による現在位置測位手法
本多 聖人, 戸川 望, 柳澤 政生, 大附辰夫
情報処理学会研究報告高度交通システム(ITS) 2007 ( 90 ) 71 - 76 2007年09月
歩行者ナビゲーションにおける携帯電話カメラ機能とランドマークを利用した位置補正手法
本多 聖人, 戸川 望, 柳澤 政生, 大附辰夫
情報処理学会研究報告高度交通システム(ITS) 2007 ( 90 ) 77 - 82 2007年09月
進路方向によって異なる混雑度を考慮した旅行時間算出手法
大高 宏介, 戸川 望, 柳澤 政生, 大附 辰夫
電気学会研究会資料. ITS, ITS研究会 2007 ( 15 ) 15 - 20 2007年09月
移動体を対象としたアプリケーションとデータサイズによる階層型 Network Mobility の負荷分散方式
月木 英治, 戸川 望, 柳澤 政生, 大附 辰夫
電気学会研究会資料. ITS, ITS研究会 2007 ( 15 ) 65 - 70 2007年09月
歩行者ナビゲーションにおけるGPS誤差補正のための道路標識による現在位置測位手法
大平 英貴, 戸川 望, 柳澤 政生, 大附 辰夫
電気学会研究会資料. ITS, ITS研究会 2007 ( 15 ) 71 - 76 2007年09月
歩行者ナビゲーションにおける携帯電話カメラ機能とランドマークを利用した位置補正手法
本多 聖人, 戸川 望, 柳澤 政生, 大附 辰夫
電気学会研究会資料. ITS, ITS研究会 2007 ( 15 ) 77 - 82 2007年09月
進路方向によって異なる混雑度を考慮した旅行時間算出手法
大高宏介, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告高度交通システム(ITS) 2007 ( 90 ) 15 - 20 2007年09月
移動体を対象としたアプリケーションとデータサイズによる階層型 Network Mobility の負荷分散方式
月木 英治, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 107 ( 216 ) 21 - 26 2007年09月
歩行者ナビゲーションにおけるGPS誤差補正のための道路標識による現在位置測位手法
大平 英貴, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 107 ( 216 ) 27 - 32 2007年09月
歩行者ナビゲーションにおける携帯電話カメラ機能とランドマークを利用した位置補正手法
本多 聖人, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 107 ( 216 ) 33 - 38 2007年09月
進路方向によって異なる混雑度を考慮した旅行時間算出手法
大高 宏介, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 107 ( 215 ) 15 - 20 2007年09月
GF(2^n)及びGF(P)におけるスケーラブル双基数ユニファイド型モンゴメリ乗算器
谷村 和幸, 奈良 竜太, 小原 俊逸, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CAS, 回路とシステム 107 ( 101 ) 43 - 48 2007年06月
再構成型プロセッサFE-GAへのフィルタマッピングとその自動化手法
本間 雅行, 戸川 望, 柳澤 政生, 大附 辰夫, 佐藤 真琴
電子情報通信学会技術研究報告. CAS, 回路とシステム 107 ( 100 ) 67 - 72 2007年06月
GF(2^n)及びGF(P)におけるスケーラブル双基数ユニファイド型モンゴメリ乗算器
谷村 和幸, 奈良 竜太, 小原 俊逸, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. SIP, 信号処理 107 ( 105 ) 43 - 48 2007年06月
GF(2^n)及びGF(P)におけるスケーラブル双基数ユニファイド型モンゴメリ乗算器
谷村 和幸, 奈良 竜太, 小原 俊逸, 史 又華, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 107 ( 103 ) 43 - 48 2007年06月
再構成型プロセッサFE-GAへのフィルタマッピングとその自動化手法
本間 雅行, 戸川 望, 柳澤 政生, 大附 辰夫, 佐藤 真琴
電子情報通信学会技術研究報告. SIP, 信号処理 107 ( 104 ) 67 - 72 2007年06月
再構成型プロセッサFE-GAへのフィルタマッピングとその自動化手法
本間 雅行, 戸川 望, 柳澤 政生, 大附 辰夫, 佐藤 真琴
電子情報通信学会技術研究報告. VLD, VLSI設計技術 107 ( 102 ) 67 - 72 2007年06月
楕円曲線暗号に適したGF(2m)上のSIMD型MSD乗算器の設計
奈良 竜太, 清水 一範, 小原俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2007 ( 39 ) 57 - 61 2007年05月
楕円曲線暗号に適したGF(2^m)上のSIMD型MSD乗算器の設計
奈良 竜太, 清水 一範, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 107 ( 32 ) 25 - 29 2007年05月
高効率Message-Passingスケジュールを用いたLDPC復号器の低消費電力化 (第20回 回路とシステム軽井沢ワークショップ論文集) -- (アーキテクチャ設計と低電力化)
清水 一範, 戸川 望, 池永 剛
回路とシステム軽井沢ワークショップ論文集 20 331 - 336 2007年04月
モバイルユーザの目的地への方向性を考慮した楕円領域検索手法
山本 隆之, 戸川 望, 柳澤 政生, 大附 辰夫
電気学会研究会資料. ITS, ITS研究会 2007 ( 1 ) 25 - 30 2007年03月
モバイルユーザの目的地への方向性を考慮した楕円領域検索手法
山本 隆之, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 106 ( 616 ) 25 - 30 2007年03月
無線センサネットワークにおけるエネルギー消費削減のためのクラスタリング手法
廣瀬 文昭, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. NS, ネットワークシステム 106 ( 577 ) 41 - 46 2007年03月
エニーキャストにおけるサーバ処理時間を考慮した経路選択手法
楊 夏, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. NS, ネットワークシステム 106 ( 577 ) 381 - 386 2007年03月
歩行者ナビゲーションにおける微小画面での視認性とユーザの迷いにくさを考慮した略地図生成方法
二宮 直也, 戸川 望, 柳沢 政生, 大附 辰夫
情報処理学会研究報告高度交通システム(ITS) 2006 ( 103 ) 111 - 116 2006年09月
車車間・路車間通を用いた車線別の渋滞情報の検出手法
大高 宏介, 戸川 望, 柳澤 政生, 大附 辰夫
電気学会研究会資料. ITS, ITS研究会 2006 ( 20 ) 19 - 24 2006年09月
車車間・路車間通を用いた車線別の渋滞情報の検出手法
大高宏介, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告高度交通システム(ITS) 2006 ( 103 ) 19 - 24 2006年09月
車車間・路車間通を用いた車線別の渋滞情報の検出手法
大高 宏介, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 106 ( 265 ) 19 - 24 2006年09月
H.264/AVC符号化向けDSPにおける動き予測演算器の設計
高橋 豊和, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 106 ( 114 ) 13 - 18 2006年06月
H.264/AVC符号化向けDSPにおける動き予測演算器の設計
高橋 豊和, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. SIP, 信号処理 106 ( 116 ) 13 - 18 2006年06月
H.264/AVC符号化向けDSPにおける動き予測演算器の設計
高橋 豊和, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CAS, 回路とシステム 106 ( 112 ) 13 - 18 2006年06月
HW/SW協調合成におけるアプリケーションプロセッサの面積/遅延見積もり手法
山崎 大輔, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 106 ( 113 ) 1 - 6 2006年06月
HW/SW協調合成におけるアプリケーションプロセッサの面積/遅延見積もり手法
山崎 大輔, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. SIP, 信号処理 106 ( 115 ) 1 - 6 2006年06月
HW/SW協調合成におけるアプリケーションプロセッサの面積/遅延見積もり手法
山崎 大輔, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CAS, 回路とシステム 106 ( 111 ) 1 - 6 2006年06月
設計事例 FIFOバッファによる高効率Message-Passingスケジュールを用いたLDPC復号器
清水 一範, 石川 達之, 戸川 望
回路とシステム軽井沢ワークショップ論文集 19 211 - 216 2006年04月
アプリケーションプロセッサのデータキャッシュ構成最適化手法 (リコンフィギャラブルとキャッシュ最適化)
堀内 一央, 小原 俊逸, 戸川 望
回路とシステム軽井沢ワークショップ論文集 19 583 - 588 2006年04月
歩行者ナビゲーションシステムにおける携帯電話カメラ機能を利用した位置補正手法
中口 智史, 戸川 望, 柳澤 政生, 大附 辰夫
電気学会研究会資料. ITS, ITS研究会 2006 ( 1 ) 25 - 30 2006年03月
歩行者ナビゲーションシステムにおける携帯電話カメラ機能を利用した位置補正手法
中口 智史, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ITS 105 ( 688 ) 25 - 30 2006年03月
動的フローに適応したネットワークプロセッサの改良とその評価
田淵 英孝, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 105 ( 644 ) 25 - 30 2006年03月
動的フローに適応したネットワークプロセッサの改良とその評価
田淵 英孝, 小原 俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ICD, 集積回路 105 ( 646 ) 25 - 30 2006年03月
レジスタ分散・共有アーキテクチャを対象としたフロアプラン指向高位合成手法
大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2005 ( 121 ) 73 - 78 2005年11月
重回帰分析により得られた1次式によるインダクタンスを考慮した配線遅延の見積り
鈴木 康成, マルタディナタアンワル, 戸川 望, 柳津 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2005 ( 121 ) 109 - 114 2005年11月
レジスタ分散・共有アーキテクチャを対象としたフロアプラン指向高位合成手法
大智 輝, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 105 ( 442 ) 31 - 36 2005年11月
重回帰分析により得られた1次式によるインダクタンスを考慮した配線遅延の見積り
鈴木 康成, アンワル マルタディナタ, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 105 ( 442 ) 67 - 72 2005年11月
Asia and South Pacific Design Automation Conference 2005(ASP-DAC 2005, アジア・南太平洋設計自動化会議2005)
戸川 望
電子情報通信学会誌 88 ( 4 ) 303 - 303 2005年04月
Sum-Product アルゴリズムによる信頼度情報の伝播を改善する部分並列LDPC復号器の実装と評価
清水 一範, 石川 達之, 戸川 望, 池永 剛, 後藤 敏
電子情報通信学会技術研究報告. VLD, VLSI設計技術 104 ( 709 ) 73 - 78 2005年03月
Sum-Product アルゴリズムによる信頼度情報の伝播を改善する部分並列LDPC復号器の実装と評価
清水 一範, 石川 達之, 戸川 望, 池永 剛, 後藤 敏
電子情報通信学会技術研究報告. ICD, 集積回路 104 ( 711 ) 73 - 78 2005年03月
A Hardware/Software Cosynthesis Algorithm for Processors with Heterogeneous Datapaths
MIYAOKA Yuichiro, TOGAWA Nozomu, YANAGISAWA Masao, OHTSUKI Tatsuo
IEICE transactions on fundamentals of electronics, communications and computer sciences 87 ( 4 ) 830 - 836 2004年04月
面積制約を考慮したCAMプロセッサ向けハードウェア/ソフトウェア協調設計手法
石川 裕一朗, 宮岡 祐一郎, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2003 ( 105 ) 175 - 180 2003年10月
高位合成システムにおけるスレッド分割を用いた低消費電力化手法
内田 純平, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 102 ( 684 ) 7 - 12 2003年02月
SIMD型プロセッサコア向けHW/SW分割におけるSIMD型演算最適化手法
太刀掛 宏一, 宮岡 祐一郎, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 102 ( 684 ) 13 - 18 2003年02月
閾値検索機能付きCAMプロセッサの最適化手法
戸塚 崇夫, 宮岡 祐一郎, 石川 裕一朗, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 102 ( 684 ) 19 - 24 2003年02月
高位合成システムにおけるスレッド分割を用いた低消費電力化手法
内田 純平, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ICD, 集積回路 102 ( 686 ) 7 - 12 2003年02月
SIMD型プロセッサコア向けHW/SW分割におけるSIMD型演算最適化手法
太刀掛 宏一, 宮岡 祐一郎, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ICD, 集積回路 102 ( 686 ) 13 - 18 2003年02月
閾値検索機能付きCAMプロセッサの最適化手法
戸塚 崇夫, 宮岡 祐一郎, 石川 裕一朗, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ICD, 集積回路 102 ( 686 ) 19 - 24 2003年02月
ハードウェアIPの応答時間を考慮したプロセッサコアのハードウェア/ソフトウェア分割手法
田川 博規, 小原俊逸, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2003 ( 7 ) 93 - 98 2003年01月
ハードウェアIPの応答時間を考慮したプロセッサコア合成システム
小原俊逸, 田川 博規, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2003 ( 7 ) 87 - 92 2003年01月
MPEG-4コアプロファイル符号化に対応した専用演算器を持つDSP
石本 剛, 宮岡 祐一郎, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2003 ( 7 ) 81 - 86 2003年01月
MPEG-4コアプロファイル符号化に対応した専用演算器を持つDSP
石本 剛, 宮岡 祐一郎, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 102 ( 611 ) 25 - 30 2003年01月
MPEG-4コアプロファイル符号化に対応した専用演算器を持つDSP
石本 剛, 宮岡 祐一郎, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 102 ( 609 ) 25 - 30 2003年01月
A High-Level Energy-Optimizing Algorithm for System VLSIs Based on Area/Time/Power Estimation
NODA Shinichi, TOGAWA Nozomu, YANAGISAWA Masao, OHTSUKI Tatsuo
IEICE transactions on fundamentals of electronics, communications and computer sciences 85 ( 12 ) 2655 - 2666 2002年12月
High-Level Area/Delay/Power Estimation for Low Power System VLSIs with Gated Clocks
NODA Shinichi, TOGAWA Nozomu, YANAGISAWA Masao, OHTSUKI Tatsuo
IEICE transactions on fundamentals of electronics, communications and computer sciences 85 ( 4 ) 827 - 834 2002年04月
Packed SIMD 型演算器を持つディジタル信号処理プロセッサのためのリターゲッタブルシミュレータ生成手法
笠原 亨介, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 101 ( 695 ) 17 - 24 2002年03月
システムVLSIのための高位面積/遅延/消費電力見積もりに基づく低消費電力指向高位合成手法
野田 真一, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2002 ( 5 ) 169 - 176 2002年01月
制御処理ハードウェアの高位合成システムにおける面積/遅延見積もり手法
余田 貴幸, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2001 ( 12 ) 25 - 32 2001年02月
発見的算法と分枝限定法を用いた計算時間予測に基づくリソースバインディング手法
中村 洋, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 2001 ( 2 ) 65 - 72 2001年01月
発見的算法と分枝限定法を用いた計算時間予測に基づくりソースバインディング手法
中村 洋, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 100 ( 534 ) 17 - 24 2001年01月
発見的算法と分枝限定法を用いた計算時間予測に基づくリソースバインディング手法
中村 洋, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 100 ( 532 ) 17 - 24 2001年01月
機能メモリを使用したプロセッサの面積/遅延見積り手法 (デザインガイヤ2000) -- (VLSIの設計/検証/テスト及び一般)
余傳 達彦, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告 100 ( 475 ) 83 - 88 2000年11月
CAMプロセッサを対象とするハードウェア/ソフトウェア協調合成システム (デザインガイヤ2000) -- (VLSIの設計/検証/テスト及び一般)
涌井 達彦, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告 100 ( 475 ) 89 - 94 2000年11月
機能メモリを使用したプロセッサの面積/遅延見積り手法
余傳 達彦, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ICD, 集積回路 100 ( 474 ) 83 - 88 2000年11月
機能メモリを使用したプロセッサの面積/遅延見積り手法
余傳 達彦, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 100 ( 473 ) 83 - 88 2000年11月
ディジタル信号処理向けプロセッサコアの面積/遅延見積り手法 (デザインガイア'99--VLSIの設計/検証/テスト及び一般)
片岡 義治, 吉澤 大, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告 99 ( 479 ) 1 - 8 1999年11月
2種類のレジスタファイルを持つディジタル信号処理向けプロセッサのハードウェア/ソフトウェア分割手法 (デザインガイア'99--VLSIの設計/検証/テスト及び一般)
桜井 崇志, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告 99 ( 479 ) 9 - 16 1999年11月
制御処理ハードウェアの高位合成システムのための面積/時間最適化アルゴリズム
家長 真行, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 99 ( 317 ) 15 - 22 1999年09月
制御処理ハードウェアの高位合成システムのための面積/時間最適化アルゴリズム
家長 真行, 戸川 望, 柳澤 政生
電子情報通信学会技術研究報告 99 ( 317 ) 15 - 22 1999年09月
FPGAを用いた動的再構成可能システムとその応用
長谷川 洋平, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 98 ( 625 ) 17 - 24 1999年03月
FPGAを用いた動的再構成可能システムとその応用
長谷川 洋平, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. ICD, 集積回路 98 ( 626 ) 17 - 24 1999年03月
2種類のレジスタファイルを持ったディジタル信号処理向けプロセッサのハードウエア/ソフトウエア協調合成システムとその並列化コンパイラ
中村 剛, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告. 設計自動化研究会報告 99 ( 12 ) 113 - 120 1999年02月
機能メモリを使用したプロセッサを対象とするハードウェア/ソフトウェア協調合成システム
寺島 信, 戸川 望, 柳澤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 98 ( 291 ) 31 - 38 1998年09月
機能メモリを使用したプロセッサを対象とするハードウェア/ソフトウェア協調合成システム
寺島 信, 戸川 望, 柳澤 政生, 大附 辰夫
情報処理学会研究報告. 設計自動化研究会報告 98 ( 87 ) 83 - 90 1998年09月
An FPGA Layout Reconfiguration Algorithm Based on Global Routes for Engineering Changes in System Design Specifications
TOGAWA Nozomu, HAGI Kayoko, YANAGISAWA Masao, OHTSUKI Tatsuo
IEICE transactions on fundamentals of electronics, communications and computer sciences 81 ( 5 ) 873 - 884 1998年05月
A Performance-Oriented Simultaneous Placement and Global Routing Algorithm for Transport-Processing FPGAs
TOGAWA Nozomu, SATO Masao, OHTSUKI Tatsuo
IEICE transactions on fundamentals of electronics, communications and computer sciences 80 ( 10 ) 1795 - 1806 1997年10月
A Circuit Partitioning Algorithm with Path Delay Constraints for Multi-FPGA Systems
TOGAWA Nozomu, SATO Masao, OHTSUKI Tatsuo
IEICE transactions on fundamentals of electronics, communications and computer sciences 80 ( 3 ) 494 - 505 1997年03月
A fast scheduling algorithm in high-level synthesis system for digital signal processing
TOGAWA N.
Proc. IPSJ DA Symposium '97 167 - 172 1997年
Simultaneous Placement and Global Routing for Transport-Processing FPGA Layout
TOGAWA Nozomu, SATO Masao, OHTSUKI Tatsuo
IEICE transactions on fundamentals of electronics, communications and computer sciences 79 ( 12 ) 2140 - 2150 1996年12月
プリント配線板を対象とした二層均等化スペーシング手法 (<特集> レイアウトと一般)
金井 宏和, 戸川 望, 佐藤 政生, 大附 辰夫
情報処理学会研究報告. 設計自動化研究会報告 96 ( 51 ) 9 - 14 1996年05月
パス遅延制約を考慮したマルチFPGA用回路分割手法
電子情報通信学会第9回回路とシステム軽井沢ワークショップ論文集 1996年04月
条件分岐構造を持つコントロールデータフローグラフの時間制約スケジューリング手法
石渡 宏明, 戸川 望, 佐藤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 95 ( 561 ) 31 - 36 1996年03月
イタレーション間データ依存制約を考慮したパイプライン化DSPスケジューリング手法
西田 浩一, 戸川 望, 佐藤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 95 ( 561 ) 37 - 44 1996年03月
エントロピーCODECの高位合成手法
鈴木 克青, 戸川 望, 佐藤 政生, 大附 辰夫
情報処理学会研究報告. 設計自動化研究会報告 96 ( 16 ) 25 - 30 1996年02月
動作記述からのデータフローグラフ生成手法
川田 容子, 戸川 望, 佐藤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 95 ( 307 ) 55 - 62 1995年10月
リソースアロケーションを考慮したデータパス・スケジューリング手法
西田 浩一, 戸川 望, 佐藤 政生, 大附 辰夫
電子情報通信学会技術研究報告. VLD, VLSI設計技術 95 ( 307 ) 63 - 70 1995年10月
動作記述からのデータフローグラフ生成手法
川田 容子, 戸川 望, 佐藤政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 1995 ( 99 ) 137 - 144 1995年10月
リソースアロケーションを考慮したデータパス・スケジューリング手法
西田 浩一, 戸川 望, 佐藤政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 1995 ( 99 ) 145 - 152 1995年10月
マルチFPGAを対象とした階層的回路分割手法
戸川 望, 佐藤 政生, 大附 辰夫
電子情報通信学会技術研究報告. CAS, 回路とシステム 95 ( 106 ) 69 - 76 1995年06月
A circuit partitioning algorithm with replication capability for multi-FPGA systems
TOGAWA N.
IEICE Trans. Fundamentals 78 ( 12 ) 1765 - 1776 1995年
Maple : LUT-FPGAを対象としたテクノロジーマッピング・配置・概略配線同時処理手法
佐藤 政生, 戸川 望, 大附 辰夫
電子情報通信学会技術研究報告. CPSY, コンピュータシステム 94 ( 257 ) 41 - 48 1994年09月
節点がレベル付けされたグラフの最小枝交差描画問題に関する一考察
松本 英幸, 佐々木 整, 梅田 達也, 戸川 望, 佐藤政生, 竹谷 誠, 大附 辰夫
情報処理学会研究報告アルゴリズム(AL) 1994 ( 82 ) 49 - 56 1994年09月
BDDを用いたマンハッタン配線問題の解法
梅田 達也, 戸川 望, 佐藤政生, 大附 辰夫
情報処理学会研究報告アルゴリズム(AL) 1993 ( 88 ) 35 - 42 1993年10月
FPGAを対象とした階層的概略詳細配線手法
戸川 望, 粟島 亨, 金子 一哉, 佐藤 政生, 大附 辰夫
電子情報通信学会論文誌. A, 基礎・境界 76 ( 9 ) 1312 - 1321 1993年09月
ロングラインに対応した階層的FPGA配線手法
曽根原 理仁, 戸川 望, 柳澤 政生, 大附 辰夫, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 1993 ( 22 ) 17 - 24 1993年03月
粟島 亨, 戸川 望, 金子 一哉, 佐藤政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 1992 ( 43 ) 223 - 228 1992年05月
粟島 亨, 金子 一哉, 戸川 望, 佐藤政生, 大附 辰夫
情報処理学会研究報告システムLSI設計技術(SLDM) 1992 ( 43 ) 179 - 184 1992年05月
Master's Thesis (Department of Computer Science and Communications Engineering)
大学院基幹理工学研究科
2024年 通年
理工学術院 大学院基幹理工学研究科
附属機関・学校 グローバルエデュケーションセンター
次世代コンピューティング基盤研究所 プロジェクト研究所所長
データ科学センター 兼任センター員
国際情報通信研究センター 兼任研究員
理工学術院総合研究所 兼任研究員
各務記念材料技術研究所 兼任研究員
カーボンニュートラル社会研究教育センター 兼任センター員
リサーチイノベ オープンイノベーション推進セクション 兼任センター員
2021年
不安定な環境発電でも永続動作可能とする超低エネルギーでロバストな集積回路設計技術
2018年 木村 晋二, 多和田 雅師, 川村 一志
環境発電の不安定な微小電力で永続動作する超低エネルギー・ロバスト集積回路設計技術
2016年 木村晋二
書込みビット数を1桁削減する書込み削減符号の構築とノーマリオフ技術への展開
2014年 多和田雅師
世界最速を達成するメニーコアプロセッサのキャッシュ構成シミュレータの研究開発
2013年 多和田 雅師
2011年 多和田 雅師
2005年
Click to view the Scopus page. The data was downloaded from Scopus API in July 01, 2024, via http://api.elsevier.com and http://www.scopus.com .